Arquitectura harvard y von neumann carlos jaspe
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UNIVERSIDAD NACIONAL EXPERIMENTAL POLITÉCNICA “ANTONIO JOSÉ DE SUCRE” VICE- RECTORADO “LUIS CABALLERO MEJÍAS” NÚCLEO: CHARALLAVE ARQUITECTURA VON NEUMANN Y ARQUITECTURA HARVARD CARLOS JASPE N° DE EXP. 2011247222 C.I. 23.798.046
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UNIVERSIDAD NACIONAL EXPERIMENTAL POLITÉCNICA
“ANTONIO JOSÉ DE SUCRE”VICE- RECTORADO “LUIS CABALLERO MEJÍAS”
NÚCLEO: CHARALLAVE
ARQUITECTURA VON NEUMANN Y
ARQUITECTURA HARVARD
CARLOS JASPEN° DE EXP. 2011247222C.I. 23.798.046
ARQUITECTURAS
VON N
EUM
ANN
HARVARD
Microprocesadores Microcontroladores
Tiene la unidad central de proceso (CPU) conectada a dos memorias (una con las instrucciones y otra con los datos)
Se conecta por medio dedos buses diferentes
La unidad central de proceso (CPU),está conectada a una memoriaprincipal única (casi siempre sólo RAM)
En ésta se guardan las instrucciones del programa y los datos.
ARQUITECTURA VON NEUMANNORIGEN:
Surge a raíz de una colaboración en el proyecto ENIAC del matemático de origen húngaro, John von neumann
Von neumann se interesó por el problema de la necesidad de recablear la máquina para cada nueva tarea.
El término arquitectura de von Neumann se acuñó a partir del memorando First Draft of a Report on the EDVAC (1945) escrito por el conocido matemático John Von Neumann en el que se proponía el concepto de programa almacenado
El primer computador comercial construido en esta forma fue el UNIVAC I, fabricado en 1951 por la Sperry-Rand Corporation y comprado por la Oficina del Censo de Estados Unidos.
ARQUITECTURA VON NEUMANN
La limitación de la velocidad de operación a causa del bus único para datos e instrucciones que no deja acceder simultáneamente a unos y otras, lo cual impide superponer ambos tiempos de acceso.
La limitación de la longitud de las instrucciones por el bus de datos, que hace que el microprocesador tenga que realizar varios accesos a memoria para buscar instrucciones complejas.
LIMITACIONES:
ARQUITECTURA HARVARD
ORIGEN:El término proviene de la computadora Harvard Mark I, que almacenaba las instrucciones en cintas perforadas y los datos en interruptores.
En los últimos años la velocidad de las CPUs ha aumentado mucho en comparación a la de las memorias con las que trabaja.
Las instrucciones y los datos se almacenan en cachés separadas para mejorar el rendimiento.
Tiene el inconveniente de tener que dividir la cantidad de caché entre los dos, por lo que funciona mejor sólo cuando la frecuencia de lectura de instrucciones y de datos es aproximadamente la misma.
ARQUITECTURA HARVARD
El tiempo de acceso a las instrucciones puede superponerse con el de los datos, logrando una mayor velocidad en cada operación.
El tamaño de las instrucciones no esta relacionado con el de los datos, y por lo tanto puede ser optimizado para que cualquier instrucción ocupe una sola posición de memoria de programa, logrando así mayor velocidad y menor longitud de programa.
VENTAJAS:
