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E S C U E L A P O L I T É C N I C A N A C I O N A L

F A C U L T A D DE INGENIERÍA E L É C T R I C A

SISTEMA DE E V A L U A C I Ó N

P A R A M I C R O P R O C E S A D O R E S

Z 8 0 , 6 8 0 0 , 8 0 8 5 A

P O R :

FERNANDO EDUARDO A L V E A R TROUP

TESIS PREVIA A LA OBTENCIÓN DEL TITULO DE INGENIERO

EN ELECTRÓNICA Y TELECOMUNICACIONES DE LA ESCUELA

POLITÉCNICA NACIONAL

Q u i t o , D i c i e m b r e d e 1983

Certifico que el presente

trabajo ha sido elaborado

en su totalidad por el s£

ñor: Fernando E. Alvear.

:NG. ALFONSO ESPINOSA R.

Director de Tesis

D E D I C A T O R I A

A mis padres .

ÍNDICE

I. INTRODUCCIÓN I

II. DISEÑO *

2.1. ESPECIFICACIONES 1

2.2. DISEÑO DEL HARDWARE 2

2.2-1. DESCRIPCIÓN GENERAL 2

2. 2-71.a. DIAGRAMA DE BLOQUES 2

2.2-l.b. DESCRIPCIÓN FUNCIONAL • 3

2.3. UNIDADES CENTRALES DE PROCESO 6

2.4. CIRCUITOS DE ENTRADA Y SALIDA (I/O; 9

2.4-1. INGRESO DE DATOS Y DIRECCIONES 9

.2.4-^2. GENERACIÓN DE SEÑALES DESDE EL TECLADO 9

2.4-3. INDICADORES DE DATOS Y DIRECCIONES 11

2.4^4. INDICADORES DE STATUS 12

2.5. MEMORIA 13

2.6. BUFFERS 16

2.6-1. BUFFERS DE DATOS Y DIRECCIONES DE LOS

uPs 16

2.6-2. BUFFERS DE DATOS Y DIRECCIONES DE TECLA-

DO 18

2.6-3. BUFFERS DE INTERCONECCION 20

2.7. CIRCUITOS DE CONTROL 21

2.7-1. SEÑALES BÁSICAS ' 21

2.7-2. INTERRUPCIONES ' 22

2 . 7 r-3 . CONTROL DE I/O 24

2.7-4. CONTROL DE TRANSFERENCIA DE DATOS CON

LOS UPS EN ALTA IMPEDANCIA 26

2.7-4.a. INICIALIZACION DEL SISTEMA PARA LA

PROGRAMACIÓN ' 26

2 . 7-4.b . INGRESO DE DATOS 29

2.7-4.C. LECTURA DE LOCALIDADES DE MEMORIA 33

2.7-r5. SELECCIÓN DE LOS uPs 38

2.7-6. CONTROL DE TRANSFERENCIA DE DATOS BAJO

COMANDO DE LOS uPs 42

2 . 7- 7 . CONTROL DE INICIALIZACION (R13SUT) 4 5

2.'8. PROGRAMADOR DE EPROMS 48

2.9. • FUENTES DE PODER 50

2.10. DISEÑO DEL SOFTWARE 52

2 . 10-7 1 .DIAGRAMAS DE FLUJO 52

2.10-2.PROGRAMAS 60

III. OPERACIÓN DEL SISTEMA 61

3.1. DESCRIPCIÓN DEL PANEL 61

3.1-1. DESCRIPCIÓN DE LOS TECLADOS 61

3.1-r2. INDICADORES DE STATUS 66

3.1-2.a. INDICADORES DE STATUS DEL MONITOR 66

3.1-2.b. INDICADORES DE STATUS DE LOS uPs 66

3.1-2.C. INDICADORES DE PROGRAMACIÓN DE EPROMS 67

3.2. ENCENDIDO, POR Y REUBICACION DE MEMORIA 67

3.3. PROCESOS DE OPERACIÓN 68

3.3-1 INTRODUCCIÓN DEL PROGRAMA DEL USUARIO 68\2 USO DE LOS MONITORES 72

3.3-2.a. 280 72

3.3-2 tb. 8085A 85

3.3-2.c. 6800 86

3.4. USO DEL SISTEMA CON CIRCUITOS EXTERNOS 86

3.4-1. PERIFÉRICOS EXTERNOS 90

3.4-2. uPs EXTERNOS 93

IV. CONSTRUCCIÓN 94

4.1. DISTRIBUCIÓN GENERAL 94

4.2. DISTRIBUCIÓN DE ELEMENTOS EN LAS TARJE-

TAS 96

V. EXPERIMENTACIÓN Y CONCLUSIÓN 122

VI. BIBLIOGRAFÍA 124

* VII. APÉNDICES 125

I N T R O D U C C I Ó N

"El microprocesador es uno de los desarrollos

tecnológicos más excitantes desde que apareció el -transij^

tor en 1948. Se ha predicho que este artefacto no sólo

revolucionará el campo de la electrónica digital, sino

que tendrá una gran influencia sobre el modo de vida de

las generaciones presente y futura". (Traducido de "Mi-

cro comp u ters and Microprocessors: Hardware, Software

and Applications," Prentice-Hall, Inc. 1976 .JOHN L.-=•

HILBURN- PAUL M. JULICH.)

A esta fecha, siete años después de la publica-

cación del libro mencionado, la cita anterior ha sido

completamente comprobada.

Dentro de la amplia gama de microprocesadores

existentes, son tres los que pueden considerarse como

los que más difusión han tenido y que han servido de ba-

se para el desarrollo de otros mas sofisticados y efica-

ces; éstos son: el 8085A de INTEL CORPORATION, el 6800

de MOTOROLA INC. y el Z80 de 2ILOG INC.

La mayoría de los fabricantes de microprocesado

res, sino todos/ fabrican también pequeños sistemas .llama-

dos de "evaluación", cuyo principal objetivo es el de

proporcionar un medio de familiarización con el micropro_

cesador pertinente. El lenguage de programación de es-

tos sistemas es el hexadecimal, salvo alguno que otro

caso en el que existe un ensamblador de un paso. Estos

II

sistemas soportan solamente un microprocesador, haciendo

que la familiarización con varios diferentes sea un pro-

blema básicamente económico.

Considerando ésto, se decidió que la presente

tesis incorpore los tres micros mencionados anteriormen-

te en un solo sistema. Además de ésto, se incorporará

un pequeño programador de EPROMS bajo el control del Z80.

Al describir las diferentes partes del circuito

se hará referencia a las coordenadas en el diagrama gene-

ral del mismo. Estas coordenadas están encerradas entre

paréntesis. Como ejemplo: 280, (2D); al localizar el

integrado respectivo en el diagrama se encontrará junto

a él un código alfa-numérico que indica su localización

en la tarjeta respectiva del aparato. Así, para el ejem

pío anterior, se encontrará junto al Z80 elcódigo 3TD , que

indica que el circuito integrado está localizado en la

tarjeta 3, columna T, fila D. En algunos casos, los in-

tegrados se encuentran compartiendo dos filas y/o dos

columnas, en este caso habrán mas de dos letras después

del numero de la tarjeta.

Al analizar la parte circuital de la Tesis, se

podrá ver que muchos circuitos pueden eliminarse, si se

incorpora su función en los programas de monitor. Sin

embargo, es necesario señalar que al momento de realizar

la Tesis, no se tenía acceso a ningún equipo que facili-

tara esta tarea, de ahí que se tuvo que recurrir a im-

III

plementar circuitalmente muchas funciones.

II. DISEÑO

2.1. ESPECIFICACIONES

Como se menciono en la introducción, el siste-

ma de evaluación de microprocesadores, acerca del cual

trata esta tesis, llevará incorporados los microprocesa-

dores Z80 de ZILOG INC., 6800 de MOTOROLLA INC, y 8085A -

de INTEL CORPORATION.

Para facilitar la familiarización del'usuario

con cada uno de estos uPsl/, el sistema tendrá un progra-

ma monitor por cada uno que se encargará de realizar las

funciones correspondientes a la evaluación de programas

y registros de los úPs.

Los programas monitores estarán en memoria no-

volátil (EPROM) , mientras g_ue datos y programas del usua-

rio se almacenarán en RAM.

Por medio de un teclado el usuario ingresará da-

tos y/o instrucciones al sistema, el c.ual a su vez se

comunicará con el usuario mediante un grupo de indicado-

res visuales (displays) y LEDS.

Para poder expandir la memoria del sistema, así

como poder utilizar la familia de circuitos integrados

periféricos de cada uP, se deberá poder tener acceso,

desde el exterior^ a los buses de datos y direcciones así

como señales de control de los .UP s .

2.2. DISEÑO DEL HARDWARE

2.2rl. DESCRIPCIÓN GENERAL

2.2-1.a. DIAGRAMA DE BLOQUES

2<e:

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S í!

2.2^1.b. DESCRIPCIÓN FUNCIONAL

TECLADO DE DATOS Y MONITOR

Estos contienen 19 teclas cada uno, teniendo

el de DATOS 16 teclas para generar caracteres aexadecima-

les (los datos propiamente dichos) y 3 de control que se

suman a las 19 teclas del MONITOR para un total de 22

teclas para operación y control del sistema.

DECODIPICñDORES DEL TECLADO.

Son decodificadores-registros para 20 teclas

y se encargan de monitorear el teclado y presentar las

señales y palabras de control, en forma binaria, al

bloque de control, y los caracteres hexadecimales a los

registros de direcciones y datos.

REGISTROS DE DIRECCIONES Y DATOS

El registro de direcciones se conecta a través

de un buffer de 16 bits co'n el' bus de direcciones del

sistema. Contiene contadores UP/DOWN para así leer lo-

calidades sucesivas de memoria, ya sea hacia arriba,

(incremento de direcciones) o hacia abajo (decremento

de direcciones). •

El registro de datos conecta a éstos al bus de

los indicadores de datos a través de dos buffers de 8 bits

cada uno.

Estos constan de 4 indicadores hexadecimales

cada uno. Los indicadores de DIRECCIONES se encienden

cuando el sistema está en el modo de programación o. los

microprocesadores están en estado de alta impedancia.

En los indicadores de DATOS , los dos más significativos

se encienden o apagan automáticamente según sea requerido

durante las diversas operaciones del sistema mientras

que los menos significativos siempre están encendidos.

BUFPERS.

Estos unen a los microprocesadores con los bu-

ses de direcciones y datos del sistema y con los regis-

tros que guardan la información proveniente de los tecla-

dos. También están considerados dentro de los BUFPERS

los circuitos integrados que sirven para la lectura y es

critura, por parte de los microprocesadores, de datos re

queridos durante su operación.

MEMORIA.

Esta tiene dos áreas: una de EPROM y otra de

RAM. En el área de BPROM se encuentran los programas

monitores del sistema. En el área de RAM se almacenan

tanto los datos intermedios de los programas monitores

como los programas del usuario.

CONTROL DE PROGRAMACIÓN/LECTURA DE EPROMS.

Este bloque contiene la circultería necesaria

para la programac-ión o lectura de las siguientes EPROMS:

2716 (1K x 8 bytes) y las dos versiones de la 2758 (1K x 8

bytes). Estas tres memorias requieren una sola fuente

de + 5V para su funcionamiento normal y una adicional

de + 25 V para su programación.

INDICADORES DE STATUS.

Son un conjunto de dio.dos emisores de luz (LEDs)

que señalan al usuario la operación en proceso y el sta-

tus delsistema.

UNIDADES CENTRALES DE PROCESO.

En este bloque están comprendidos los tres mi-

croprocesadores residentes del sistema: 280, 8085A y

6800.

Además, se incluyen los circuitos básicos nece-

sarios para el funcionamiento de dichos microprocesadores

como la generación de las señales de reloj respectivas

y un registro/buffer para el bus de datos del 8085A.

CONTROL

Contiene todos los circuitos necesarios para

el control total de la .operación del sistema por el usua

rio y ciertos procesos-por los microprecesadores.

2.3. UNIDADES CENTRALES DE PROCESO

Z80/8085A/6800/OTROS POSIBLES

Los tres microprocesadores residentes en el sis-

tema son de 8 bits y tienen capacidad para direcciónar

directamente 64K bytes de memoria. El Z80 y el 8085A

direccionan separadamente memoria y periféricos mientras

que el 6800 no establece ninguna diferencia entre ambos.

En cuanto a los circuitos adicionales necesarios

para su funcionamiento, el Z80 y el 6800 necesitan de ge-

neración externa de los pulsos de reloj mientras que el

8085A necesita de un registro de 3-estados para obtener

los 8 bits menos significativos de las direcciones, a

partir del bus de datos por ser los datos y los 8 bits

menos significativos de las direcciones multiplexados

en este bus.

Estos microprocesadores, en cuanto a los buses

de datos y direcciones se refiere, están conectados en

paralelo y separados del resto del sistema por buffers

de 3-estados, cuyo objetivo es colocar la meno£ carga

posible a los uPs.

Algunas señales de control están también en pa-

ralelo , como son las de escritura (WR) y lectura (RD).

Cabe señalar aquí que el 280 y el 8085A tienen estas señales

7

separadas, a diferencia del 6800 que tiene una sola señal

para ambos propósitos (R/W). Además, el Z80 tiene una s_e

nal para procesos de memoria (MREQ) y una para procesos

de I/O (IORQ) , mientras que el 8085A tiene uno solo 'para

ambos propósitos (IO/M) y el 6800 no tiene ninguno.

El manejo tanto de memoria como periféricos fue

diseñado alrededor de las señales de control del Z80 y

por tanto fue necesario generar las respectivas señales

en base a las existentes en los ü;.Ps restantes.

Para el 8085A (2B), IO/M está conectado direc-

tamente a MREQ del Z80 (2D) ya que para proceso.s; de

memoria las dos líneas funcionan igual. Para procesos

I/O, IO/M se conecta a través de un inversor de 3-esta-

dos (2H) con IORQ del 280 7 este inver.sor se habilita

solamente cuando se selecciona el 8085A.

Para el 6800 (2F), antes de obtener estas seña-

las separadas es necesario una señal de habilitación para

estas. Dicha señal se logra haciendo una función AND en-

tre la señal VMA del 6800, a través de los inversores

(II), y MEM CLK del generador de fases de reloj MC6875L

(4J), función que se logra con la compuerta AND de colee

tor abierto ( 1IH). La función que realizan los inver-

sores (II) se explicara mas adelante.

Para la señal rOT se hace un AND de R/W con la

señal anterior ( R/W. VM. MEM CL'.K) , (3H) , y luego se in-

vierte ésta (3H), conectándose luego la señal obtenida

a RD en el Z80 y 8085A.

Para la señal WR , R/W pasa a través de un inver-

sor de colector abierto (2H) y se hace el sincronismo con

la señal especial de habilitación como en el caso ante-

rior, obteniéndose R/W • VMA ' MEMCLK mediante el AND y el

inversor respectivo ( 3H), siendo luego conectado a WR

en los otros uPs.

La señal MREQ se obtiene a partir de la señal

BA del 6800 y una señal de habilitación proveniente del

biestable ( 9F) , pin 9, la cual está en 1L mientras

esté seleccionado el 6800. Estas dos señales, a través

del circuito formado por los ÑOR (lj), el ÑOR (3K) y el

transistor conectado a la salida de éste, generan la se-

ñal MREQ, la cual está siempre presente ( no es un pulso)

mientras esté seleccionado el 6800. La habilitación de

memoria o periféricos depende entonces solo de RD o WR.

Para IORQ, solo se invierte VMA mediante el in

versor de colector abierto ( 2H). Esta señal, sin embar-

go, hace un OR (2H) con la señal proveniente de la com-

puerta AND (1H) que realiza la función lógica RD • WR

sincronizando de esta manera IORQ con -RD o WR. Esta com-'

puerta OR (2H) es común a los 2 uPs.

En cuanto a-las señales de reloj necesarias pa-

ra los uPs, el 8085A necesita de un cristal que se conec-

ta, directamente a dos terminales que tiene para este

propósito; la frecuencia de oscilación del cristal utili-

zado es 4 MHz y esta frecuencia se obtiene dividida por

2, en un terminal dedicado del mismo 8085A. Este reloj

es de niveles TTL y en este caso es de aproximadamente

4V. Pasando esta señal de reloj a través de una compuer-

ta AND (IB) se obtiene una señal de reloj que se usa pa-

ra diversos propósitos en el resto del sistema, obtenien-

do además un "FAN-OUT" de una compuerta TTL normal. Es-

ta señal pasa también por una compuerta de colector abier

to (IB) y se conecta luego a la entrada CLK del Z80. La

resistencia recomendada por el fabricante, que debe ser

conectada a la salida de la compuerta de colector abier-

to que maneja a la entrada CLK, es de 330 J * - , para cum-

plir las características AC y DC de dicha entrada.

•Para el 6800 se utilizo un circuito integrado

dedicado para generar las críticas fases no superpuestas

de reloj que éste necesita. Este circuito integrado es

el MC6875L (4J), y la frecuencia que genera para este

caso, está entre 900 KHZ y 1 MHZ.

2.4. CIRCUITOS DE ENTRADA Y SALIDA (I/O)

2.4-1. INGRESO DE DATOS Y DIRECCIONES

El principal circuito de este grupo es el que

se encarga de la decodificacion de los teclados y de la

generación de caracteres hexadecimales y señales básicas

de control.

Para decodificar los dos teclados de, 19 teclas

cada uno, se utilizan dos circuitos integrados 74C923

cada uno con capacidad para manejar 20 teclas arregladas

en una matriz de 4 x 5. El primero de ellos (7L) se en-

carga de los caracteres hexadecimales y tres señales de

control; el segundo ( 1 3 J) maneja el resto de las seña-

les de control, que con las tres anteriores suman un to-

tal de 22. Los caracteres hexadecimales, en el caso de que

sean direcciones, son cargados en contadores "UP/DOWN" pro

gramables ( 7 K, 7K, 8K, 9K) componiendo así los 16 bits

para direccionar las diferentes localidades de memoria.

En el caso de que sean datos, son cargados en dos regis-

tros de 4 bits 74C175 (10K,11K) obteniéndose así los 8

bits de datos.

2.4-2. GENERACIÓN DE SEÑALES DESDE EL TECLADO.

Estas señales se obtienen del decodificador

10

74154 (15J) y del decodificador 74L3155 (8L) . El decofi-

cador de teclado (13J) comanda al decodificador (15J) y

la mitad del decodificador (8L), mientras que el otro deco_

dificador de teclado (7L) comanda a la otra mitad del de-

codificador (8L). Los dos bits menos significativos de

los decodificadores de teclado (7L) y (13J) son comunes

a ambas mitades del decodificador (8L) y llegan a través

de un circuito AND-OR-INVERT 74LS51 (9L)que hace las ve-

ces de un multiplexer doble 2 a 1.

La habilitación de cada mitad del decodificador

(8L) se logra mediante dos señales para cada mitad; una

de ellas (la entrada C) proviene del bit mas significati-

vo de cada decodificador de teclado mientras que la otra

(la entrada G) proviene de las señales DA- de los mismos

decodificadores de teclado (7L) y (13J) , previamente tra

tados por el circuito formado por los biestables (12L) y

(13L)-(14L). Estos circuitos adicionales fueron necesa-

rios debido a la forma en que trabajan los 74C923 al

momento de señalar la presencia de un dato válido en sus

salidas. Esto es, la señal DA indica una entrada válida

del teclado y está presente antes de que se estabilize el

dato correspondiente a la salida (máximo 150 ns antes).

Esta señal, al ser aplicada directamente a la entrada

de habilitación respectiva del decodificador (8L) genera-

ría dos pulsos diferentes a la salida en vez de uno solo

como es lo deseado. Esto se debe a que como la señal DA

está presente antes que el dato, se habilita la mitad

respectiva del decodificador (8L) con el dato presente

11

al momento de activarse DA y luego cambia su salida de

acuerdo al dato deseado. Se corrige ésto dando una demo-

ra a la señal DA mediante el circuito de biestables men-

cionado -anteriormente. La demora es el tiempo equivalen-

te a medio ciclo de la señal de reloj aplicada a la entra.

da de reloj en los biestables (aproximadamente 75 u.S.).

Esta señal demorada se obtiene de Q del segundo biestable

en cada circuito de demora, mientras que las señales para

controlar al "multiplexer" (9L) . Se obtienen de las salí.

das Q, a través de los OR (12L y 13L, derecha) respectivo,

de los dos biestables de cada circuito de demora.

2 . 4-: 3 . INDICADORES DE DATOS Y DIRECCIONES

Consisten en dos grupos de 4 indicadores lumino-

sos hexadecimales de 7 segmentos, TIL311, conteniendo ca-

da indicador la lógica necesaria para la retención y con-

versión de 4 bits binarios a 7 segmentos, como también el

manejo de los LEDS que componen los segmentos.

En el grupo de indicadores que muestran las di-

recciones de . localidades de memoria no se utiliza su capa-

cidad de retención de datos ya que éstos son retenidos

en los registros retenedores de direcciones y conectados

a los indicadores a través de los buffers respectivos.

Estos indicadores se encienden solo cuando el sistema es-

tá en el modo de programación. En el 'otro grupo, el de

datos, los dos dígitos menos significativos se encienden

o apagan de acuerdo a las necesidades del sistema; ésto

12

es , cuando el sistema está en el modo de programación es-

tán apagados, y son encendidos bajo control de los progr_a

ma's monitores o del usuario.

Cada indicador tiene, en la parte inferior del

dígito, un LED a cada lado del mismo y que normalmente

se usan para indicar el punto decimal. Se usan estos

LEDS , encendiendo ambos al mismo tiempo, para indicar

el próximo dígito a escribirse. La circuitería que con-

trola estos LEDS asi como la retención de datos en los

indicadores se explica en los numerales 2.7-4.a y 2.7-6

respectivamente.

2.4-4. INDICADORES DE STATUS.

Muestran el status tanto de los programas moni-

tores como de algunas señales de control. En el 'primer

caso, 16 LEDS realizan dicha función y son manejadas

por los retenedores (19H), los cuales son a su vez con-

trolados por el decodificador 74LS154' (13H) que realiza

la función de decodificador de periféricos (I/O) bajo

control de los programas monitores.

'Para el caso de las señales de control, éstas

son manejadas por el retenedor (27E) que trabaja sólo

como buffer. Estas señales son activas algunas en alto

y otras en bajo, por lo cual, para las activas en alto,

se han colocado los inversores (28E) a las salidas res-

pectivas del retenedor (27E) para el encendido de los LEDS.

13

2.5. MEMORIA

El bloque de memoria puede dividirse en tres gru.

pos: MONITOR, RAM DE MONITOR y RAM DEL USUARIO. El MONI_

TOR ocupa tres EPROMS 2716 (2Kx8 bits c/u): dos de ellos

(13C) y (14C) en los primeros 4 K bytes de memoria, mien-

tras que al tercero (15C) en los últimos 2K de memoria.

Este ultimo 2716 no es utilizado totalmente, ocupándose

las siguientes localidades: F800H- F916H y FC00H->FFFFH ;

de manera que quedan libres las localidades F917H-*-FBFFH,

pudiendo ser utilizadas en el futuro para almacenar algún

programa que pueda ser útil al sistema.

El RAM DEL MONITOR es el área de memoria utilizja

do por los programas monitores para almacenar datos obte-

nidos durante los diversos procesos que estos realizan.

Esta área se encuentra en las localidades 1000H-»1125H

El resto de la memoria (aproximadamente 58K bytes!

son para el usuario (RAM DEL USUARIO), comenzando en 1126H

Existen implementados en el sistema 4k bytes de

RAM que se reparten entre RAM del Monitor y RAM del usua-

rio, siendo ésta reubicable mediante el conmutador SW1

(16E) .

Antes de explicar esta reubicación es necesario

explicar la decodificacion para la memoria, tanto EPROM

como RAM. Para ésto se pensó habilitar la memoria resi-

14

dente en el sistema en bloques de IKxS bytes, para lo cual

se requerirán 4 decodificadores 4 a 16 ( 74LS154) , de los

cuales dos están implementados en el sistema (15D)y (15F) ;

un decodificador 2 a 4 (18C) , que habilita a los decodifi-

cadores anteriores, complementa el circuito de decodifica

ci5n de memoria.

El decodificador (15D) selecciona los primeros

16K bytes mientras que el decodificador (15F) selecciona

los últimos 16 K bytes. Los dos decodificadores restan-

tes necesarios deben ser suministrados exteriormente y

seleccionan el segundo y tercer bloque de 16K bytes, re-

cibiendo su habilitación del decodificador (18C) median-

te las salidas 2YI y 2Y2 que son accesibles externamen -

te .

Los primeros 2K bytes de EPROM (13C) se habili-

tan mediante el decodificador (15D), 1.a compuerta AND

(14D) y el OR (13D) . Esta compuerta OR es necesaria de-

bido a que el MP6800 no establece diferencia entre cir-

cuitos de I/O y memoria, y dado que la decodificación

de. I/O fue diseñado alrededor del Z 8 O y se realiza en

los primeros 256 bytes, es necesario deshabilitar los

primeros 2K de memoria (13C) cuando está seleccionado el

6800. El OR (13D) recibe las señales para habilitar lo's

2K de memoria mencionados (13C) del AND (14D) y del ÑOR

(3K) . El AND (14D) recibe las señales de selección de

los primeros 2K de memoria provenientes del decodifica-

dor (15D) mientras que el ÑOR (3K) genera la señal de

15

deshab-ilitación mencionada cuando se selecciona el 6800.

Los siguientes 2K de EPROM (14C) reciben su ha-

bilitación del decodificador (15D) através del AND (15D)

re spectivo.

Los últimos 2K de EPROM (15C) reciben su habili-

tación del decodificador (15F) a través del AND (15D) res-

pectivo .

La RAM incorporada en el sistema recibe su habi-

litación del multiplexer cuádruple 74S257 (16E) que sirve

como " reubicador" de esta, a excepción de los circuitos

de memoria (17D) y (18D) que son utilizados para RAM del

Monitor y se habilitan directamente del decodificador

(15D) r Pin 5, como el quinto K de memoria.

El conmutador SW1 (16E) , como se menciono ante-

riormente, controla la reubicacíón de las áreas de RAM,

y estando en la posición indicada en el diagrama (funcio-

namiento normal) permite que los 2114, que forman la RAM

del sistema, reciban las señales presentes en las sali-

das B del multiplexer (16E). Además, la entrada OE de

los 2716'está puesta a tierra mediante el conmutador

SW1 y su control depende de la entrada CE en cada uno.

La distribución de RAM en este caso, analizando las sal_i

das del multiplexer (16E), es la siguiente: 1Y=5K—6K-1,

2Y = 6K-^7K_1, 3Y = 7K->8K— 1 , y 4Y = 8K-'9K~1 .

16

AL cambiar al conmutador SW1 de posición , la en-

trada ~OE (fe los 2716 se coloca en XL deshabilitando a és-

tos, y la entrada SEL del multiplexer (16E) se coloca a

tierra pasando a sus salidas las señales presentes en las

entradas A, en cuyo caso aquellas tienen la siguiente

distribución de RAM: 1Y = OK-*1K—1 , 2Y = lK-r2K-l , 3Y=6 2K—6 3K— 1 ,

y "-tí. u j jx- -i- .

Esto quiere decir que se pueden utilizar los pr_o_

gramas monitores para desarrollar programas del usuario

y probar éstos, luego, en las localidades en las que es-

tarían en la práctica, es decir, a partir de 0000H en el

caso del Z80 y 8085A, y en el último K de memoria en el

caso del 6800. También es útil ésto al utilizar micro-

procesadores externos al sistema cuya primera instrucción

se obtiene de 0000H o FFFEH.

2.6. BUFFERS

2.6-71. BUFFERS DE DATOS Y DIRECCIONES DE LOS uP s .

'Están formados por 4 circuitos integrados 8212

y separan a los uPs del resto del sistema con el fin de

colocar la mínima carga posible en los respectivos buses

de éstos.

Dos de ellos, (4B) y (4C), son para el bus de

direcciones, y los otros dos, (4E) y (4F), son para el

bus de datos.

17

Los primeros, (4B) y (4C) se habilitan cuando

se selecciona uno de los tres uPs residentes, y se logra

controlando las entradas DS1 y DS2 de estos integrados.

La entrda DS2 está comandada por el selector de uP s

74LS175, (10F) pin 14, que es la señal de habilitación

(activo en OL) para un uP externo, y que al estar en IL

activa la entrada DS2 en los buffers en cuestión. La en.

trada DS1 se desactiva solo cuando el sistema entra en el

modo de programación lo cual se logra mediante el biesta-

ble (16N) pin 9.

Los buffers (4E) y (4F) tienen conectadas las

entradas del uno con las salidas respectivas del otro

formando un buffer de 8 bits de dos vías para el bus de

datos.

La entrada DS2 del buffer (4E) está comandada

por dos señales; la una proveniente del selector de uPs

74LS175 (10F), pin 15, a través del inversor de colector

abierto (5D) que habilita al buffer cuando se selecciona

uno de los uPs residentes, y la otra proveniente del AND

de 4 entradas (3G), a través del transistor (5D) respect^

vo, compuerta que deshabilita al buffer cuando detecta

uh estado de alta impedancia en todos los uPs- Estoes nece

sario para casos como el de transferencia de datos median

te DMA.

La entrada DS1 del buffer (4E)' y la entrada DS2

del buffer (4F) están conectadas entre sí y controladas

18

por la señal WR de los uPs; la entrada DS1 del buffer

(4F) está controlado por la señal proveniente del cir-

cuito formado por los ÑOR (4G), (4G) y (1E).

La señal proveniente de este circuito es equiva-

lente a la señal RD y se genera cuando el uP selecciona-

do ejecuta una operación de lectura. Sinembargo , es nec_e_

sario considerar que aunque los uPs generan directamente

la señal RD, el Z80 realiza un cierto tipo de lectura

sin generar esta señal. Esto se produce durante inte-

rrupciones que utilizan la entrada INT del uP . Este nece

sita que le sea suministrada cierta información para po-

der dar servicio _a dicha interrupción, y el uP genera en-

tonces las señales MI e IORQ juntas/ (sin la señal RD)

debiéndose obtener de las mismas la señal requerida para

habilitar al buffer (4F).

Las tres compuertas ÑOR mencionadas (4G), (4G)

y (1E) generan esta señal de habilitación a partir de las

señales RD, Mi e IORQ.

Con ésto, los buffers se habilitan de acuerdo

la operación en proceso: lectura (RD), escritura

o alta impedancia,

a

2.6-2. BUFFERS DE DATOS Y DIRECCIONES DEL TECLADO

A semejanza del caso anterior/ estos buffers

están formados por 4 circuitos integrados 8212 y separan

19

las direcciones y datos provenientes del teclado, de los

buses de direcciones y datos, respectivamente, del siste-

ma .

Los buffers (71) y (81) son para el bus de dire£

cienes, cuyas salidas se conectan a las de los buffers

(4B) y (4C), respectivamente, descritos en el numeral an-

terior; sus entradas son alimentadas desde los contadores

UP/DOWN programables (7K), (7K), (8K), (9K) mencionados

en los numerales 2.4-1 y 2.7-4.C.

Los buffers (101) y 111) corresponden a los da-

tos y están conectados en paralelo, con sus salidas ali-

mentando a los indicadores de datos (11C), (11C) , (12C) ,

(12C); sus entradas reciben la información de los retene-

dores (10K) y (11K) que componen los 8 bits de datos.

Los buffers (101) y (111) están en paralelo de-

bido a que para ciertos procesos los uPs necesitan leer

dos bytes de información provenientes del teclado, bytes

que necesitan ser mostrados primero en los cuatro indica-

dores de datos y luego leidos por los uPs. Debido a ésto,

es necesario retener esta información en alguna parte, y

esto se logra utilizando los buffers mencionados como re-

tenedores además de buffers.

Los buffers (71) se habilitan cuando el sistema

está en -el modo de programación y esto se logra controlan

do las entradas DS1 desde el biestable (16N) , pin

20

El control de los buffers (101) y (111) es com-

partido entre señales de control del teclado y el contr_o

lador de I/O de los uPs, y será explicado en el numeral

2.7 - -4 .b.

Durante el modo de programación solo se habili-

ta el buffer (111) para la transferencia de datos desde

el teclado hacia la memoria.

2.6-3. BUFFERS DE INTERCONEXIÓN.

A este grupo corresponden los buffers (6H),

(61) , (13D) y (13E) . Los dos primeros sirven en reali-

dad como pórticos de I/O para la lectura de datos del te

ciado y escritura de datos a los indicadores de éstos;

reciben su habilitación, en la entrada DS2, desde el

biestable (16N), pin 8, deshabilitandose cuando el siste-

ma está en el modo de programación.

El control de la dirección de flujo de los da-

tos viene del decodificador de I/O 74LS154 (13H): para

el buffer (6H) a través del AND (19M)/ salidas 4 y 5 del

decodificador, y para el buffer (61) a través del AND

(131)/salidas 6 y 7 del decodificador. Las señales pro-

venientes de estos AND alimentan las entradas DS1 de los

respectivos buffers.

Los buffers (13D) y (13E) unen el bus de datos

proveniente de la memoria (bus de datos del sistema) con

21

el bus de los indicadores de datos; se habilitan solo

cuando el sistema está en el modo de programación y para

este proposito, la entrada DSl en el buffer (13D), y la

entrada DS2 en el buffer (13E) reciben la señal de habi-

litación del biestable (16N), pines 8 y 9, respectivamen-

te .

La entrada DS2 en el buffer (13D) está conecta-

da a la entrada DSl en el buffer (13E) y señalan la dire_£

ción de flujo de los datos de acuerdo a la señal prove-

niente de la compuerta OR (L 3L, izquierda). Esta señal será ex

plicada en el capítulo 2.7— 4.b. En general, estos dos

buffers permiten, gue un dato sea escrito en memoria e in-

mediatamente leído (programación del sistema), o leer,

sucesivamente, localidades de memoria.

2.7. CIRCUITOS DE CONTROL

• 2.7-1. SEÑALES BÁSICAS

El decodificador '74154 (15J) y el decodificador

74LS155 (8L) constituyen el "centro" de los circuitos

de control. Entre los dos generan todas las señales de

control del sistema provenientes de los teclados.

A continuación se indica la correspondencia en

tre las salidas de los decodificadores y las respectivas

señales de control.

22

74154 (15J) 74LS155 (8L)

0 - ESCAPE 8 -ARS 1Y0- SHIFT

1 - SS 9 -BREAK CHECK 1Y1- L

2 — RD PGM4- 10 -BREAK REMOVE 1Y2— H

3 _ RD pGMí u -BREAK INSERT 1Y3

4 — RESET CPU 12 —EXTRA 2Y0— GO

5 - WR PGM 13 -6800 2Y1— REG

6 - REG. STR 14 -8085A 2Y2- REG

7 - MNU 15 -280 2Y3-

2 . 7-2. INTERRUPCIONES

De las señales anteriores, las siguientes son

usadas por los programas monitores: ESCAPE, SS, REG STR,

MNU, ARS, BREAK CHECK, BREAK REMOVE, BREAK INSERT, L, GO ,

REG, REG.

Estas señales producen una señal de interrupción

a través del NAND de 13 entradas (18J), la cual se canali-

za a cada uP mediante los' NAND (7F) y (8F) que permiten

el paso de la señal proveniente del NAND (18J) solamente

al uP seleccionado. Esto es necesario debido a que si se

aplica la señal de interrupción a todos los uPs simultá-

neamente, en ciertos casos, al seleccionar uno a continua

ción de otro el uP seleccionado reconocerá la señal y

entrará a decodificar y dar servicio a dicha interrupción

inmediatamente después de haber sido seleccionado, reali-

zando así una función errónea.

23

Estas señales de interrupción se aplican a las

entradas de interrupción de mayor prioridad en los uP s:

NMI para el caso del 280 y 6800, y TRAP para el 8085A.

Las compuertas NAND (7F) que manejan estas entradas de

interrupción/ son de colector abierto ,_ lo cual permite

que señales de interrupción provenientes de circuitos

externos al sistema puedan ser aplicados a las entradas

respectivas en los uPs del sistema (Z80 , 6800). Para el

8085A la señal de interrupción (TRAP) externa debe ser

aplicada a la entrada del inversor de colector abierto

(7E), abriendo antes el interruptor ESI (1),(7E) .

Para ejecutar la rutina correspondiente a la fun

ción que se desea, el uP seleccionado, al recibir la se-

ñal de interrupción, lee los buffcrs 74367 (171) que per-

miten el paso de las señales provenientes del teclado y

que producen una interrupción. El uP identifica la fun-

ción que se está solicitando y procede a la ejecución

de la rutina respectiva.

Si después de leer los buffer (171) el uP en-

cuentra que ninguna de las señales está activa, es decir,

no se solicita ninguna función, el uP determina que la in

terrupción proviene de algún circuito externo al sistema

y salta a una localidad de memoria determinada donde el

usuario deberá haber puesto una instrucción de salto ha-

cia la rutina de servicio de dicha interrupción.

24

2.7^3. CONTROL DE I/O

El decodificador 74LS154 (13H) genera todas las

señales de control para los circuitos de I/O del sistema,

bajo control de los programas monitores. Sus entradas de

selección (A,B,C,D,) están conectadas al bus de direccio-

nes del sistema, y en cuanto a sus entradas de control,

G2 está comandada por la señal 10RQ proveniente de la

compuerta OR (2H) cuyo funcionamiento está explicado en

el numeral 2.3. La entrada Gl está comandada por el NAND

de cuatro entradas (7H), el cual, en conjunto con el AND

de dos entradas de colector abierto (7H), determina que

para el 280 y el 8085A el decodificador (13H) responda

a las últimas 16 direcciones del mapa de I/O, es decir,

desde P0H hasta FFH. Para el 6800, el decodificador

(13H) responde a las direcciones desde 00F0H hasta

00FFH del mapa de memoria.

Esto se logra añadiendo al circuito anterior

de habilitación de la entrada Gl del decodificador (13H)

el circuito formado por las compuertas OR (7C), el tran-

sistor (7D) y el transistor (6F).

Las compuertas OR (7C), en conjunto con el tran-

sistor (7D), generan un 1L solo cuando los 8 bits más

significativos del bus de direcciones'están en OL, y co-

nectan esta señal en paralelo con la salida de colector

abierto del AND (7H) para deshabilitar a la entrada Gl

del decodificador (13H) , a través del NAND (7H) , si uno

25

de los 8 bits mencionados está en 1L.

El transistor (6F) está siempre saturado cuando

no está seleccionado el 6800. Mediante la señal prove-

niente de la compuerta ÑOR (U) , cuyo funcionamiento fue

explicado en general en el numeral 2.3 y que produce un

OL siempre que este seleccionado el 6800, este transis-

tor se corta, liberando la base del transistor (7D) y per_

mitiendo así que las OR (7C) formen parte del control de

la entrada Gl del decodificador (13H).

Las señales de control de I/O que genera el de-

codificador (13H) se describen a continuación:

Las salidas 14 y 15 habilitan a los buffer's

(171) para la lectura de las señales de interrupción pro-

venientes del teclado; las salidas 13 y 12 controlan la

carga de datos en los retenedores (19H) que manejan a

los indicadores de status; las salidas 11,10,9 y 8 contro-

la al interfase de periféricos programables 8255 (27C)

que controla el circuito de programación de EPROMS; las

salidas 7 y 6 habilitan al buffer de interconexión (GI)

através del AND (131) , la salida 7 habilita además al

buffer (101) a través del AND (91), y la salida 6 habili-

ta también al buffer (111) a través del AND (111); las sa-

lidas 5 y 4 habilitan la retención de datos en los indica

dores (12C) y (lie) a través de los AND de co 1 ector¿

//to (19L) y ( 2 0 L ) respect ivamente , las salidas 3 /^:.2 están

libres y pueden ser uti l izados por el u sua r io , rcí?rbéfe¿on--T f . . -u ^ *• ' [ | c¿; u.- . ív -t . < i (j • "•

00340$

26

diendo a las direcciones F3H y F2H (280 y 8085A) y

00F3H y 00F2H (6800) de I/O; las salidas 1 y 0 permiten

el control de parte del circuito que maneja las funciones

de introducción de datos al sistema desde el teclado. Es-

te circuito será explicado en el siguiente subcapítulo.

2.7-4. CONTROL DE TRANFERECNIA DE DATOS CON LOS uPs

EN ALTA IMPEDANCIA.

Este circuito recibe señales de control desde

el teclado, y de los uPs a través del controlador I/O, pa

ra manejar la transferencia de datos a los indicadores

de datos y direcciones, el encendido o apagado de estos,

y a los indicadores del dígito a escribirse.

Dado que este circuito recibe varias señales

de comando, su funcionamiento será explicado describien

do las diversas funciones que realiza.

2.7-4.a. INICIALIZACION DEL SISTEMA PARA LA PROGRA-

MACIÓN.

Este modo se activa al presionar WRPGM. El de-

codificador 74154 (15J) responde colocando la salida 5 en

OL, el cual genera una señal de borrado en el contador

UP/DOWN 74193 (15L) , a través de los AND (15K) y el inver-

sor (15L), sirviendo además como señal de reloj para los

biestables (16N) accionando a estos al regresar a 1L.

De estos biestables, el de la" derecha 'genera las señales

27

que indican que el sistema está en el modo de programa-

ción ocn sus salidas Q y Q. La salida Q (pin 9) habilita

(o deshabilita, según sea el caso) a los buffers (13E)

entrada DS2 , (4C) entrada DS1, y (4B) entrda DS1; además,

a través de los inversores de colector abierto (18K) se

coloca un OL en la entrada LSI de los indicadores de dí-

gitos (12C) correspondientes a los dos dígitos menos sig

K

nificativos / manteniendo a éstos habilitados.

Esta misma señal, proveniente del pin 9 del

table en cuestión , a través de los inversores ( 18J) colo-

ca un OL en las entradas 2G y 2C del decodificador (18C)

habilitando a éste y por lo tanto el acceso a la memoria

del sistema; estas dos señales generadas a través de los

inversores (18J) están en paralelo con las señales MREQ

(salida 12 del inversor inferior) y la formada por RD"WR,

mediante el AND (1H) , (salida 10 del inversor superior) ,

señales explicadas en el numeral 2.3.

La señal proveniente de Q (pin 8), del biestable

(16N, derecha) habilita o deshabilita según sea el caso

a los buffers: (13D) entradas DS1,(6H) entrda DS2, (61)

entrada DS2, (71) entrada DS1 y (81) entrada DS1. La salida

Q (pin 6) del otro biestable (16N, izquierda) coloca un

OL en el OR (12K) para permitir el paso de una señal

proveniente de este mismo circuito de transferencia de

datos, destinada a incrementar automáticamente los conta

dores que direccionan las localidades de memoria cuando

se está cargando un programa del usuario en el sistema;

28

también coloca un OL en el OR (17E) que permite el paso

de la señal de escritura WR, proveniente del sistema de

transferencia de datos, hacia la memoria.

Esta señal WR PGM generada desde el decodificador

(15J) genera también una señal de borrado a través del AND

(10M) que inicializa el circuito de selección de los uPs

y el circuito de generación de RESET inicial de los mis-

mos, circuitos que serán explicados mas adelante; esta

misma señal, a través del AND (11M) produce una señal de

borrado para el biestable (15N izquierda), y el biesta-

ble (17M) . Este, a través cb Q (pin 8) controla el bloqueo

de los dos dígitos mas significativos de los indicadores

de datos (11C), y al estar el biestable borrado, éstos

están bloqueados. Al estar borrado (15N) , izquierda) ,

la salida Q coloca OL en la entrada B del decodificador

(16L) a través del AND (15L) respectivo, lo. cual permite

que la selección de las salidas del decodificador (16L)

dependa solamente de la entrada A: la salida Q del bies-

table coloca un 1L en la entrada de selección de pala-

bra del multiplexer (17L, izquierda) y un OL, a través

del inversor respectivo en el multiplexer (17L, derecha).

El 1L selecciona la palabra A2, B2 ,C2 ,D2, mientras que

un OL selecciona la. palabra £1,131,01,01.

Asumiendo que el biestable (15N, dere'cha) esta

borrado, éste coloca un OL en la entrada lG,a través del

AND (15L) respectivo, y un 1L en la entrada 2G, del deco-

dificador (16L) habilitando de esta manera las salidas

29

1YO,1Y1,1Y2,1Y3 del mismo. Las salidas del multiplexer

(17L, derecha) dependen, entonces del contador UP/DOWN

(15L); al estar este borrado, aparece un OL en la salida

1YO del decodificador (16L), y al estar conectados los

multiplexers (17L) como se muestra en el diagrama, este

OL aparece en la salida QB del multiplexer (17L, derecha).

Las salidas de este multiplexer están conectadas, a tra-

vés de resistencias, a los cátodos de los LEDS de los pu_n

tos decimales del dígito más significativo; estos puntos

decimales, al encenderse, indican cual es el siguiente

dígito que se va a escribir. De esta manera, para este

caso, el dígito a escribirse es equivalente al medio byte

más significativo de la palabra (8 bits) que se va a es-

cribir en memoria.

2.7-4.b. INGRESO DE DATOS

Al presionar una tecla correspondiente a un

carácter hexadecimal, el valor binario correspondiente

a dicho carácter se coloca en las salidas del decodifi-

cador (7L) y se genera un pulso, DA, mediante el circui-

to explicado en el numeral 2.4—2. Esta señal pasa por

el OR (13L , izquierda) cuya entrada es la señal provenieri

te del bit mas significativo del decodificador (7L),

a través de los inversores (7L), lo cual determina que

solo los caracteres hexadecimales permitan el paso del

pulso DA hacia el contador (15L) y los demás circuitos

involucrados con esta' señal. Estos circuitos son: el

de escritura en memoria, los buffers de interconexión

30

(13D) y (13E)-, y las compuertas que generan diferentes

pulsos para la carga de los datos en diferentes retene-

dores, estas compuertas son las localizadas en (18L),

(18M), (19L) y (20L).

Para la escritura en memoria, la señal DA prove-

niente del OR (13L, izquierda) pasa a través del OR (17E) .

habilitado, como ya fue explicado, por el biestable (16N ,

izquierda) hacia la entrada WE de las memorias a través de

lo.s.-'.inversores (17E). La salida del inversor de colector

abierto (17E) está conectada a la salida WR de los uPs.

Como DA es un pulso, cuando éste no está presente, la me-

moria está habilitada para la lectura, ésto implica que

los buffers de Ínter coneccion (13D) y (.13E) permitan el

paso de información desde los buffers de datos del tecla-

do hacia la memoria solo durante la duración de DA', mien

tras que en ausencia de éste, el sentido del paso de in-

formación debe ser desde la memoria hacia los indicadores

de dígitos. Esto se obtiene conectando la señal en cues

tión a la entrda DS2 del buffer (13D) y a la entrada

DS1 del buffer (13E) .

La señal DA está conectada a todos los OR (18L)

y (18M) pero solo pasará por aquél cuya otra entrada es-

té en OL, y esto ocurre, para este caso, s5lo con el OR

conectado a QB del multiplexer (17L, derecha) obteniéndo-

se así un pulso a OL en su salida que se transmite a tres

compuertas AND como se puede apreciar en la figura. La

conexión al AND de colector abierto no tiene, en este

31

caso ( el de ingreso de datos), ninguna consecuencia ya

que su salida está fija a OL por acción del biestable

(16N, derecha), pin 9 y los inversores (19K) como fue

explicado anteriormente. De los otros A N D - aquél que

a su salida tiene el inversor (19K, derecha) da un pulso

de carga para el retenedor (10K) que cargará el valor c_o

rrespondiente al carácter hexadecimal a la salida del de-

codificador (7L). El tercer AND genera dos pulsos, (uno

a OL , a través del AND (91) en la entrada DS1 del buffer

(101) y uno a 1L, a través del inversor ( 91) en la entr_a

da STB del mismo buffer.

Con ésto se realizan dos funciones: Se habilita

al buffer para que permita el paso del dato presente a

sus entradas y que proviene de los retenedores (10K) y

(11K), y al desaparecer los pulsos se retiene este dato

aunque el buffer queda deshabilitado, es decir, en alta

impedancia. Aquí caben dos explicaciones, una acerca del

estado de alta impedancia del buffer y otra para justi-

ficar la retención del dato ya que esto parecería ser

redundante debido a los retenedores (10K) y (11K). Para

el caso-de la alta impendancia, se menciono anteriormente

que durante el modo de programación los buffers, (13D) y

(13E) estaban conectados de tal manera que la dirección

del paso de información - sea desde la 'memoria hacia los

indicadores de datos (y por consiguiente a las salidas

de los buffers (101) y (111) ), excepto durante la dura-

ción de DA, de ahí que es necesario que estos se habili-

ten solo durante el pulso mencionado. En realidad el

32

buffer (111) se habilita solo para una función que puede

realizarse solo bajo control del programa monitor. En

cuanto a la retención/ durante ciertos procesos bajo con-

trol del monitor/ el uP en funcionamiento necesita -de 16

bits de información desde el teclado { y es aquí donde

el buffer (111) entra), información que pasa por los

retenedores (10K) y (11K) (solo 8 bits) y por tanto 8

bits deben ser retenidos mien-tras se cargan los otros 8.

Al retornar-DA a 1L se incrementa' el contador

(15L), y debido a que los AND (15L) no han variado/ la

salida QA del multiplexer (17L, derecha) se coloca en OL,

con el resto de sus salidas en 1L. Esto permite el paso

del pulso DA a través del OR (18L) respectivo y hacia los

3 AND (19L) correspondientes, y en este caso, el AND que

tiene a su salida el inversor (18K, izquierda)da vn impul-

so de carga en el retenedor (11K)/ el AND de colector a-

bierto no realiza ninguna función debido a la explicación

dada en el caso de la salida QB, y el tercer AND es el

mismo mencionado en el caso de QB y que genera dos pulsos

en el buffer (101) con un resultado semejante al anterior

pero en este caso con la nueva información procedente

del retenedor (11K) y por supuesto la retenida anterior-

mente en (10K) . Al retornar DA a 1L , se incrementa nu_e

vamenté el contador (15L) y como los AND (15L) aun no han

variado/ la salida QB del multiplexer (17L, derecha) , se

pondrá en OL y QA regresará a 1L; este pulso generado

por QA y DA a través del AND respectivo (18L) pasa por el

OR y AND (12K) hasta la entrada CU del contador (9K) el

33

cual incrementa su valor en 1, incrementando así la ca-

dena de contadores que direccionan las localidades de

memoria.

De aquí en adelante, sin cambiar de función, el

proceso anterior ( el de ingreso de datos) es cíclico.

Un OL estará alternando entre QA y QB del multiplexer

(17L) generando los pulsos de carga, escritura e incre-

mento de direcciones.

2.7-4.C. LECTURA DE LOCALIDADES DE MEMORIA

Estando el sistema en el modo de programación, al

presionar la tecla H se entra al modo de lectura de una

localidad cualquiera de memoria; el decodificador (8L)

coloca su salida 1Y2 en OL, el cual acciona la entrada

LOAD del contador (15L), da una señal de reloj para el

biestable (15N, derecha) , y un.a señal de borrado para el

biestable (16N, izquierda).

Al borrar (16N , izquierda) su salida Q se colo-

ca en 1L deshabilitando, mediante el OR (12K) el incremen

to de direcciones como efecto de la introducción de carao

teres hexadecimales.

El biestable (15W, derecha), por su parte, al re

cibir la señal de reloj, coloca un 1L en su salida Q y un

OL en Q. Q está conectado a la entrada PR del biestable

(15N, izquierda) y al OR (15L), el cual permite el paso de

34

la señal proveniente de la salida 1YO del decodificador

(16L), al mismo tiempo que el OL en la entrada PR de

(15N , izquierda) coloca un 1L en su salida Q conectada

al AND (15L, superior) habilitando a este para pasar la

señal de la salida QB del contador (15L), además la sali-

da Q del mismo biestable (15N, izquierda) se coloca en

OL, seleccionando así la palabra Al, B1,C1,D1 en el mul-

tiplexer (17L , izquierda) y A2, B2,C2,D2, en (17L , dere-

cha) .

El 1L en Q de (15"N , derecha) permite el paso

de la señal de la salida QC del contador (15L) a la entra

da 1G del decodificador (16L) y el complemento de esta se

nal a 2G del mismo decodificador.

El OL en la entrada LOAD del contador (1SL) car-

ga el valor 4b, el cual, conjuntamente con los AND (15L)

selecciona las salidas 2YO ,2Y1 , 2Y2 , 2Y3 del decodificador

(16L) y estando las entradas A y B del mismo en OL, coló

ca un OL en la salida 2YO.(

, Las salidas 2YO, 2Y1, 2Y2, 2Y3 están conectadas,

a través de resistencias, a los catados de los LEOS de los

puntos decimales de los indicadores de direcciones, corres

pendiendo 2YO al mas significativo, también están conecta

dos a los OR (18M). Los puntos decimales, al igual que

en el caso de los datos, indican el dígito a escribirse.

Los OR (18M) cumplan una función similar a los OR (18L)

en cuanto permiten el paso de la señal DA, proveniente

35

del OR (13L), si su otra entrada está en OL, al retenedor

respectivo. En este caso, los retenedores son los conta-

dores (7K), (7K), (8K), (9K) que componen los 16 bits pa-

ra direcciónar las localidades de memoria.

• Al introducir la dirección de la localidad de

memoria que se quiere leer, el OL en la salida 2YO del

decodificador (16L) se va desplazando hacia 2Y3 cargando

al mismo tiempo cada dígito en el retenedor (contador)

respectivo, hasta que llega a 2Y3 . En este momento, el

contador (15L) tiene en sus salidas el valor 7b y hasta

ahora los AND (15L) no han variado, sin embargo , al intro-

ducir otro carácter hexadecimal, las salidas del contador

cambian al valor 8b y esto coloca un OL, a través del AND

(15L, inferior) en la entrada 1G y un OL en la entrada

2G del decodificador (16L) seleccionando así las salidas

1YO, 1Y1, 1Y2, 1Y3 y colocando un OL en 1YO. Este OL se

transmite a través del OR y los AND (15M) a la entrada de

borrado del biestable (15N, izquierda); el OL en su entra

da PR todavía está presente, de manera que estas dos seña

les, en conjunto, colocan tanto a la salida Q como Q en

1L. Este 1L en Q realiza la misma función descrita en el

numeral 2.7-4.a. , mientras que el 1L en Q permite aún

el paso de la señal de la salida QB del contador (15L),

a través del AND respectivo, a la entrada B del decodifi-

cador (16L).

En este punto, cabe la explicación de la función

de retroceso de la señal que indica el siguiente dígito a

36

escribirse. Al presionar la tecla SHIFT, el decodifica-

dor (8L) coloca su salida 1YO en OL, el cual se transmite

a la entrada CD del contador (15L) decrementando a éste.

Esto tiene como efecto que el OL a la salida seleccionada

del decodificador (16L) pasa a la salida anteriormente s_e

leccionada, y esto a su vez tiene como efecto que los LED

que indican el siguiente dígito a escribirse, se apagan

y se encienden los del dígito aunteriormente escrito.

Con esto se ve la necesidad de aplicar una señal de bo-

rrado y PR simultáneamente, en el biestable (15N, izquier;

da) para el CHSo anterior. Al presionar SHIFT una vez que

el Olf pasó de la salida 2Y3 a la salida 1YO en el decodi-

ficador (16L) , dicho OL regresará a 2Y3 y las salidas Q y

Q del biestable (15N , izquierda) serán 1L y OL, respecti-

vamente y el sistema estará nuevamente en el modo de lec-

tura de una localidad de memoria.

Si, por el contrario, una vez pasado el OL de la

salida 2Y3 a la salida 1YO se presiona un carácter hexade-

cimal, el OL, que pasa a la salida 1Y1 es una señal de bo

rrado para el biestable (15N, izquierda) , el cual quita

el OL de la entrada PR de (15N, izquierda) permitiendo

que sea la entrada de borrado, CLR, la que tome control

y mantenga borrado al biestable y el sistema queda fija-

do para el modo de ingreso de datos excepto por una señal:

la proveniente del biestable (16N, izquierda), que fue

borrado al presionar la tecla H y no ha sido alterado

desde entonces. Esta señal, como ya se ha explicado ,

permite o (y, en este caso) impide el paso, mediante el

37

OR (12K), de la señal de incremento para los contadores

que forman los 16 bits para direccionar las localidades

de memoria, como también la señal de escritura de memoria

mediante el OR (17E) y los inversores (17E).

De esta manera, al seguir tratando de introdu-

cir caracteres, hexadecimales, no pasará nada: no varia-

rá la dirección de localidad introducida ni se alterará

el contenido de dicha localidad aunque sí variarán los

datos en los retenedores de éstos. Para poder alterar

el contenido de la localidad de memoria es necesario

presionar WR PGM nuevamente, y con ésto el sistema se

comportará como ya fue descrito para dicho caso.

Con el sistema en el modo de programación des-

pués de haber presionado WR PGM, H, o haber introducido

datos, se puede leer localidades sucesivas de memoria

hacia arriba ( incremento de dirección) o hacia abajo

(decremento de dirección) presionando las teclas RD PGM!

a RD PGMi, respectivamente. Al presionar el primero,

el decodificador (15J) coloca su salida 3 en OL, el cual

se transmite , a través del AND (12K) , a la entrada CU

del contador (9K) incrementando la cadena y por ende la

dirección mostrada al momento.. La tecla RD PGMI por su

parte, activa la salida 2 del decodificador (1SJ) y esta

señal se conecta directamente a la entrada CD del conta-

dor mencionado, decrementando la dirección. Presiones

sucesivas de estas teclas incrementarán o decrementaran

según sea el caso, la dirección que aparece en los indi-

cadores respectivos.

La acción de estas dos teclas es independiente

de cualquier otra función, excepto durante la señal aut£

mática de RESET (POR).

2.7-5. SELECCIÓN DE LOS uPs.

Una vez introducido el programa del usuario. se

procede a la selección del UP con el que se va a traba-

jar, esto se logra simplemente presionando la tecla co-

rrespondiente al.uP deseado, lo cual coloca un OL en una

de las 4 últimas salidas del decodificador (15J). Estas

salidas están conectadas al AND de 4 entradas (11G) y a

las entradas D de los biestables (10H) y (11H) corres-

pondiendo los de (IIH) a las salidas más significati-

vas. El AND de 4 entradas (11G) , a través del inversor

(11G) produce un pulso de borrado para el circuito de

Transferencia de Datos mencionado anteriormente y este

mismo pulso, a través del otro AND (11G), cuya otra en-

trada es la señal proveniente de la salida Q del bies-

table (14L), pin 9, generación de la señal DA para el

teclado (12J)), genera una señal de habilitación para el

biestable (8G) y de reloj para los biestables (10H) y

(11H). -Al cargarse estos biestales, solo uno de ellos

tendrá a su entrada D el OL que corresponde al uP que

se quiere seleccionar, el resto tendrá obviamente un 1L;

ésto implica que la salida Q de estos biestables, que es

la que se utiliza en este circuito, estará en OL luego

39

del pulso de carga y deberá permanecer en OL hasta que se

presione la tecla del uP correspondiente. Esto obliga a

que después de un encender el sistema, es decir después

de la señal automática de RESET (POR) las salidas Q de los

biestables (10H) y (11H) estén en OL, lo cual se logra

aplicando la señal POR a las entradas PR de estos biesta-

bles. La aplicación de esta señal, proveniente del tem-

porizador 555 (41) a través del inversor (51), es a través

del AND (10M), cuya otra entrada proviene de la señal

WR PGM, la cual causa el mismo efecto que POR, para es-

te caso. Al habilitarse el biestable (8G) , con el mis-

mo pulso de carga de (10H) y (11H) , éste genera, en con-

junto con: el contador doble 74393 (8H), el biestable

(9H), el AND (9H) y el inversor (9G), un solo pulso ha-

cia OL en la salida Q del biestable (9H) , que produce ,

a través del AND (8G), cuya otra entrada es la señal

POR'WR PGM del AND (10M), un pulso de borrado en el bie£

table (9G) y el retenedor (10F); el biestable (9G) gene-

ra el pulso de reloj para el retenedor que cargará los

datos en las salidas Q de (10H) y (11H) a través de•su

salida Q y la señal de encendido/apagado a través de ~Q

para los indicadores de direcciones. La señal de sincro-

nismo del circuito que genera el pulso hacia OL en la

salida Q del biestable (9H) es un tren de pulsos prove-

niente de la salida CLK (OUT) del uP 8085A a través del

AND (IB) que sirve de buffer para esta salida, y que

llega a la entrada de reloj del biestable (8G). La en-

trada D del biestable (9G) proviene del AND de cuatro

entradas (3G), el cual genera un 1L siempre y cuando

40

los uPs hayan generado una señal, un 1L, de reconocimien-

to de al-ta impedancia y por lo tanto se pueda proceder

a la selección de uno de ellos. Mas adelante se explica-

ra esto mas detenidamente.

Hecho estas descripciones individuales se puede

visualizar mejor el funcionamiento del circuito: se pre-

siona la tecla correspondiente a un uP, se carga un OL en

el biestable respectivo (10H •—• 11H) , se produce un pul-

so de borrado en el retenedor (10F) y luego un pulso de

carga en el mismo que se carga con los datos provenien-

tes de los biestables (10H) y (11H). Las salidas del

retenedor manejan las entradas de control de alta impe-

dancia- de los uPs.

Para el S80, la señal de control de alta impe-

dancia proviene de la salida Q2 a través del inversor de

colector abierto (6E), de esta manera se puede contro-

lar el estado de alta impedancia, si sé necesita, por

medio de algún circuito periférico externo al sistema

como por ejemplo un controlador de DMAyconectando la

señal de control respectiva directamente a la entrada

BUSRQ en el Z80. Cabe anotar que esta señal externa de-

be provenier de una compuerta o salida de colector abier

to .

Para el 6800 la señal de control de alta impe-

dancia proviene de la s.alida Q3 del retenedor y es conec

tada a la entrada D del biestable (9F)7 cuya entrada de

41

reloj está comandada por la salida MEM CLK, a través del

inversor (4H), del circuito generador de las fases 01 y

02 para el uP . Esto es necesario ya que la aplicación

d-e la señal HALT al uP debe cumplir una cierta condición

de sincronismo, y esto se logra mediante el circuito

descrito. La salida Q del biestable se conecta a la

entrada HALT del 6800 a través del inversor de colector

abierto (8F) que cumple la misma función que el inversor

(6E) en el caso del Z80.

Para el 8085A, la salida del retenedor (10P) que

controla la alta impedancia es Ql y se aplica a la entra

da HOLD a través de los inversores (1A, derecha) y (IB) .

La señal de control externa debe aplicarse a la entrada

del inversor de colector abierto (1A, izquierda), abrien

do previamente ES1(8)(1A) .

Esta secuencia, de borra.do del retenedor (10F)

y luego la carga del mismo con nueva información, es ne-

cesaria debido a la demora que puede haber en la puesta

en alta impedancia de un uP y la activación inmediata

de otro, lo cual puede llevar a que en determinado ins-

tante estén ambos activos, produciéndose un estado de

contención en los buses de éstos. De esta manera se jus-

tifica la secuencia descrita: colocar todos los uPs en

alta impedancia monitorear las señales de reconocimien-

to del alta impedancia, y una vez que todos han respon-

dido, entonces proceder a cargar el retenedor (10P) con

la nueva información para seleccionar el nuevo uP con

42

el que se va a trabajar. De esto se deduce la importan-

cia del AND (3G) cuya salida está conectada a la entrada

D del biestable (9G).

2.7-6. CONTROL DE TRANSFERENCIA DE DATOS BAJO COMAN

DO DE LOS uPs.

Como se menciono en el numeral anterior, al se-

leccionar uno de los uPs se produce un pulso de borrado

para el circuito de transferencia de Datos, lo cual ini-

cializa al circuito para poder ser utilizado adecuadamert

te cuando el programa monitor lo requiera. Mientras

está activado uno de los uPs los indicadores de direc-

ciones están apagados, mientras que los correspondientes

a los dígitos mas significativos de los datos se encien-

den o apagan bajo control del monitor.

Al requerir el monitor datos desde el teclado

se genera un pulso en la salida 1 del decodificador

(13H), el cual es una señal de borrado para el contador

(15L) a través del AND de 3 entradas (15K), y una señal

de reloj para los biestables (17N) y (15N, izquierda);

este biestable cumple la misma función que fue explica-

da en el numeral 2.7-4.a: permite el paso de la señal

QB del contador (15L), a través del AND (15L, superior),

a la entrada B del decodificador (16L) y selecciona las

palabras 1 y 2 en los multiplexers (17L, izquierda) y

(17L, derecha) , respectivamente. El biestable (17N)

genera un OL en su salida Q, que está conectada a las

43

entradas de control de encendido, BLK, de los indicadores

de los dos dígitos mas significativos de los datos, encejí

diendo a éstos.

Con el circuito de transferencia de datos fijado

de esta manera, están encendidos los LEDS de los puntos

decimale-s del dígito -mas significativo de los datos , in-

dicando que este es el que se va a escribir, esto implica

un OL en la salida QD del multiplexer (17L, derecha) ;es-

te OL se desplaza hacia QA del mismo multiplexer a medi-

da que se introducen los datos, y por lo tanto, también

los pulsos que aparecen a las salidas de los OR (18L) co-

rrespondientes se desplazan en el mismo sentido. La sa-

lida de cada uno de estos OR está conectada a tres com-

puertas AND, una de colector abierto, una cuya salida es-

ta conectada a un inversor, y otra sola. Los AND conec-

tados a los OR correspondientes a las salidas QA y QB del'

multiplexer (17L, derecha) funcionan de la manera que fue

descrita en el numeral 2.7-4.b. excepto los de colector

abierto; esto se debía a cjue el biestable (16N , derecha)

tenía su salida Q en 1L, que a través de los inversores

(19K) colocaban un OL a la salida de estos AND. En es-

ta ocasión el biestable está borrado y por tanto su sali-

da Q está en OL de manera que los inversores colocan un

1L a su salida, habilitando a los AND en cuestión. Los

cuatro AND de colector abierto (19L) y (20L) controlan

las entradas de retención (LSI) de los indicadores de dí-

gitos, estando el que corresponde a la salida QD del

multiplexer (17L, derecha) conectado al indicador del

44

dígito mas significativo. En cuanto a los dos AND res-

tantes , el funcionamiento de uno de ellos ya fue expli-

cado y es el que controla la carga de información en el

buffer (101); el otro realiza una función similar pero

con el buffer { 111) y las señales provienen de los OR

conectados a las salidas QC y QD del multiplexer

(17L, derecha) .

El programa de monitor requiere, en ocasiones,

no solo de datos provenientes del teclado, sino también

transferir datos al usuario, y para ésto utiliza los

4 indicadores de datos. Si son necesarios dos bytes

de información, el monitor, tal como en el caso ante-

rior, genera un pulso de reloj para el biestable (17N)

a través de la salida 1 del decodificador (13H) > para el

encendido de los indicadores correspondientes a los dos-

dígitos más significativos de los datos; luego procede

a escribir la información , en los cuatro indicadores,

lo cual se logra escribiendo dos dígitos (1 byte) a la

vez .

Los pulsos de escritura, o mejor dicho, de re-

tención para los indicadores porvienen del codificador

C13H) , salidas 4 y 5 correspondiendo la salida 4 al by-

te más significativo ( los dos dígitos más significati-

vos). Esta señal está conectada a los dos AND de colec-

tor abierto (20L) que corresponden a los OR conectados

a las salidas QC y QD del multiplexer (17L, derecha);

mientras que la señal proveniente de la salida 5 del

45

decodificador está conectada a los otros dos AND de cole£

tor abierto (19L) y (20L). De manera que mediante estos

AND el uP controla la retención de información en los iri

dicadores. Estas dos señales (salidas 4 y 5 del decodi-

ficador), mediante el AND (19M) generan un pulso de habi-

litación para el buffer (66H) , tal como se explica en el

numeral 2.6-3.

En caso de que solo se requiera la escritura de

1 byte ( el menos significativo), no es necesario en-

cender los dos indicadores mas significativos y se pue-

de proceder directamente a la escritura del byte en cues

tion .

2.7-7 . CONTROL DE INICIALIZACION (RESET) .

Existen tres tipos de señales de RESET: RESET

automático (POR), RESET desde el teclado, y RESET de se-

lección inicial de uP .

La señal POR se produce luego de conectarse el

equipo .o de una perdida momentánea o total del voltaje de

la línea, y proviene del circuito formado por el compara

dor (31) , y el temporizador 555 (41) .

En el caso de pérdida momentánea o total del

voltaje de línea, si comparador detecta la baja en la

señal de 5V y produce una señal de disparo para el 555,

el cual actúa como un monoestable y da un pulso a 1L a

46

su salida, ésta es la señal de POR, obteniéndose POR

mediante el inversor (51).

Para el caso de encendido del sistema, el com-

parador mantiene disparado al 555 hasta que la fuente

(+5V) haya llegado a un valor apto para el funcionamiento

de los circuitos del sistema. El pulso generado por el

555 es de aproximadamente dos segundos.

Esta situación de POR puede ser generada manual-

mente mediante SW2 (31), localizado en el panel frontal

La señal proveniente del 555 inicializa total-

mente el sistema y coloca a los uPs en estado de alta

impedancia mediante el circuito de selección de los

uPs. La señal-POR llega a las entradas de RESET de los

uPs a través de los AND de colector -abierto (9E) .

La señal de RESET de selección inicial se re-

fiere solo a los uPa y - s e aplica solamente la primera vez

que se selecciona un uP después de un POR o WR PGM. Es-

to se hace para asegurar que los uPs empezarán a ejecutar

los monitores a partir de las localidades de memoria

a las que deben dirigirse después de la aplicación de un

RESET.

Esto se logra con el circuito formado por los

AND (II), el retenedor (II) y los monoestables redispa-

rables (21) y (3J). Las salidas de los NAND están conec

47

tadas a las entradas ID, 2D y 3D del retenedor y cada

uno corresponde a un uP, estando sus entradas conectadas

por un lado, a la señal de reconocimiento del estado de

alta impedancia del uP respectivo, y por otro a la salida

Q correspondiente a la entrada a la cual están conecta-

dos. La entrada de reloj del retenedor es el tren de

pulsos proveniente de CLK (OUT) del 8085A debidamente bu-

ferado por el AND ( IB, superior) que carga al retenedor

constantemente con el valor presente en sus entradas.

Después de un POR o WR PGM, las señales de reco-

nocimiento de alta impedancia de los uPs están en 1L al

igual que las salidas Q del retenedor, lo cual coloca un

OL en las entradas D, y que es cargado constantemente en

dicho retenedor manteniendo el 1L en Q. Al seleccionar

un uP , su señal de reconocimiento de alta impedancia se

coloca en OL lo cual cambia la salida del NAND respecti-

vo a 1L, el cual a su vez se carga en el retenedor y apa-

rece en la salida Q respectiva como un OL que se realimen

ta a la entrada del NAND manteniendo su salida en 1L in-

dependientemente de cualquier variación, en adelante, de

la señal de reconocimiento de alta impedancia del uP en

cuestión-. Estas salidas Q se conectan a las entradas

A de los monoestables mientras que las entradas B están

conectadas a la señal RESET CPU proveniente del teclado

y que al estar desactivada está en 1L. Con la entrada

B en 1L, al cambiar a OL la entrada A, la transición

produce un pulso a la salida del monoestable, pulso que

se transmite a la entrada de RESET del uP respectivo

48

a través del OR y AND (9E) respectivo. Los OR (9E) per-

miten el paso de la señal de RESET solo al uP seleccion_a

do, esto se debe a que el RESET desde el teclado dispa-

ra a todos los monoestables simultáneamente.

Esta señal, correspondiente a la tecla RESET CPU,

proviene de la salida 4 del decodificador (15J), y como

ya fue mencionado, está conectada a las entradas B de los

monoestables. Al aplicarse esta señal, se disparará el

mono-estable cuya entrada A esté en OL generando el pul-

so de RESET respectivo. Inicialmente podría pensarse

que los OR (9E) están demás, por lo que se acaba de men

cionar al respecto del disparo en B y OL en A, y e.sto

es cierto si solo se selecciona un uP durante el funcio

namiento del sistema; pero en el caso más general, se

puede seleccionar todos sucesivamente, lo cual termina-

ría en todas las entradas A de los monoestables en OL

y por tanto se dispararían todos con la señal en B, y es

por e'so que se necesitan dichos OR para permitir el paso

de la señal de RESET, desde el teclado, solo al uP selec-

cionado .

Las señales POR y RESET desde el teclado (RST)

se conectan al exterior del sistema mediante el AND

(5J) , cuya salida se define como POR/RST. El complemen

to de esta señal POR/RST también esta conectada al exte-

rior- del sistema, mediante el inversor (5J).

2.8. PROGRAMADOR DE EPROMS.

49

Este circuito programa los EPROMS 2716 y las

dos versiones del 2758, es decir el que debe tener el bit

más significativo de las direcciones en OL y el que debe

tenerlo en 1L.

La programación se la hace a través del circuito

progr-amable de interfase de periféricos, PPI, 8255 (27C);

la señal de selección se obtiene del decodificador (13H)

cuyas salidas 8,9,10,11, se conectan al NAND (13H) y a tr_a

ves del inversor (13H) habilitan o deshabilitan al PPI

mediante su entrada CS . Esta señal, conjuntamente con

las de RD , WR, A0 y Al, controlan todo el funcionamiento

del circuito; A0 y Al se conectan a sus respectivos del

bus de direcciones. Las entradas D0 —• D7 se conectan

al bus de datos del sistema para recibir palabras de

control y datos de los uPs, y transmitir datos a éstos.

Los datos hacia y desde la EPROM pasan por las

salidas PB0—' PB7 y las direcciones por las salidas

PA0 ^PA7 y PC0--PC2 . La salida PC3 genera los pulsos de

programación para la EPROM o se mantiene en OL para su

lectura.

La salida PC4 carga un Oí en la salida Q del biestable

(26C) para la lectura de la EPROM o no ejecuta ninguna

acción y mantiene a Q en 1L para la programación de la

EPROM. El LED controlado por la salida Q al encenderse

indica lectura de la EPROM.

50

La salida PC5 , al cargar un 1L en la salida Q del

biestable (26D) y mediante el circuito' analógico del dia-

grama, coloca 25V en la entrada VPP del EPROM habilitánd£

lo para la programación. Por otro lado, con un OL' en la

salida Q, mediante el mismo circuito analógico del diagr_a

ma, Vpp está a 5V. La salida PC6 es-una señal de RESET

generada por el monitor para el circuito de programación

y conjuntamente con la señal de POR, a través de los NAND

(27C) inicializa este sistema. El NAND (28D) invierte la

señal POR para aplicarla al PPI.

2'. 9. FUENTES DE PODER

Para las fuentes de poder se tenía disponible

un transformador con un primario para 110V y dos secunda-

rios, uno de ellos entrega aproximadamente 45V y el otro

aproximadamente 13V, ésto sincarga.

El secundario que entrega 13V es utilizado para

alimentar los reguladores de 5V del sistema. Previamente,

este voltaje es rectificado por el puente de dio,dos

PDA 980-1 (21G) y luego filtrado por un capacito.r de

22000uF(22G).

El secundario que entrega 45V se utiliza para

generar los voltajes necesarios para el programador de

EPROMS. Este voltaje es rectificado por el puente de

diodos TCG168 (22E) y luego filtrado por un capacitor

de lOOOuF (23E) . El voltaje DC obtenido es alimentado a

51

un circuito (21B, 22B) que realiza la función de un dio.do

zener y baja el voltaje a 32v que luego es alimentado al

regulador de 24v (21C), el cual, debido a los dos diodos

conectados en serie con su terminal de tierra, genera los

25V que necesitan las EPROMS para su programación. De

estos 25V también se obtienen los 5V necesarios para la

polarización del EPROM a programarse. El transistor

(22C) baja los 35v a 14v para ser alimentados al regula-

dor de 5v (23D) , el cual, debido al diodo en serie con

su terminal de tierra, genera 5.6 v, voltaje que es. ali-

mentado al terminal de Vcc del EPROM a través del diodo

D4 (24C) y el circuito analógico (24D, 25D), que alimen-

ta al terminal de programación, Vpp, del EPROM.

Debido a que los reguladores de 24V son fija-

dos a cualquier voltaje entre 23V y 25V, el dio.do D5 (25C)

puede ser reemplazado por una conexión directa, si, al

cambiar el regulador existente, el regulador nuevo entre-

ga nuevos de 24v.

2.10. DISEÑO DEL SOFTWARE.

2.10-1. DIAGRAMAS DE FLUJO

RUTINA DE ERROR

52

QUITARINDICADORES

CONTADOR 1= FFH

CONTADOR 2= 30H

DECREMENTARCONTADOR 2

DECREMENTARCONTADOR 1

COMPLEMENTARINDICADOR DEERROR

SELECCIÓN DE RUTINA

53

GUARDARREGISTROSNECESARIOS

QUITAR INDICADORDE "RESET"

INFORMACIÓNDESDE TECLADO

LOCALIZAR DIREC-

CIÓN DE RUTINA

REESTABLECER RE-

GISTROS

SALTAR A RUTINA

LOCALIZADA

SALTAR A RUTINADE SERVICIO DE

USUARIO

54

RUTINA DE INSERCIÓN DE BREAK.-

DE BREAKSINSERTADOS

ESPERAR LOCALIDADDEL BREAK

GUARDAR LOCALIDAD

DEL BREAK Y OPCODECORRESPONDIENTE

INSERTAR INSTRUC-CIÓN DE BREAK

ACTUALIZARCONTROL DEBREAKS

INCREMENTARCONTADOR DEBREAKS

SALTAR A RUTINA

DE "ESCAPE"

SALTAR A RUTINADE "ERROR"

55

R U T I N A DE C A R G A DE DATOS D E S D E EL T E C L A D O .

LEER Y GUARDAREL BYTE MASSIGNIFICATIVO

LEER EL BYTEMENOS SIGNIFICATI-VO

EJECUTAR RETORNO

56

RUTINA DE REMOCIÓN DE BREAK

DE BREAKSINSERTADOS=00H

ESPERAR LOCALIDADDEL BREAK

LOCALIZAR LA INS-TRUCCIÓN CORRES-PONDIENTE

INSERTAR EL OPCODEEN LA LOCALIDADLEÍDA

ACTUALIZAR CONTROLDE BREAKS

DECREMENTAR CONTA-DOR DE BREAKS

SALTAR A RUTINA DE"ESCAPE"

SALTAR A RUTINADE "ERROR"

RUTINA DE GO

57

REINSERTAR ELOPCODE

TERMINAR

SS

si

ESPERAR DIRECCIÓN

CORRER DESDELA DIRECCIÓNINTRODUCIDA

REINSERTAR EL •OPCODE

ACTUALIZAR CONTROIDE BREAKS

DECREMENTAR CON-

TADOR DE BREAKS

R U T I N A DE CAMBIO DE CONTENIDO DE REGISTROS

ENCONTRAR REGISTROA ALTERAR

\t

LEER NUEVO DATO

GUARDAR DATO DERAM DE REGISTRO

MOSTRAR DATO ENDISPLAY

RUTINA DE CHEQUEO DE BREAKS

ENCONTRAR BREAK

MOSTRADO

\

S!

MOSTRAR SIGUIENTEBREAK

MOSTRAR NUMERO DE

BREAKS INSERTADOS

RUTINA DE MNU

ESPERAR CÓDIGODE SELECCIÓN

LOCALIZAR DIREC-

CIÓN DE RUTINA

SALTAR A RUTINA

LOCALIZADA

RUTINA DE ROTAR REGISTROS (DERECHA)59

REGISTROSELECCIONADO

ENCONTRAR

REGISTRO

ENCONTRAR SIGUIEN

TE REGISTRO HACIALA DERECHA ,

MOSTRAR CONTENIDODE NUEVO REGISTRO

ACTUALIZAR STATUS

DE MONITOR

RUTINA DE ROTAR REGISTROS (IZQUIERDA)

REGISTRO

SELECCIONADO

SELECCIONARPC

ENCONTRARREGISTRO

ENCONTRAR SIGUIENTE REGISTRO HACI7ÍLA IZQUIERDA

MOSTRAR CONTENIDODE NUEVO REGISTRO

ACTUALIZAR STATUS

DE MONITOR

RUTINA DE SS

60

REINSERTAROPCODE

ACTUALIZAR CONTROLDE BREAKS

DECREMENTAR CONTA.DOR DE BREAKS

ESPERARDIRECCIÓN

ENCONTRAR SIGUIENTE INSTRUCCIÓN ""

GUARDAR OPCODEE INSERTAR SSBREAK

CARGAR REGIS-TROS

EJECUTAR DESDEINSTRUCCIÓN ANTE-RIOR

REINSERTAR

OPCODE

. 2.10.2. PROGRAMAS

Los listados de los programas se encuentran

en los Apéndices.

61

III . OPERACIÓN DEL SISTEMA

3.1. DESCRIPCIÓN DEL PANEL

3.1-1. DESCRIPCIÓN DE LOS TECLADOS

Se puede considerar aquí que uno de los tecla-

dos está dedicado a la introducción de los caracteres he-

xadecimales, mientras que el otro se encarga del control

del sistema. El primero ( el de la izquierda en el pa-

nel) tiene en realidad 16 teclas para caracteres hexade-

cimales y 3 que pertenecen al grupo de control. La fun

ción de cada una de las 22 teclas de control se describe,

en forma general, a continuación.

Z80 , 8085A, 6800, EXTRA.-

Al presionar una de estas teclas se selecciona

el uP a utilizarse. EXTRA se refiere a un uP externo al

sistema.

BREAK_INSERT.-

Inicia la rutina'de inserción de un BREAK en el

programa del usuario. Pueden insertarse un máximo de 8.

BREAK REMOVE.-

Inicia la rutina para remover un BREAK del pro-

grama del usuario.

BREAK CHECK.-

Indica cuantos BREAKS se han insertado en el pro

grama del usuario y en qué localidades se encuentran. La

62

función de esta tecla es cíclica, es decir , una vez que

por presiones sucesivas de la tecla, se ha mostrado la

localidad del último BREAK. insertado, indica nuevamente

el número de BRE&KS insertados, procediendo luego a mos-

trar las localidades de los BREAKS y así sucesivamente.

ARS . -

Esta tecla funciona solamente cuando está selec

cionado el Z80 y muestra el contenido del par de registros

que tienen registros primos, es decir: AF, BC, DE y HL.

En caso de ser presionado luego de seleccionar cualquier

otro registo o si se está trabajando con otro uP, da in-

dicación de error.

La función de esta tecla es cíclica, es decir,

presiones sucesivas de ella mostrarán, alternadamente , el

contenido del par de registros primo del seleccionado, y

el contenido de éste.

MNU.~

En el caso del Z80 esta tecla realiza mas de una

función. Selecciona las funciones pertinentes a la lec-

tura- programación de una EPROM, lectura-escritura de una

localidad de RAM, y cálculo del OFFSET para saltos rela-

tivos -

En elcaso de los otros uPs, inicia la rutina de

lectura-escritura de una localidad de RAM.

63

REG. STR.-

Cambia el contenido del registro seleccionado

por el dato introducido a los indicadores de datos.

REG, REG

Estas teclas se usan para seleccionar (encender)

uno de los 16 LEOS (excepto RST , BRK, ERR, SS) que indican

el STATUS del MONITOR. El movimiento de encendido del

LED seleccionado es hacia la izquierda o derecha, de acuer

do al sentido que indica la fecha. No todos los LEOS de

status del panel pueden ser seleccionados para un uP dado;

así con el Z80 se pueden seleccionar: PC, SP , ARS, AF, BC ,

DE, HL, IX, IY, IR; con el 8085A se pueden seleccionar:

PC, SP, AF, BC, DE, HL,IR; con 6800 se pueden seleccionar;

PC, SP, CCR, AB, IX. •

El significado 'de estos registros ss, para cada

uP, el siguiente:

Z80

PC : Contador de programa

SP : Stack pointer

ARS : Selección de contenido de registros alternos(primos'

AF : Acumulador y registro de banderas

BC : Par de registros BC

DE : Par de registros DE

HL : Par de registros HL

IX : Registro índice X

IY : Registro índice Y.

IR : Registro de interrupción

64

8085A


SP : Stack poÍnter

AF : Acumulador- y registro de banderas

BC : Par de registros BC.

DE : Par de registros DE

HL : Par de registros HL

IR : Registro de interrupciones

6800


SP : Stack pointer

CCR : Registro de banderas ( Condition Code Register)

AB : Acumuladores A y B

IX : Registro índice

La función de 'estas dos teclas es cíclica, es de

cir, una vez seleccionado el último LED, vuelve a selec-

cionarse el primero y viceversa.

WR PGM.-

Coloca al sistema en el modo de programación.

ESCAPE.-

Produce un salto a la rutina del mismo nombre,

rutina que permite volver al control del monitor mante-

niendo todavía datos intermedios como por ejemplo indica

ción de status y numero de BREAKS insertados.

65

- GO. -

Inicia la rutina que permite ejecutar un progra-

ma del usuario.

- . RD. PGMt , RD PGM4 .-

Estas teclas son utilizadas so'lo cuando el si_s

tema está en el modo de programación, e incrementan o

decrementan en una unidad la dirección mostrada en los

indicadores de direcciones, leyéndose el contenido de d_i

cha localidad en los indicadores de datos.

RESET CPU.-

Produce un RESET solo en el uP seleccionado.

ss. -

Inicia la rutina de ejecución del programa del

usuario paso a paso.

H. -

Se utiliza cuando el sistema está en el modo de

programación. Coloca á los indicadores de dígito en el.i

dígito más significativo de los indicadores de direccio-

nes; esto indica que se debe ingresar la dirección de la

localidad de memoria que se quiera leer.

L. -

.Inicia la rutina por medio del cual el uP selec-

cionado lee datos -provenientes del teclado.

SHIFT.-

Mueve los indicadores de dígito un dígito hacia

66

la izquierda. De esta manera se puede corregir un ca-

rácter antes de que el dato sea ingresado al sistema.

3.1-2. INDICADORES DE STATUS.

3.1-2.a. INDICADORES DE STATUS DEL MONITOR

Visualizan las diversas actividades que ejecuta

el programa monitor. El significado del encendido de

cada LEDes el siguíente:

RST: El monitor ha ejecutado la rutina de RESET.

BRK: El programa del usuario ha encontrado y ejecutado

un BREAK.

ERR: Se ha tratado de ejecutar una función no permiti-

da.

SS: El monitor esta ejecutando el programa del usuario

paso a paso.

PC..IR: El significado de estos indicadores fue expli-

cado en el numeral anterior al describir el fun

cionamiento de las teclas REG, REG.

3.2-2.b. INDICADORES DE STATUS DE LOS üí s . -

Mediante estos indicadores se puede visualizar

el estado de las entradas de los uPs que controlan el

estado de alta impedancia de éstos, así como también

el de sus salidas de respuesta a este estado de alta im-

pedancia .

En el caso del 380 se tiene también una indica-

67

clon de cuando el uP ha ejecutado la instrucción HALT.

3.1-2.C. INDICADORES DE PROGRAMACIÓN DE

EPROMS.

Estos indican si la EPROM insertada en el zóca-

lo de zero-fuerza de inserción está siendo programada

(PROG) o leída ( RD). Una EPROM puede ser insertada o

retirada del zócalo solo cuando ambos indicadores están

apagados, lo cual indica que no hay ninguna actividad

que incluya a dicha EPROM.

3.2. ENCENDIDO, POR Y REUBICACION DE MEMORIA.

El encendido del sistema es controlado por el

interruptor dentro del marco denominado POWER. El LED

dentro del mismo marco indica si el sistema está o no

energizado.

En el marco denominado POR, el LED indica que el

sistema está siendo sometido a una señal de RESET general

Esta señal se genera automáticamente al encender o apagar

al sistema y puede también ser activada mediante el inte-

rruptor pulsante dentro del mismo marco.

El interruptor dentro del marco MEM sirve para

reubicar la memoria del sistema. Al estar hacia abajo,

la EPROM (que contiene al monitor) y la RAM están en las

localidades indicadas en la parte inferior del marco.

68

De esta manera, se pueden correr programas del usuario

(sin control del monitor) desde las localidades de donde

se lee la primera instrucción después de un RESET , gene-

ralmente 0000H o FFFEH.

3.3. PROCESOS DE OPERACIÓN

3.3-1. INTRODUCCIÓN DEL PROGRAMA DEL USUARIO.

Al encender el sistema, el LED que indica POR

se encenderá por aproximadamente 2 segundos y luego se

apagará indicado que el sistema puede ser operado. Al

mismo tiempo, aparecerá en los indicadores de direccio-

nes FPPPH y en los indicadores de datos un valor cualquie

ra. El interruptor MEM debe estar hacia abajo.

Luego de esto, y antes de realizar cualquier

proceso, es necesario presionar WR PGM, lo cual mostra

rá en los indicadores de direcciones 0000H y en los de

datos 3EH. Esto corresponde a la primera localidad de me-

moria y su contenido. Mientras se está en el modo de

pr-ogramacion los dos dígitos mas significativos de los

indicadores de datos permanecen apagados.

En este punto se pueden hacer dos cosas: Se-

leccionar uno de los uPs y entrar al comando del monitor

o introducir un programa del usuario . Al realizar

lo primero se tiene que el monitor funciona pero no exis

te un programa sobre el cual pueda actuar, de ahí que

69

esta primera acción no tiene ningún sentido.

Para introducir un programa del usuario es ne-

cesario escoger un área de RAM destinada para este pro-

pósito, y la primera localidad disponible es 1126H y va

hasta 1BFFH; otra área va de 2000H hasta 23FFH.

Para esta explicación se usará como primera lo-

calidad para el programa de prueba 1200H. Presionando H,

los indicadores de dígito a introducirse pasarán a indi-

car el dígito más significativo de los indicadores de

direcciones, de manera que ahora se puede introducir la

dirección deseada, es decir, 1200H. Se observará que con

la introducción de cada carácter, los indicadores de dí-

gito se mueven una posición hacia la derecha indicando

el siguiente dígito a escribirse. Al introducirse cada

carácter de la dirección, aparecerá en los indicadores

de datos el contenido de la nueva localidad; así, en el

caso de este proceso, la dirección inicial era 0000H

y mostraba el contenido 3E,H, al introducir el primer ca-

rácter de 1200H aparecerá el contenido de la dirección

1000H y.así sucesivamente hasta completar la dirección.

Es posible cambiar cualquier carácter introducido posi-

cionando los indicadores de dígito debajo del carácter

deseado,.presionando la tecla SHIFT. Cada presión de

esta tecla mueve los indicadores mencionados una posi-"

ción hacia la izquierda. Si estando dichos indicadores .

en el dígito más significativo de los indicadores de

direcciones, se presiona la tecla SHIFT, aquellos pasaran

70

a indicar el dígito menos significativo de los indicado-

res de datos, y presiones sucesivas de la tecla harán

que se desplazen los indicadores de dígito hacia la iz-

quierda y alrededor de los 4 indicadores de datos. Pa-

ra volver al procedimiento normal se presiona WR PGM o "H.

Volviendo al procedimiento inicial, y asumiendo

que se ha introducido ya la dirección 1200H , si se presi_o

na cualquier tecla hexadecimal, no pasará nada y se se-

guirá observando la misma dirección y su contenido. Pa-

ra alterar el contenido es necesario presionar WR PGM ,

evitándose así que se altere accidentalmente la locali-

dad leída. Luego de haber presionado WR PGM se puede

ingresar el programa de prueba o alterar la localidad

deseada. Al introducir el primer dígito se alterará

el contenido de dicha localidad y aparecerá el nuevo

dígito como el más significativo del par hexadecimal

y el segundo dígito variará de acuerdo con el contenido,

en ese momento, del buffer de datos respectivo del sis-

tema, además, los indicadores de dígito indicarán el

dígito menos significativo. Al introducir el segundo

carácter hexadecimal, los indicadores de dígito pasan

a indicar el dígito más significativo del par hexadeci-

mal y se incrementa automáticamente el contador de di-

recciones observándose en los indicadores de estos la

localidad siguiente, es decir, para este caso 1201H,

y su contenido.

Una vez introducido el primer carácter del par

71

hexadecimal, presiones sucesivas de SHIFT harán que los

indicadores de dígito oscilen entre los dos caracteres

de dicho par.

La introducción del programa completo se limita

a introducir los datos uno tras de otro , ya que el con-

tador de direcciones/ como se menciono anteriormente,

se incrementa automáticamente luego de la introducción

del dígito menos significativo.

Mientras el sistema este en el modo de programa-

ción, e independientemente del uso de las teclas H y

SHIFT, las teclas RDPGMt y RD PGM* incrementarán o de-

crementarán en 1, respectivamente, el contador de direc-

ciones, observándose la nueva localidad, y su contenido

en los indicadores respectivos.

En cualquier momento durante el proceso anterior,

se puede, mediante la tecla H, leer cualquier localidad

de memoria,

. En general, si por algún motivo se pierde con-

trol del sistema, estando ya sea en el modo de programa-

ción o bajo control del monitor, presionando WR PGM de-

volverá el control del sistema ( por HARDWARE) al tecla-

do , y en caso extremo, el botón POR reinicializará todo

el sistema.

Cabe indicar aquí que el encendido de los indi-

72

cadores de direcciones ( que sucede solo en el modo de

programación) está sujeto a una respuesta positiva de

todos los uPs al estado de alta impedancia; es decir,

si uno de ellos no responde, mediante su salida respec-

tiva , a este estado, no se encenderán dichos indicadores,

Estas señales, como ya fue explicado, son moni-

toreadas mediante los LEOS en el marco denominado STATUS-

uPs en el panel del sistema.

Es recomendable familiarizarse bien con el pro-

cedimiento explicado hasta aquí antes de proceder a la

selección de uno de los uPs y al uso de su monitor.

3.3-2. USO DE LOS MONITORES

Una vez entrado el programa del usuario, presio

nando la tecla correspondiente a uno de los uPs residen-

tes (Z80, 8085A, 6800) colocará al sistema bajo el con-

trol del monitor respectivo.

Para la demostración del uso de los monitores

se uóítilizará un programa para el Z80 y se explicará

detalladamente el uso de su monitor; para el 8085A y el

6800 se resaltarán las diferencias en el funcionamiento

de sus respectivos monitores con respecto al del Z80.

3.3-2.a. 280

El procedimiento de ingreso del programa se

73

describirá en secuencia junto con el programa. El pro-

grama cargará algunos de los registros del uP con cier-

tos valores y terminará en un lazo.

1. Presionar POR y esp.erar a que se apague el LED res-

pectivo .

2 . Presionar WR PGM

3. Presionar H e ingresar la dirección 1200H

4. Presionar WR PGM

5. Ingresar el programa que se lista a continuación .

El listado corresponde al programa luego de haber

"sido ensamblado.

1200

1202

1204

1206

1209

120C

120F

1213

1217

121A

121B

121C

121D

3E22

ED47

3E11

010201

110403

210605

DD210700

FD210800

310013

00

Z80TST

END

18FD

LD

LD

LD

LD

LD

LD

LD

LD

LD

NOP

NOP

NOP

JR

A,

I,

A,

BC

DE

HL

IX

IY

SP

22H

A

11H

,0102H

,0304H

,0506H

,0007H

,0008H

,1300H

END

6. Chequear que el programa esté bien: presionar H, in-

gresar 1200H y verificar, el contenido de esta locali-

dad; presiones sucesivas de RD PGM1- permitirán veri-

74

ficar todo el programa.

7. Presionar la tecla Z80.

En este momento deben estar encendidos solamen-

te los dos dígitos menos significativos de los indicado-

res de datos y debe leerse 00H; en los LEOS de status

de los uPs deben estar apagados todos los LEDS corres-

pondientes al 280 (BUSRQ, BUSAK, HALT), y en los LEDS

de Status del Monitor debe encenderse solamente RST.

Esto indica que el sistema está bajo control del monitor

del Z80 y ha ejecutado la rutina RESET.

Con el fin de constatar el buen funcionamiento

del programa, se puede insertar un BREAK en la localidad

121CH, el cual transferirá el control nuevamente al moni-

tor una vez que el programa de prueba haya alcanzado di-

cha localidad. Para esto hay que proceder de la siguien_

te manera:

1. Presionar BREAK INSERT. Se observará que los indi-

cadores de datos muestran 0000H y los indicadores

de dígito están posicionados en el dígito más signi-

ficativo. RST debe apagarse.

2. Ingresar la dirección para el BREAK, es decir, 121CH

3. Presionar L. Esto hará que el monitor lea la direc-

ción que se acaba de ingresar y proceda a la inser-

ción del BREAK. Debe leerse ECH en los indicadores

de datos.

75

Para verificar la inserción del BREAK se pre-

siona BREAK CHECK: debe verse en los indicadores de da-

tos 01H, lo que indica que hay 1 BREAK insertado. Pre-

sionando nuevamente esta tecla mostrará la localidad de

este BREAK, en este caso, 121CH. Una nueva presión vol-

verá a mostrar 01H , repitiéndose la secuencia.

Ahora se está listo para correr el programa y

debe precederse de la siguiente manera:

1 . Presionar ESCAPE. Debe aparecer ECH en los indica-

dores de dato s,

2 . Presionar GO. Aparecerá 0000H, tal como en el caso

de la inse'rción del BREAK.

3. Ingresar la dirección desde el cual se desea correr

el programa, para el caso, 120011.

4 . Presionar L.

Se observará que en los indicadores de datos

se lee 121CH, que es la localidad donde se insertó el

BREAK, además estarán encendidos BRK y PC indicando que

se ejecutó un BREAK, y en los indicadores de datos apa-

rece la localidad donde se ejecutó.

Para ver el contenido de los registros del uP al

momento de ejecutarse el BREAK se presiona REG (REG), es-

to desplazará el LED que indica PC hacia la derecha (iz-

quierda) para indicar el siguiente registro, SP (IR) y

su contenido.

Asumiendo presiones sucesivas de REG, primero

76

se observará SP , luego AF, etc. Para los pares de regi_s

tros AF, BC, DE Y HL. Los dos dígitos más significati-

vos de los indicadores de datos muestran el contenido del

primer registro y los menos significativos el del segun-

do; así para el ejemplo:

PAR DE . INDICADORES EQUIVALENCIA

REGISTROS DE 'DATOS

AF

BC

DE

HL

11XX

0102

0304

0506

A =11

B =01

D =03

H =05

F = XX

C = 02

E = 04

L = 06

X=Desconocido

Para IX, IY, éstos son de 16 bits, luego los

cuatro dígitos de los indicadores muestran el contenido

del registro seleccionado. Para IR, éste es un registro

de 8 bits, por lo tanto deben tornarse en cuenta solo

los dígitos más significativas de los indicadores.

El procedimientoi anterior puede ser modificado

para que una vez que se ejecuta el BREAK, lo que se ob-

serve sea cualquiera de los registros del uP. Esto se

logra seleccionando el registro deseado mediante

REG, REt^ y luego realizando el proceso' a partir del nu-

meral 2 en el proceso anterior.

Así, si en el ejemplo se selecciona el par DE

y luego se corre el programa, lo que observará en los

indicadores de datos es el contenido de este par de re-

77

gistros.

Es posible cambiar el contenido de cualquiera

de los registros después de la ejecución de un BREAK,-

simplemente se selecciona el registro deseado, se ingre-

sa el nuevo valor y se presiona REG STR, ésto cargará

el nuevo valor en el registro y se puede comprobar selec-

cionando el par de registros siguiente o anterior y re-

gresando al par cuyo valor se quiso cambiar. Debido a

que los registros se muestran en pares, si se desea cam-

biar el contenido de uno de ellos sin variar el otro,

éste deberá ser cargado con el mismo valor, así:

Si el contenido de BC muestra 0102H y se desea

cambiar C a 34H, se procede a ingresar 0134H y se presio

na REG STR. Si por el contrario so quisiera cambiar B,

entonces habría que ingresar 34021 i y presionar REG STR.

Para visualizar esto, puede insertarse otro BRBAK

en la localidad 120FH realizando el proceso ya descrito y

también verificar la existencia de los dos BREAKS por

medio de BREAK CHECK.

SI correr el programa desde 1200H se observará

que ejecuta el BREAK 120FH. Ahora se puede proceder al

cambio del contenido del registro del ejemplo:

1. Seleccionar BC

2. Ingresar 0134H (cambio del contenido de C)

3. Presionar REG. STR.

4. Seleccionar PC

En este punto se corre el programa a partir de

la localidad del BREAK ejecutado (120FH) presionando GO

e ingresando esta dirección y se observará que el progra-

ma para en 121CH, que es la dirección del otro BREAK in-

sertado .

Seleccionando BC se puede comprobar que contiene

el nuevo valor 0134H. Si se verifica ( con BREAK CHECK)

el número de BREAKS insertados, se observará que hay uno

solo y está en 121CH, es decir, donde paro el programa.

Esto se debe a que al dar el comando de GO a partir de

una dirección donde está insertado un BREAK, el monitor

reinserta la instrucción del programa correspondiente a

dicha localidad y actualiza el contador de BREAKS in-

sertados. Si ahora se corre el programa a partir de es-

te BREAK, entrará al lazo de NOP del programa; si, por

el contrario, se presiona RESET CPU el monitor ejecutará

la rutina de RESET, y la instrucción correspondiente a la

dirección donde está el BREAK no será reinsertada quedan-

do la instrucción de BREAK (FFH) insertado en el progra-

ma. Si se corre el programa nuevamente bajo estas condi-

ciones, esta instrucción (FFH) será interpretada como

RST 38H y se saltará a la localidad de servicio de esta

instrucción (1138H) con la posible destrucción del pro-

grama insertado ( de no haber un programa del usuario

direccionado en esta localidad). En general, esto su-

79

cederá con todos los BREAKS insertados que no hayan sido

removidos mediante GO o BREAK REMOVE.

Si se ha seleccionado uno de los pares de regis-

tros AF , BC, DE , o HL, es posible ver su par alterno

presionando ARS, esto encenderá el LED que indica ARS

y significará lo que se observa en los indicadores de

datos es el contenido del par de registros alterno del

par seleccionado, así, si se ha seleccionado BC y se

presiona ARS se observará en los indicadores de datos

el contenido de B'C ' . Presiones sucesivas de ARS encejT.

derán y apagarán el LED respectivo y se mostrará al-

ternadamente el contenido del par de registros selec-

cionados y el de sus respectivos alternos. Si se pre-

siona ARS habiendo seleccionado algún registro diferen-

te a los mencionados, el monitor responderá con una in-

dicación de error.

Si se desea remover un BREAK insertado -en el pro

grama simplemente se presiona BREAK REMOVE, se ingresa

la dirección del BREAK que se quiere remover y se pre-

siona L. Para verificar que efectivamente el BREAK

fue removido, se puede utilizar BREAK CHECK o la te-

cla MNU. Esta tecla será explicada mas adelante.

Es posible ejecutar el programa que se haya in-

gresado, paso a paso mediante la tecla SS. Igual que

en el caso de ejecución de un BREAK, se puede observar

el contenido de todos los registros del uP, pero esta

80

vez después de la ejecución de cada instrucción.

Pueden darse dos casos en el funcionamiento de

esta tecla. Primero, cuando el programa no ha sido co-

rrido aún o se ha presionado ESCAPE 5 RESET; en este caso,

después de presionar SS el monitor responderá colocando

0000H en los indicadores de datos, indicando que

hay que ingresar la dirección desde la cual se desea eje-

cutar el programa y se enciende el LED correspondiente a

SS indicando que esta función está en proceso. Para el

programa de ej emplo se ingresa 1200H y se presiona L , apa.

reciendo 1202H en los indicadores de datos y encendiéndo-

se PC, lo cual indica que se ejecuto la instrucción en

1200H y que el contenido del contador de programa (PC)

después de ejecutar esta instrucción es 1202H. A partir

de aquí, presiones sucesivas de la tecla ejecutarán el

programa instrucción por instrucción, leyéndose luego de

cada presión el contenido del registro seleccionado.

El segundo caso en el funcionamiento se refiere

al funcionamiento de SS luego de la ejecución de un BREAK.

En este caso, presiones sucesivas de SS ejecutarán el

programa a partir de la localidad en la que se ejecuto

el BREAK t reeinsertando primero la instrucción correspon-

diente a dicha localidad y actualizando el contador de

BREAKS (disminuyéndolo en 1). De esta manera, se puede

correr el programa normalmente hasta un punto determina-

do por un BREAK, para luego proseguir s.u ejecución paso

a paso.

81

Para terminar la función SS se presiona GO y se

ingresa la última localidad mostrada en los indicadores

de datos, así el programa se ejecutará normalmente a pa_r

tir de dicha localidad. Otra manera es utilizando MNU

para leer la localidad mostrada y reingresar la instruc-

ción correspondiente. MNU será explicada mas adelante.

Como en el caso de BREAK, existen teclas que al

ser presionadas terminan la función SS dejando inserta-

da en el programa la instrucción utilizada por él- moni-

tor para ejecutar dicha función; estas teclas son:

BREAK -INSERT, BREAK REM'OVE , BREAK CHECK, ESCAPE y RESET.

La tecla MNU, en el caso del Z8Q, selecciona la

lectura-escritura de una localidad de memoria, lectura-

programación de EPROMS y cálculo de offset para saltos

relativos.

Al presionar esta tecla aparece en los indicado-

res de datos 11H, indicando que se debe ingresar un có-

digo hexadecimal para seleccinar la 'función deseada; la

correspondencia entre código y función se encuentra en

el cuadro denominado MNU en el panel frontal, y a con-

tinuación se describen dichas funciones.

00 — R/W MEM.

Al ingresar 00H y presionar L el monitor responde

colocando 0 0 0 0 H en los indicadores de datos, a continua-

8 o¿.

: c i ó n se ingresa la dirección de la localidad cuyo cont_e

nido se desea leer y se presiona L , en seguida aparece-

rá en.los indicadores de datos dicho contenido. Para

alterar este dato, • se ingresa el nuevo dato y se pre-

siona L, aparecerá ECH indicando que se ha ejecutado la

alteración y que el monitor esta en la rutina ESCAPE.

03— PGM680

Esta rutina programa las EPROMS 2716 y 2758 (AR=

0.L) . Al ingresar 03 y presionar L, el monitor responde

colocando 0000H en los indicadores de datos, lo cual

significa que se debe ingresar la dirección de memoria

del sistema desde la cual se va a grabar en la EPROM

insertada en el zócalo del panel. Al ingresar esta lo-

calidad y presionar L, aparece 0001H lo que significa que

hay que ingresar la dirección de memoria del sistema

hasta donde se va a grabar en la EPROM. Ingresando es-

ta dirección (con L) aparece 0002H, indicando que ahora

se debe ingresar la dirección de la EPROM desde donde

se va a grabar la información de la memoria del sistema.

Ingresando esta dirección (con L), se encenderá el LED

denominado PROG dentro del "marco llamado EPROM en el pa-

nel. La última dirección ingresada permanecerá en los

indicadores de datos mientras dure la programación, es

decir, hasta que se apague el LED PROG. Luego de esto

aparecerá ECH indicando el fin de la programación y que

el monitor está en la rutina ESCAPE.

Si el área de memoria del sistema que se está

83

grabando excede la dirección 2048H de la EPROM, el moni-

tor realizará la grabación hasta esta localidad y luego

dará indicación de alarma sin grabar el resto, ésto pa-

ra evitar el escribir sobre lo que este grabado en 0000H

de la EPROM. Dado que el 2758 es solo de 1K x 8 bytes

y que utiliza el mismo programa, es posible escribir so-

bre su contenido si se excede la localidad 1024H sin que

se active la alarma.

La EPROM puede ser insertada o removida del zó-

calo en el panel solamente cuando los LEOS del cuadro

denominado EPROM estén apagados, .esto tanto para las

funciones de programación como de lectura.

0-6 — PGM581

Esta rutina programa la EPROM 2758 SÍ865 (AR-1L).

El procedimiento para la programación es idéntico al

caso anterior excepto por la alarma que esta vez se ac-

tiva al excederse la localidad 1024H.i

09—LD680

Esta rutina lee datos desde las EPROMS 2716 y

2758 (AR=0L). El procedimiento para la lectura es simi-

lar a los dos casos anteriores pero con una diferencia

en las indicaciones del monitor:

H ; Dirección de EPROM desde la cual se va a leer.

1H : Dirección de EPROM hasta donde se va a leer.

84

0002H: Dirección de RAM del sistema desde donde se va

a cargar la información leída desde la EPROM.

Una vez terminada la lectura el monitor coloca

ECH en los indicadores de datos. Tal como en el caso de

la programación de estas EPROMS, si el área de EPROM ex-

cede la localidad 2048H se activa la alarma. Mientras

dure la lectura, el LED RD permanece encendido.

0C—LD581

Esta rutina lee datos desde la EPROM 2758

S1865 (AR=-1L) . El procedimiento de lectura es idéntico

al caso anterior excepto por la alarma, que se activa

si se excede la localidad 1024H.

0F:—OFFSET

Esta rutina calcula el OFFSET necesario en las

instrucciones de salto relativo. El procedimiento es el

siguiente: Se ingresa primero el código 0FH y el moni-

tor responde con 0000H en los indicadores de datos, lúe

go se ingresa la dirección equivalente a la dirección

donde está el salto mas 2, luego se ingresa la dirección

a" la cual se desea que se produzca el salto y el monitor

responde colocando el offset en los indicadores de datos

Si la dirección a la cual se desea saltar está fuera del

rango permisible, el monitor da indicación de error. El

programa no acepta sa.ltos que pasen el límite FFFPH y

85

0000H, dando en estos casos también indicación de error.

3 . 3-2.b. 8085A

El funcionamiento del monitor es igual al del Z80

excepto para las teclas ARS y MNU, y los LEDS de Status

del Monitor, que responden de acuerdo a los registros

del 8085A. En cuanto a las teclas, al presionarse ARS

el monitor da indicación de alarma; y el MNU solo reali-

za la función de lectura-escritura de una localidad dé

memoria (R/W MEM en el caso del 280).

Con respecto a los LEDS de Status del Monitor, IR

se refiere al registro de interrupciones y dato serial;

dado que éste es un registro de 8 bits y se muestran 16

bits en los indicadores de datos, deben tomarse en cuen-

ta solo los dos dígitos más significativos ya que estos

corresponden al contenido de este registro.

Cabe indicar que la única manera de leer este re-

gistro es con la instrucción RIM, la cual copia su con-

tenido al acumulador y además lee un bit de dato serial

presente en el terminal SID del uP. Al ejecutarse un

BREñK, y con el fin de tener acceso al contenido del

registro en cuestión al momento del BREAK, se ejecuta

esta instrucción (RIM) en algún momento durante la ru-

tina de ejecución del dicho BREAK, y como se mencionó

anteriormente, en ese momento se lee el dato del termi-

nal SID, lo cual implica que este bit puede ser erróneo

86

si el ^'dato es una señal variable.

3 . 3-2 . c. 6800

El funcionamiento del monitor es igual al del 280

exceptó para las teclas ARS y MNU, en cuyo caso se com-

porta igual que para el 8085A.

A diferencia de los otros dos uPs, el 6800 permi-

te el encendido de los indicadores de direcciones, y cu a n.

d'o esto suscede siempre se lee FFFFH; las teclas con las

que ésto ocurre son: BREAK INSERT, BREAK REMOVE, MNU,

GO, SS, y se debe a que las rutinas activadas por estas

teclas utilizan la instrucción SWI y ésto coloca al uP

en estado de alta impedancia, y como los otros uPs tam-

bién es'tán en alta impedancia, se habilita el acceso a

los indicadores de direcciones.

3.4. USO DEL SISTEMA CON CIRCUITOS EXTERNOS

n

Antes de explicar el uso del sistema con circuitos

externos, es necesario determinar la equivalencia entre

los p'ines de los conectores externos y las señales del

sistema. Estos conectores se encuentran localizados al

lado izquierdo del sistema.

Existen también, junto a estos conectores una to-

ma de tierra (GND) para un conector tipo "banana" para

facilitar la conección de tierra de circuitos externos

con el sistema.

87

COWECTOR

BC1

CONECTOR

EC2 (280) '

CONECTOR

EC3 (6800)

CONECTOR

EC4 (8085A)

1 -

2 -

3 -

4 -

5 -

6 -

7 -

8 -

9 -

10 -

11 -

12 -

13 -

14 -

15 -

16 -

17 -

18 -

19 -

20 -

21 -

22 -

23 -

24 -

25 -

D0

DI

D2

D3

D4

D5

D6

D7

A0

Al

A2

A3

A4

A5

A6.

A7

A8

A9

A10

All

A12

A13

A14

A15

EXTRA

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

16

17

18

19

20

**21

* * 2 2

23

24

(HOLD) 25

- RFSH

- MI

- IORQ

- MREQ

- INT

- NMI

- WA1T

- HALT

- BUSAK

- BUSRQ

- RD

- WR

- CLK

- CS2

- CS3

- POR/RST

- POR/RST

- 6K->8K-1

-' 8K^10K-1

-10K-T12K-1

-12K->14K~1

-14K-*16K-1

1

*2

*3

4

5

6

7

8

9

*10

*11

12

13

14

1 5

16

17

18

19

20

21

22

23

24

25

- BUS02

- DBE

- TSC

- HALT

- IRQ- NMI

- BA

- R/W

- VMA

- VMA

- DMA/REG REQ

- MEM CLK

- RD

- WR *

- CS2

1-

2 —

3-

*4-

*5-

*6-

*7-

*8-

9-

10-

11-

12-

13-

14-

15-

- CS3 *16~

- POR/RST

- POR/RST

- 48->50K-l

- 50-K-»52K-1

- 52K-J-54K-1

- 54K-*56K-1

- 56K^58K-1

- 58K->60K~1

- 60K^62K-1

17-

18-

19-

20-

21-

22-

23-

24-

25-

RESET OUT

SOD

SID

TRAP

RST -7 . 5

RST 6.5.

RST 5.5.

INTR

INTA

S0

ALE

SI

IO/M

READY

CLK (OUT)

HOLD

HLDA

RD

*WR

CS2

CS3

POR/RST

POR/RST

16K-»32K-1

. 32K-M8K-1

* Para hacer uso de estas señales se debe abrir

los Interruptores respectivos en ESI o ES2. Si no se usan

estas señales, los interruptores deben permanecer cerra-

dos , caso contrario, el sistema no funcionará debidamente.

La correspondencia entre los interruptores y las

señales- respectivas se describe en el numeral 3.4-1

** Estas líneas de habilitación se activan solo

cuando se reubica la memoria del sistema. Esta reubica-

ción se describe en el numeral 2.5.

El conector EC1 contiene las lineas de los buses

de datos1 y direcciones del sistema, es decir, los buses

a las salidas de -los buffers que separan a los uPs del

resto del sistema. Además, contiene la señal de control

de alta impedancia para un uí* externo.

El conector EC2 contiene las señales de control

del 280 (pines 1-13) y algunas señales generales del si_s_

tema como son:

CS2 , CS3 (pines 14-15) son señales para la selección

de circuitos periféricos y están decodificados en

F2H y F3H respectivamente.

POR/RST, POR/RST (pines 16-17) son señales de RESET

generadas desde el sistema. POR es de RESET automá-

tico del sistema.y se activa al conectar o desconec-

tar la alimentación al sistema o se genera manualmen-

te desde el panel frontal; esta señal es activa en

OL; POR es simplemente el complemento de POR. RST es

activo en OL y se genera desde el teclado (RST CPU) ;

RST es el complemento de RST.

Los pines 18-20 están libres

Los pines 21-25 corresponden a señales que activan

2K x 8 bytes, cada uno, de memoria externa.

El conector EC3 contiene las señales de control del

6800 (pines 1-9) y algunas señales extras propias

para un sistema basado en este uP, como también algu-

nas señales generales del sistema.

VMA (pin 10), es una señal de entrada al sistema y pa-

ra utilizarlo se debe abrir el interruptor ES 2/3).

DMA/REF REQ (pin 11), es una señal de entrada al gene-

rador de fases de reloj ( MC&875L), utilizado durante

ciertos procesos de DMA. Para su uso, debe abrirse

89

el interruptor ES2(2).

MEM CLK {pin 12) es una señal proveniente del genera-

dor de fases de reloj ( MC5875L) normalmente utiliza-

do para la habilitación de memoria.

RD , WR (pines 13-14) son las señales de lectura y es-

critura de los uPs . Para el Z80 y el 8085A son toma-

dos directamente de sus terminales respectivos, mien-

tras que para el 6800 son obtenidas de la siguiente

manera: RD = R/W'02'VMA, y WR=R/W'02'VMA. Esto se

explica, a nivel de circuito, en el numeral 2.3.

CS2 , CS3 (pines 15-16) son señales para la selección

de circuitos periféricos y están decodificados en

00F2H y 00F3H respectivamente.

POR/RST, POR/RST (pines 17-18) cumplen la misma fun-

ción explicada anteriormente al describir el coyrec-

tor EC2.


2K x 8 bytes, cada uno, de memoria externa.

El conector EC4 contiene las señales de control del

8 O 8 5 A {pines 1-19) y- algunas señales generales del si_s_

tema.

Los pines 20-23 cumplen la misma función explicada al

describir el conector EC2.


16K x 8 bytes cada uno de memoria externa.

Al utilizar las señales marcadas con (*), se debe, an-

tes, abrir el interruptor respectivo en ESI o ES2 ex-

plicados en el siguiente numeral.

90

3.4-1. PERIFÉRICOS EXTERNOS

El uso de periféricos externos al sistema es muy

simple, y se reduce a utilizar las señales necesarias

de los conectores externos del sistema mencionados en

el numeral anterior.

Sinembargo, es necesario una explicación adicional

acerca de aquellos terminales marcados con (*) en las

listas del numeral anterior.

Las señales correspondientes a estos terminales,

en estado inactivo, deben estar conectados a Vcc o tie-

rra, y esto se logra mediante los interruptores SS1 y

ES2 localizados junto a los conectores externos. En con

secuencia, para poder utilizar las señales anteriormente

mencionadas, es necesario abrir el interruptor respecti-

vo ya que el estado normal de estos interruptores es ce-

rrado. La correspondencia entre las señales y los inte-

rruptores se indica a continuación:

ESI ES2

1 - TRAP ' 1 - READY

2 - RST 7.5 2 - DMA/REF REQ

3 - RST 6.5 3 - VMA

4 - RST 5.5 4 - LIBRE

5 - INTR 5 - LIBRE

6 - TSC 6'- LIBRE

7 - DBEt-*BUS 02 1 - LIBRE

8 - HOLD . 8 - LIBRE

91

En el caso de la señal DBE del 6800/ ES1(7), la

señal no está conectada ni a Vcc ni a GND , sino a la se-

ñal BUS02 proveniente del generador do fases de reloj

para el 6800 (MC6875L) ya que en funcionamiento normal

éste debe ser su conexión. Abriendo este interruptor

deja libre la entrada DBE.

En el caso de VMA, ésta no es una de salida del si_s

tema, es decir, el complemento de la señal VMA del 6800

como podría pensarse. Es una señal de entrada necesaria

p.ara casos, por ejemplo/ de acceso directo a memoria

(DMA) y debe ser suministrada exteriormente.

Para el caso en que se requiera del uso de las

líneas de interrupciones que producen saltos a localida-

des preestablecidas de memoria, como son: NMI en el Z80;

TRAP, RST 7.5, RST 6.5, RST 5.5, en el 8085A; NMI,'IRQ

en el 6800; es necesario colocar instrucciones de salto

a las rutinas respectivas, en ciertas localidades de me-

moria ÍRAM) reservadas para estos casos.

.Esto se debe a que las localidades originales ha-

cia las cuales se pr'educen los saltos, luego de recibir

los uPs dichas interrupciones, están dentro de las áreas

de los programas monitores y han sido fijadas para saltar

a las localidades de RAM siguientes:

92

UP

Z80

8085A

6800

INTERRUPCIÓN

NMI

RST

RST

RST

RST

RST

RST

RST

RST

TRAP

RST

RST

RST

RST

RST

RST

RST

RST -

RST

RST

RST

NMI

IRQ

. SWI

0

8

10H

18H

20H

28H

30H

38H

7. 5

6. 5

5. 5

0

1

2

3

4

5

6

7

LOCALIDAD

ORIGINAL

0066H

0000H

0008H

0010H

0018H

0020H

0028H

0030H

0038H

0024H

003CH

0034H

002CH

0000H

0008H

0010H

0018H

0020H

0028H

0030H

0038H

FFFCH

FFF8H

FFFAH

NUEVA

LOCALIDAD

1144H

0000H NO HAY CAMBIO

'1126H

1129H

112CH

112FH

1132H

1135H

1138H

1147H *VER EXPLICACIÓN EN TEXTO

1141H

113EH

113BH

0000H No hay cambio

1126H

1129H

112CH

112FH

1132H

1135H

1138H

111DH

1123H

1120H

Para ilustrar el uso de las nuevas localidades,

supóngase que para el 280 se desea utilizar algún circui-

to que interrumpa al uP con NMI; entonces es necesario

colocar en la localidad 1144H la instrucción de salto

extendido no condicionado, C3, seguido luego de dos bytes

que indican la localidad en donde empieza la rutina res-

pectiva .

Este procedimiento es igual para el resto de inte-

93

rrupciones al igual que en los otros uPs, excepto en el

caso de la interrupción TRAP del 8085A en que se coloca la

dirección de la rutina de servicio y no la instrucción

de salto. Para ésta interrupción , las localidades para

la mencionada instrucción son: 1147 (byte menos signi-

ficativo) y 1148 (byte más significativo).

La señal HOLD no está conectada directamente al

terminal respectivo en el 8085A, pero su efecto es el mis

mo sobre el uP. El acoplamiento de esta señal al uP

está explicado en el numeral 2.7-5.

3.4-2. uPs EXTERNOS

El uso de uPs externos al sistema es también muy

simple y se reduce, como en el numeral anterior, a utili-

zar las señales necesarias de los conectores externos.

Debe tenerse cuidado, sin embargo, de no conectar

una señal hacia el sistema en un terminal que es exclusi-

vamente salida de uno de los uPs residentes del sistema.

Estos se indican a continuación:

EC1 EC.2 (Z80)

2 5-EXTRA 1 - RFSH

(HOLD) 2 - MI

- HALT

9 - BUSAK

13 - CLK

14 - CS2

15 - CS3

16 - POR/RST

EC3 (6800)

1 - BUS 02

7 - BA

9 - - VMA

12 - MEM CLK

15 - CS2

16 - CS3

17 - POR/RST

18 - POR/PST

EC4 (8Q85A

1 - RESET OUT

2 - SOD

3 - SID

9 - INTA

10 - SO

11 - ALE

12 - SI

15 - CLK (OUT)

94

17 - P O R / R S T 19 - 48K-^50K-1 17 - HLDA

21 - 6IO8K-1 20 - 50K—>52K-1 20 - CS2

22 - 8K-*10K-1 21 - 52K—54K-1 21 - CS3

23 -10K->12K-1 22 - 54K—>56K-1 22 - POR/RST

24 -12K-*14K-1 23 - 56K—»58K-1 23 - POR/RST

25 -14K-»16K-1 24 - 58K—60K-1 24 -16K—y32K-l

25 - 60K—*62K-1 25 -32K—»48K-1

Es necesario también, antes de trabajar con un

uP externo, deshabilitar las EPROMS del sistema. Esto se

logra mediante el interruptor de reubicación de memoria, .

localizado en el panel frontal en el cuadro denominado

MEM, colocándolo hacia arriba.

2.10-2. PROGRAMAS

Los listados de los programas monitores de los

tres uPs residentes en el sistema se encuentran en la par

te final de este volumen. "

IV. CONSTRUCCIÓN

4.1. DISTRIBUCIÓN GENERAL

En la figura a continuación se muestra, en for-

ma general, la distribución de las tarjetas y partes prin

cipales del sistema. Las tarjetas, sean éstas de circui-

tos impresos o de entorchar se identifican con la tecla T

seguida de un número, mientras que los zócalos (de las tar

jetas que los tienen) se identifican con la tecla J, igua_l

mente seguida de un número.

95

.Las dos regletas de conexión se identifican co-

rno RC1 y RC2, mientras que los conectores extras, localiza-

dos sobre algunas tarjetas, se identifican con la letra E

seguida de un numero.

VENTILADOR

PORTAFUSIBLE

F L

FS1 f

ES2 Í

ES

EC¿

tLj

EC2 1

EC1 [

GNDC

11

<=*•**

0 Oo

T9

0 O

Jr— i

1 1

T

C

U

5

T7

((

U/JA

C O1— LJ

O O Oo

s~^\/ 2 2 0 0 0 V f }

^\^^ TF1000 1 ^ -^

v^X RC1

| 1 1 C /

E2 T3/J3| |

QsvT2/J2

1 1

Q.5V1 — T3/J3 El] _-..!_ 1

Q5V

O D O Ci iZ[ O ^\*—LJ U LJ l_J I_J L.I (®T^

T6O O O O O O O O 0 'O O O O O O O O [->_

"l

T0 / J8

O-

REUBICACIONDE MEMORIA

MONTORDE POR

-POR MANUAL

-MONITOR DEENCENDIDO

•ENCENDIDO/APAGADO

96

Las tarjetas TI,T2,T3, la regleta de conexión

RC2 y 4 reguladores de voltaje se encuentran montados so-

bre un "plano de tierra", por debajo del cual se hacen

la mayoría de conecciones del sistema. De esta manera

se reducen los problemas debidos a lazos de tierra.

Este plano está fijo a la base del sistema fo_r

mando una sola "base general de tierra", a la cual están

fijas las tierras de las tarjetas restantes.

En la regleta de conexión RCl se hacen las

conexiones del voltaje de línea con el transformador TP,

el fusible, el ventilador y el interruptor de encendido/

apagado. En RCl se hacen las conecciones de los voltajes

rectificados y filtrados con las líneas a los regulado-

res respectivas.

4.2. DISTRIBUCIÓN DE ELEMENTOS EN LAS TARJETAS.

U2

U 1

U3

U¿

2pF

U7 U£ U

U8

U Ul

U9

0

-

i

U U

u u

3 2

U 1

5

U Ul

U !S

J7

8

U Ul2

0 3

U2

2U

23

U2

Í

U2

5

U2

6

•

U3

0

U2

9

U 2

8

U2

7

U U

31 32

-J3

5 U3

4

U3

3 C1

g £> i —

i h

R2

U36

LJ

,

,

CTR

1C

2 i

-

TI

98

Ul

U2 -

U3 -

U4 -

US -

U6 -

07 _

US -

U9 -

U10-

Ull-

U12-

U13-

U14-

U15-

U16-

U17-

Ü18-

U19-

U20-

U21-

U22-

U23-

U24-

U25-

U26-

U27-

U28-

U29-

U30-

U31-

U32-

U33-

U34-

U35-

U36-

74LS74

7404

74298

8212

8212

74L808

74298

74155

8212

8212

7408

74193

74LS74

8212

8212

8212

8212

74LS74

74Lsl55

7432

74C175

74C193

74C193

74C193

74C193

74C175

74LS51

CD4009

74C923

74C923

CD4009

74154

NE555

Rl - 12Kf7 ,1/4W

R2 - 4991n ,1/4W

Cl - luF

C2 - luP

C3 - O.OluF

CTR1-CONECTOR DE 7 PINBS

U1

UU

115

R9

0

C1

7

U3

9

U4

3U

11

2U

11

3

R92

UÍ5

C22

U54

61 1

6

(OP

CIO

NA

L)

cía

U3

8

cía

IHO

U¿

3C

23

U53

LUfl

U4

6

C20

U 3

7

C21

LU

Í

U5

2U

55

US

B

21 U [OP_

CIO

ÑA

U

21 U

(OP_

CIO

_

ÑA

U

U 5

9

21 U (OP_

cio_

NAL!

\i (OP_

cio_

NA

L)

U 6

2

U6

3R7

U ¿

2U

47

US

OU

51U

56

U57

U6

0U

61

U6

4R

3

100

U37 - 2114 C17 - O . 1 uF

U38 - 2114 . Cl 8 - O. 1uF

039 - 2716 Cl 9 - 0.luF

U40-2114 C 2 O - O . 1 u F

U41-2114 C 2 1 - O . 1 u F

U42 - 74154 C22 - 0.1uF

043 - 74LS155 C23 - 0.1uF

U44 - 74S257 C24 - 0.luF

045 - 2114

046 - 2114 0112 - 7408

047-74LS154 Ü 1 1 3 - 7 4 0 8

048 - 2716 0114 - 7408

049 - 7408 01 15 - 74LS3 2

050 - 2114

051 - 7408

052 -

053 - 2114

054 - 2716

055 - 7404

056 - 7408

057 - 74LS74

058 - 7432

059 - 7408 '

060 - 7432

061 - 7432

062 - 7411

063 - 7405

064 - 7409

R3 - 1.5K n ,1/4W

R4 - 1 . 5KÍ1 ,1/4W

R5 - 1 . 5KO ,1/4W

R6 - 1.5KS7 ,1/4W

R7 - 1KH ,1/4W

CTR2- CONECTOR DE 24-PINES

•i.

U6

8

U6

7

CT

R3

Ría T2

016

JOK

Q

TI

Ría

U6

6

-{R

.13

R12

U6

S

U 6

5U

70

U 7

2

U7

1

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5 U 7

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Jl (95)Jl (98)Jl (99)Jl (92)Jl (97)Jl (91)Jl (94)Jl (96)

Jl (47)Jl (48)Jl (49)Jl (41)Jl (42)Jl (43)Jl (44)Jl (45)Jl (46

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- E3 (20)- E3 (19)- E3 (18)- E3 (17)- E3 (16)- E3 (15)- E3 (14)- E3 (13)- E3 (12)- E3 (11)- E3 (10)- E3 (9)- E3 (8)

- E3 (7)- E3(6)- E3 (5)- E3 (4)- E3 (3)- E3 (2)- E3 (1)

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10 - T9 (17)11 - T9 (16)12 - T9 (15)13 - T9 (14)14 - T9 (13)15 - T9(12)16 - T9 (11)17 - T9 (10)18 - T9 (9)19 - T9 (8)20 - T9 (7)21 - T9 (6)22 - T9 (5)23 - T9 (4)24 - T9 (3)25 - T9 (2)26 - T9 (1)

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- E 4 ( 1 4 )- E4 (15)- E4 (16)- E4 (17)- E4 (18)- E4 (19)- E4 (20)- E4 (21)- E4 (22)- E4 (23)- E4 (24)

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E5(5)E5 (19)E5 (6)E5 (18)E5 (7)E5 (17)J4 (N)J4 (P)J3 (81) ,J2 (85) ,J3 (65) ,J3 (64) ,J2 (47) ,J2 (46) ,J2 (72)J2 (23)

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122

RC1

1 - HOv, FUSIBLE

2 - FUSIBLE , RCI (5)"

3 - HOv, INTERRUPTOR

4 - •5 - RCI(2J, TF, VENTILADOR, Ll6 - TF, VENTILADOR, Ll

RC2

1 - TÍO (3) ,RC2 (5)

2 - GND3 - TF , PUENTE DE DIODOS TCG168(AC)4 - TF, PUENTE DE DIODOS TCG168(AC)5 - RC2 (1) ,PUENTE DE DIODOS TCG168 ( + ) ,CAPACITOR lOOOuF.

6 - PUENTE DE DIODOS PDA98O-1(+),J4(2),CAPACITOR 22OOOuF,REG+5V

7 - TF, PUENTE DE DIODOS PDA980~1(AC)8 - TF, PUENTE DE DIODOS PDA980-1 (AC) .

V.

Todas las pruebas que se hicieron al sistema

tuvieron resultados totalmente satisfactorios. Dichas

pruebas incluyeron el uso de un microprocesador externo

al sistema, concretamente el 8035 de INTEL CORPORATION,

y diversos circuitos periféricos de los uPs. En cuan-

to a los programas, existen los inconvenientes señala-

dos en la Introducción de esta tesis, debido a las li-i

mitaciones existentes al momento de de desarrollo, in-

convenientes que pueden ser superados alterando un poco

dichos programas.

No se recomienda contruir uno o mas sistemas

idénticos a éste ya que hay muchas funciones realizadas

por "hardware" que pueden ser incorporados a los progra.

m-as monitores, de ahí que, en caso de quererse construir

un sistema parecido, el sistema puede ser utilizado para

desarrollar los programas respectivos.

123

El grabador de EPROMS incluido en el sistema,

si bien no es esencial, sí es una gran ayuda al momen-

to de querer implementar, en el posible circuito en de-

sarrollo, los programas desarrollados por el usuario.

124

BIBLIOGRAFÍA

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HALL , INC. 1980

THE TTL DATH BOOK FOR DESIGN ENGINEERS, TEXAS INSTRU-

V- MENTS , INC. 1976

125

VII. APÉNDICES

Hoj as de Datos

Listado de Programas

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52-•*,ro01o

55

NenUr-55

NanU<*•

MM54C922/MM74C922 16 key encoderMM54C923/MM74C9232Q key encoder

general description

Thüsa CMOS key encoders provide all thfl necessarylogic to fully encode an array of SPST switches, Thekuyboard icun can bu implomuntüd by uiihar an uxtttrnalclock or nxiurnal capacitor. ThustJ tmcodun alio havu on-chlp-pull-up dev¡coi which purmil iwjiches wíth up to50 kH on rüsistíinctí 10 bu uied. No diodus In thu iwltcharray aru neodud to eljminatu ghoit switches. ThaInturnal dubounca circuit nuudt only a vinuls uxiürnulcdpicttot and can bu dufuatud by oniiiUiiu the capacitar.A Data A va i labia ouiput goas to a hígh level when avalid kuyboard entry has buen made. Thu Dala Avaüsbleoutpul futurns lo a low levei when the entered key isreleaitíd, av**n !f another key ií depreísed. The DataAvailablu wjll fdturn high to índicata acceptance of thenow key a/tur a'normal debounce padod; this iwo keyloil over ií provldwd baiweeri any two switches.

An ínturnal ruflistur remombers tho lasi key presseduven altar Ihe key ¡v rttleased. The TRI-STATE* outputs

prouide (or uasy expansión and bus operaiion and artí." LPTTL compatible.

features

• 60 kH máximum switch on rusistance

• On or o|( chip clock

• On chip low pull-up duvlcus

• 2 key roll-over

» KuybouncB elimination wiih singla capacitor

• Last kuy rugistür al outputs •

• TRI-STATE outpuls LPTTL compatible

• Wide supply ranga 3V to )5V

• Low powtír consumplion

connection díagrams

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PARAMETER CONDITIONS MIN TYP MAX UNITS

OUTPUT ORIVE (S« 54C/74C Family Characttriitleí D«» Shiwt) • '

ISOURCíiQuíput Source Current (P-Chann«l)

' 'SOURCEOuiput Sourcn Currant (P-Chann»')

IsiNK Output Sink Currant (N-Channel) '

'SINK Output Sink Curj"em (N,-Channel)

TACC-^CVOUT"°V'

VCC-IOV.VQUT-PV,TA - 25°c

VCC-GV, VQUT-VCC.TA - 25°,c

VCG " iov, VOUT * ^cc*

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-8

1.75

( 8

-3,3

-16

3.6

16 ,

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mA

mA ,

mA

mA

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PARAMETER

tpdOi'pdl Prüp"(jat|on 0«|ay Tima to

LÓuical "0" or Logicai "1"

from D.A, .

i

'OH'llH Propag^ilon Palay Tim« fromLoflical "Q'.'or Lofllcil "]"

1 jnto Hiflh Im pedánea Staie

1HO('H1 Proptiyutlan D«I«y Tlmü (rom

Hlflh Irnpodunca St«tu 10 i

Loylcul "0"or Loglcal "1"

•

C|N Input Capaciiuncü

COUT' TRI'STATE Output Capacitünca

CONDIT10NS

CL - 60 pF, fF/gur» 1}

VCC - 5VVGC - iovVCG-ISV

RL-10k,CL-6pF,^frw*2;

VGC * w RL- IO^'• VCC- 10VCL- 10 pF

Vcc-ISV . ,'

RL * lOfc, CL • 50 pF, (Fígun 2)

VCC-BV .RL- IOKVGC" i°v CL- 6o PFVCC- IBVAny Input, (Note 2)

'Any Output, (Notu 2)

MIN TYP

• •60

35

26

80

65

50

100

55

40

5

10

MAX

150

80

60

200

150

110

260

125

9Q,

7,6

UNITS

mm .

m

nins

m

nini

ni

pF

PF

Nou lt "Abioluii M»x¡tnum R«lfnfl<" •!« thow v«lum Niyond whlch lh« lafaiy oí thí davic* cannol b« guaraniwd. Excepi for "OpanninuT«ntp*riiurt ñiintK" trwy »t* not rnaant to imply that iht devicaí »hou|d bu op»rai.id *[ ihow IrmJn. Th« ubi* ot "EI»ctrlcal Ch«r«itfinfci"providm condlljont for «úlual d*vica opttraiíon.NeuZi C.pMlunc.I.Bu.r.nMdby rlodlet.iiinu. . .

switching time waveforms

' *miv' |P W

ANrdHEH UI1I

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\ finí *T»TC"1 •-- ---

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•

FIGURE 1 FIOUREZ

block diagram

truth table ;

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*0mll lof MM6-*Cfl22/MM?4C922

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Typ|c«l lfp v* V|fg «t AnyV Input

l RUI, v» VOUT •' A||VOulpui

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Ouiputt »r* n TRl-STATE unrll key ii preited, ijien daia U placed on büi,Whon íc«y It r« «a^d, ouipun murn 10 TRI-STATE.

•ybo.rd may b* lynchronootly »c»nn«d by omlttlng int c«o«cltof >t oéc. .nd drlu no «c. dlr-ctly U th» iv.wm clock•n 10 hHi,

1-140

^^7ífr' ilwT*-^^^>ifc*í*^*ívíifii f í • '

rZ80-CPU Product Specif icatioíi

The X.ilog X.KU produel Inie is ;i compleie .sel oí' niicro-L'ompuU'i componen!*, di 'vclnpim'i i l sysU-nu; and Mippo i I.snUwan' l lu» /.SU i i i ic iuc iHi ip i i l t ' i rumpiui iMi l M'l iwlmli".:i]| ni M í e c t m i i l s necessaiy ln b i n l i l Ini ' . l i p i - t ln imana . 1

microcompnler sy.siem.s wilb v i r ina l ly nn oiber Ingic ¡uní ;ii n i í i i i n t i n i nnmher nl'Jow cnsí s l a n d a i d memnry elemenis.

The X.KO-tTU i* ;i l l i i r t l g e n e í a i i n n single c h i p micrn-proeossot wilb unrtvaled cmnpi i l a imi ia l powcr. Thi.sinereased c n i n p u l a l i o n a l power residís in bigher sy.slemthruugh-pui ;md more eiTieieni nieniury u i i l i z a l i u n whencompared lo seeond gene ra l inn mierocompnler.s. Inaddf l ion , l l ie X.HO-CTU is veiy e;i.sy lo impleinenl in lu ¡i.syslL'ni beciinse of ils single vol lüge i e t | i i nen ien i plus ; i l lo i i lpul .signuls ;ire l'illly ilecudcd ;ind linied lo uonl io l.s l ; ind; i rd-nieniory ui p e r i p l i e n i l c n o n i l s . l i le c i r c u i i isimplenieiued u.sing un N-chumiel. ion iinplnniüd.sil icon guieMUS pri)L-e.s.s.

l ; ig i ; re I. is ;i bloek dnigu in i oí l l i e CI 'U, l- ' igme J del ;nl .sthc in ie rn i i i regisier conr igu ia l ion which eon la in s JOS b i l soí' R e u d / W r i l e meniory i h a l a ie aeeessible lu Ihe p i o g i a m -mer.The regisiers i nc lude i w u .seis i i l ' . s i x g e n e i a l pnipn.seregislers i b a l inay be nsed i n d i v i i l i i ü l l y ¡ i . sK-b i i u'g^leis oía,s 10-bil registe i jJair.s.Tbeie ;ne also lwo .sel.s . i l ' ; n n i i n i i -l u l o r and l'lag legisler.s. The p i o g i a i n i n e i l i a s ;n.\ ^ lo e i i l i e isel oí' nuun ur al lánale legisléis l luoiígl i a gioup oí 'ex-change i n s l r u c l i n n s . Tlii.s a l l e r n a l e sel allow.s roregroimd/backgronnd innde ol 'npeíai ion or inay be leserved Inr veiyl a s L ' l n i ü r r u p t response. The CI J U also e n n l a i n s a l ü - b i lsiaek puinier which permils .simple impleinenialion of

n u d l i p l e level i n i e r r u p l s , i m l i n i i i e d s n h r o u l i n ei o r m a i i y l y p i í f » n ú l i i i u band ín^ .

I bf I W u Id b l l l i uk \s . i l luw N i l M l l . U d . i l . i i i i . i i i i p i il a l m i i ;md easy i m p U - t i i c n t a l i n n oí ie]oc:i l ; ible i-uiU-. I lu-Ke l t e sb legis lcr provides loi a i i l o n i a l Í L ' , I n l a l l y i r í i i i sp a u -mle l ie . sh ni c - v l e i n a l i lynainu ' memoiies. 'I be I iegisk-1 is uvil¡n a powei l 'n l i n l o m i p l ii-spunso moile In lo rm l l u - nppeí sl u i s ni .i p u i n l i ' i lu a i n l e i n i p l seiviee a t ld i e s s l . i b l í - . \.Ihe n t U ' i i i i p i i n g device snpiibes l l i e Inv/ei ¡S h i l s ni l ia-p n i n l e í . A ca l i is iben m;ide In i h i s service adilress.

.Snií'Ji- f l up . N-c l i a inu ' l Silicnu ( i a l i 1 l 'l 'H.I i.S i i i s l i n e l i n n s iiiehak's a l l /N oí l l i e HUISUAIions w i l b I n i a l s n l l w a r e c o m p a l i b i l i l y . New ms l i i k 'l i n i i s i i t i ' l n d i ' - I . .S and I d bu n p e í a l i n l i s w i l h innn'U M ' l n l ad i lu ' sMii^ nmdfs Mich as nu lexed , b i l and u - l a l i]7 ink'inal K'gisU'rs.Tinco tundes oí' l a s l m l c i n i p l respoiise plus a nnn-maskable n i l e i r i i p l .D i i c c l l y n i i c i l a c i ' s s l a n d a r d speed si a I ¡o nr d y na mu'memniii's wilh vnlually no i-Mema! logic.

I .d /Js i n s l i i i L M i n n e x e L - i i l i n n speed.Single 5 Vl ) t ' Mipply and single-pba.se 5 voli C'loek.Oni-poiTorins any n l b e i single ch ip n i i c r o c n m p n i e r in- I - , iS-, oí Ki-hit applicalion.s.A l l pnts T I L C ' o m p a l i b l eBui l i - in dymimie RAM refresh circuilry.

Z80-CPU BLOCK DIAGRAM

i ih ini /uuii ' i un.:,

280-CPU REGISTERS

Z80-CPU Pin Description

Z80-CPU PIN CONFIGURATION

(Address Bus)

D 0 ~D 7

(Datu Bus)

M|(MachineCycle one)

MREQ(MemoryRequest)

IORQ( inpu l /Ou tpu tRequesl)

RD(MemoryRead)

\VR •(MemoryWrile)

RFSH(Refresh)

Tri-state o u l p u l , act ive high. A r j - A [ 5c o n s l i t u t e a 16-b¡l address bus. Theaddress bus provides Ihe address' Ibrmemory (up lo 64K bytcs) dataexchangcs and Ibr I/O device da ta exchanges.

Tri-stalc ¡ n p t i l / o u l p u l , aclive high.DQ- Dy c o n s t í l u i e un 8-bit b id i r ec t iona !data bus. The dala bus ¡s used Ibr dalaexchangos v v i l h ine tnury and 1/0 doviees.

O u l p u l , ac t ive low. M | ind íca l e s ( h u í thecurrenl machine cycle ¡s Iho UP codefetch cycle ol 'an ins l rucl ion execul ion .

Tri-slate o u l p u l , active low. Tin.' memoryrequesl signal indíca les t h u l Ihe addressbus holds a valid addross for a memoryread or memory w r í l e operu l ion .

Tri-slale o u l p u l , ac l ive low.The I OROsignal indicales t ha l Ihe lower ha l l " ol ' lheaddress bus holds a val id 1/0 address Ibra I/O read or wri le operal ion. An IORQsignal is'also gencraled when an i n l c r r u p í¡s being acknowledged lo indícate t ha l aninterrupl response vector can be placedon the da ta bus.

Tri-stale o u l p u t , active low. RD indicalest h u l the CPU wanls lo read data fronimemory or un I/O device. The addressedI/O device or memory should use íhissignal ío gaíe dala onlo the CPU dala bus.

Tri-stale o u l p u l , aclive low. WR ind ica lestha l the CPU da la bus holds val id dala lobe siored in Ihe addressed memory or 1/0device.

Ou lpu l , ac l ive low. K F S I I indicales I h a íthe lower 7 bits of Ihe address bus con-tain a refresh address for dynamícmemories and the curren! MRIiQ signalshould be used lo do a refresh read lo alldynamic memories.

11ALT( H a l l s l a l e )

WAIT(Wai l )

I NT• ( I n l u i i u p iRequesl)

N M I(NonMa.skablel i i l e r t u p t )

RliSliT

BUSRQ(BusRequesl)

UUSAK(BusAcknowledge)

Oulpul , aclive low. HALT incliciiic.s i ha lIhe CPU luis execuled a I I A I . T .sol'lwan1

i i i . s l i n c l i o n and is a w a i l m g c i l h i M n I H H Iiiia.skahk' oí a ma.skahlt1 n i ln i i i | i l tw i i l ithe ina.sk enahk 'd) bufore o p o u i l i i u i f¡mresume. W h i l o ha l led , Ihe CPU execulesNOP's lo muin lu in memory ref'reshacl iv i ly .

Inp t i t , aclive low. WAIT indícales tu liieZ-80 CPU Iha l the addressed memory urI/O devices are nol ready Ibr a da l at ransfer . The CPU con t inues lo cnU'i w:uls l a l e s l o i as long as t h i s signal is a c t i v e .

I n p u l , aclive low. The I n l e r r u p l RequeMsignal i s g e n e r a t e d by I/O devices. Arequesl w i l l be honored al the end o l ' l h ecur ren l ins l rucl ion if Ihe i n t e r n a l soft-ware con t ro l l ed i n l e r r u p l enable l 'lip-llop( I F F ) i s e n a b l e d a n d i f Ihe BUSRQ signal¡s nol aclive.

I n p u l , ac l ive low. The non-maskablei n l e r r u p l requesl Une has a h íghe i -p r í o r i t y( h a n I NT and is always recogni/.L'd al 1 1 u-end of Ihe cu r r en l i i i s l r u c l i o n , imlepcn-denl of Ihe s l a l u s of Ihe i n l e r r u p l enableIlip-llop. NMI automal icaJIy Ibrces (heZ-8Ü CPU lo reslarl lo location í)t)(»6| |.

I n p u t , active low. RliSliT ini i ia l ix .es IheCPU as íbllows: reset inlerrupl enableIlip-llop, clear PC and registcrs I and Rand sel ¡n te r rup t lo 8080A mode. Duringresel time, Ihe address and dala bus go loa high impedance slate and all con t ro lou lpu l signáis go lo the inac l ive s t a l e .

I n p u t , active low. The bus requesl signalis used lo rcquest the CPU address bus,da ta bus and t r i - s ta le o u l p u l conl ro lsignáis lo go lo a high impedance s la le soI h a l o lhe r devices can c o n l i n l (hese

O u l p u l , ac l ive low. Bus acknowkdge isused to indícale lo (he requesling devicet h a l the CPU address bus, da l a bus andtrí-slale conlrol bus signáis have becn setlo I h e í r high impedance s la le and Iheexterna! device can now cont ro l the.se sfgna

TimingWaveforms

The program cot inlcr con i en i (PC) is placed on Iheaddress bus i m m e d i a l e l y al Ihe .slarl of (he cycie. One luí 11'clock l ime l a l e r MRlíQ gocs ae l ive . The f a l l i n g e d g e oí*MRHQ canJjtMised direolly as a chip enable lo dymimicmcmor¡e.s. RO when aclive ¡ndicales t h a l Ihe memoryda l a . shon ld be e n a b l e d o t i lo i h c í T U d i t l a bus. The CPUsamples da la w i l h Ihe r i s ing edge of íhc clock s ta le 'l'3.Clock stales 73 and 1*4 of a felch cycie are u.sed lo reí'reshdynumic memuries while (he CPU i.s i n l e r n a l l y decodingand execuling Ihe inslrticliun. The refresh control signalRRSH indícales iha l a refresh rcad o f a l l dynamic memoriesshould be aceomplished.

II I HÍFKÍSI I *D»M

l l l u s l r a l e d here i .s I h e l in . i ing o r m e m n r y read or wr i l eeyclcs_olher i b a n an 01* code íeieh (M ¡ cycie). The M R K Qand RD signáis are uscd exaelly a.s in I h e l'oich cycie. I n

• l l i e cuse oí':! memory w r i l e eyele, I h e M R K Q al.sn heconie.sact ive when Ihe address bus i.s s table so I h a l i l can be useddireclly a.s a chip enable I'or dynamic memories. The \VRl i n e is ac t ive when da la on Ihe d a l a bus is . s lnble .so I h a l ¡ican be u.srd diu 'dly a.s'it K/W pnlsi1 h i v i r l u i i l l y any lypi1 oí'semiconduclor memory.

INPUT OR OUTPUT CYCLES

l l lus l ra led here is the t i m i n g I'or an I/O read or I/O wrileopera l ion . Nol ice Ihal d m i n g 1/0 o p e r a l i n n s . a C i n g l e wai lslute ís aulomalically inserled (Tw*J.The reason lor lilis isdur ing 1/0 operal ions ihis ex t ra .slale a l lows suf i lc ienl l imefor an I/O port lo decode i t s address and a c t í v a l e the WMTline ¡f a wail is r equ i red .

C

INTERRUPT REQUEST/ACKNOWLEDGE CYCLE

The i n t e r r u p L signal is sampled by Ihe CPU wilh Iherising edge oí" Ihe Insl clock ul the end oí'any inslruction.Wlien an i n t e r r u p t is accepted, a speciai M | cycie ¡sgeneraled. Dur ing Ibis M ] cycie, the IORQ signul becomesacíive (ínsíead o l 'MREQ) to indicaie t ha l Ihe i n l e r r u p t i n gdevice can place an ü-bil vector on tlie data bus. Two wuits ta les (Tw*) are a u t o m a t i c a l l y udded lo ih i s cycie .so Iha l ar ipple p r i o r i l y i n i e r r u p l scheme, .such as I h e une used in Míe280 per iphera l conl rü l le rs , can be easÜy imp lemen led .

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Ltnd cu un 11 l'ur Üulpul

8085A

SINGLE CHIP 8-BIT N-CHANNEL MICROPROCESSOR

• Single +5V Power Supply

• 100% Software Compatible with 8080A

• 1.3 /Js Instruction Cycle

• On-Chip Clock Generator (with External

Crystal or RC Network)

• On-Chip System Controller; Advanced

Cycle Status Information Avaílabie

(or Large System Control

• Four Vectored Interrupts (One is non-

Maskable)

• Serial In/Serial Out Port

» Decimal, Binary and Double Precisión

Arithmetic

• Direct Addressing Capability lo 64K

Bytes of Memory

The Intel - 8085A is a new generation. complete 8 bit parallel central processmg unil (CPU). Its instruction sel is 100%software compatible witn the 8080A microprocessor, and it is aestgned lo improve the presenl 8080*s performance bynigher syslem speetí. Its high level of system integralion allows a mínimum syslem oí three IC's: 8085A (CPU), 8156(RAM and 8355/B755A iROM/PROM-.

The 8085A incorporales all of the íeatures that the 8224 (clock generator) and 8228 (system controller) provided (or the8080, thereby oflering a high level oí system integralion.

The 8085A uses a multiplexed Data Bus. The adaressissplit betweentheS bitaddress bus and the 8 bit data bus. The on-chip address latches of 8155/8156/8355/8755A memory producís allows a direct inierface with 8085A.

8085A CPU FUNCTIONAL

BLOCK D1AGRAM

SUPPLY 1 —GND

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INTR ' RS? 5 5 "SUS | SID SOD

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8085A

8085A FUNCTIONAL PIN DEFINITION

The following describes Ihe function of each pin:

A8-Ai5 (Oulput 3-SlnU)Address Bus; The most signiiicunt B-blls of the memoryaddress or the B-blts of the I/O address, 3-stated duringHold.and Hall modes.

AD0.7 (Input/Outpul 3-itale)

Mulliplexed Address/Data Bus; Lower B-bits of the•memory uddross (or I/O addross) appear on the busduring Ihe first clock cyclo of a machine' stale. It thenbecomes Ihe dala bus durlng the second and third clockcycles.

3-stated during Hold and Hall modes.

ALE (Output}

Addruss Lalch Enablo: It occurs during Ihe llral clock cycle ofa machine slate and enables (he address to gel latched intothe on-chip lalch oí peripherais. The f alllng edge. of ALE is setto guaranlee setup and hold times for the address informalion.ALE can also be used lo strobe the status Information. ALEIs never 3-slaled.

So, Si ((

Dala Bus Slalus. Encoded status of Ihe bus cycle:

0 HALT1 WRITE0 READ1 FETCH

ST can be used as an advanced R/W status.

RD (Output 3-iltl«)

READ; indícales thu soledad memory or I/O davlce Is lo beread and thal the Dala Bus is avallable (or Ihe dala Iransler.3-stated during Hold and Hall.

wW (Output 3-iUI»)

WRITE; Indícales the data on Ihe Data Bus i,s i" be writtenInto Ihe selected memory or I/O locatlon, Dalu is sel up althe traíllng edge oí WR. 3-stated during Hold and Haitmodes.

READY (Inpul)

If Ready is high during a read or wrlte cycle, it Indícalesthat the memory or peripheral is ready to sentí or receivedala. I fReadyisIow, (he CPU wíllwait for Ready togo highbefore completlng Ihe read or write cycle.

HOLD (Input)

HOLD; Indícales Ihal anolherMasterlsrequestlng the useof the Address and Data Buses. The CPU, upon receivingthe Hold request, will relinquisn Ihe use of buses as soonas the completíon of Ihe curren! machine cycle. Internalprocessing can corjtinue. The processor can regain thebuses only atler the Hold is removed. When the Hold isacknowledged, the Address, Dala, RD, WR, and IO/M Unesare 3-staled,

HLDA (Output)

HOLD ACKNOWLEDGE; indícales that the CPU hasrecelved the Hold request and that ¡t will relinquish the

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RESETOUT C

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3 vcc3 HOLD

3 HLDA3 CLKIOUT)3 íTÉsTTTÑn READY

3 IO/M

3 s,3 R°3 WR3 ALE

3 s0

3 AIB3 AH

3 A]3

3 Au

3 A10

3. AB

3 A,

Flgur* 1. 8085A PINOUT DlAGRAM

buses in Ihe nexl clock cycie. HLDA goes low alter theHold request is removed. The CPU lakes the buses onehalí clock cycle after HLDA goes low.

INTR (Input)

INTERRUPT REQUEST; Is usod as a gonural purposuInlerrupl. II is sampled only during the next to tho lastclock cycle oí the instruction. If it is active, the ProgramCounler IPC) will be inhibiled (rom incremenling and anINTA will be issued. During this cycle a RESTART orCALL instruclion can be inserted to jump lo the inlerruptservice rouline. The INTR Is enabled and disabied bysoftware. It is disabied by Reset and immediately alter anInterrupt is accepted.

INTA (Oulpul )

INTERRUPT ACKNOWLEDGE; Is used Inslead of (andhas the same timing as) RD during the Instruction cycleafter an INTR is accepled. II can be used to actívate Ihe8259 Inlerrupt chip or some other ¡nlerrupl port.

RST 5.5RST6.5RST 7.5

- (Inpuls)

RESTART INTERRUPTS; These three Inputs have thesame timing as INTR excepl ihey cause an internalRESTART to be automalically inserted.

RST 7.5 -»- Highest PriorityRST 6.5RST 5.5 ->• Lowesl Priorily

The priorily of theseinterruptslsorderedasshownabove,These interrupts have a higher prlority than the INTR,

8085A

THAP (Input)

Trap Inlerrupl ¡s a nonmaskable restar! interrupt. It isrecogrmed al Ihe same time as INTfl. II ¡s unaflecled byany mask or Inlerrupt Hnable. II has Ihe highest priority ofany inlerrupt.

RESET IN (Inpul)

Rusel seis Ihe Program Counler lo zero and resels IheInterrupl Enable and HLDA (lip-ílops. None of the oíher(lags or regislers (except the inslruclion register) areallüded. The CPU is held ¡n the resé! condition as long asResel ís applied.

HESET OUT (Oulpul)

Indícales CPU is being reset Can be used as a syslemRESET. The slgnal is synchronued to the processor dock.

X , , X 2 (Input)Cryslsl or R/C natwork connecilons to sel the Inlernalclock generalor. Xi can also be an exiernal clock inputInstead oí a cryslal. The input frequency Is divíded by 2 loglve Ihe Internal operallng (requency.

CLK (Oulpul)Clock Oulput íor use as a system clock when a cryslal orR/C neiwork is used as an input to the CPU. The perlod oíCLK Is twice the Xi. X2 input period.

IO/M (Oulput)

IO/M Indícales whelher the Read/Wríte ¡s lo memory or1/0. Tri-slated during Hold^and Hall modes.

SID (Input)

Serial inpul data lino. The dala on íhis line is loaded inloaccumulalorbit 7 whenever a RIM inslruclion isexecuted.

SOO (oulput)

Serial outpul data line, The oulput SOD is sel or resel asspecilied by the S1M fnslructlon.

Vcc*5 volt supply.

Ground Relerence.

FUNCTIONAL DESCRIPTIONThe B085A Is a complete 8-bil parallel central processor. ItIs designad wilhN-channel depletionloadsandrequjresasingle t-5 volt supply. lis basíc clock speed is 3 MHz IhusImprovlng on the presenl 8080's performance with highersyslem speed. Also II is designad lo lit inlo a mínimumsyslom oí three IC's: The CPU. a RAM/IO, and a ROM orPROM/IO chip.

The 8085A uses a mulliplexed Data Bus. The address Issplit belween Ihs higher 8-bit Address Bus and the lower8-bil Address/Data Bus. Durlng the flrst cycle the addressla ssnt oul. The lower 8-blia are latched inlo Iheperlphorala by iho Adtíresa Laich Enable (ALE). DurlngIhe rest oí the machine cycle Ihe Data Bus la used íormemory or I/O data.

The 8085A provides RD, Wfi, and 10/Memory signáis íorbus control. An Inlerrupl Acknowledge signal (INTA) isalso provided. Hold, Ready, and all Interrupts aresynchronízed. The 8085A also provides serial input dala(SID) and serial output data (SOD) Unes íor simple serialInleríace.

In addition to these íeatures, the 8085A has threemaskable, restar! Interrupts and one nonmaskable trap¡nterrupt.

8085A vs. 8080A

The 8085A Includes Ihe (ollowing íeatures on-chip inaddilion to all oí the 8080A funcllons.

a. Inlürnal clock generatorb. Clock oulputc. Fully synchronlzsdRjadyd. Schmitt action on RESET INe. RESET OUT pinI. R~D. WR, and IO/M Bus Conlrol Signáisg. Encotiud Slalus inlormalionh. Mulliplüxed Address and Dalai. Direct Restarts and nonmaskable Interruplj. Serial Input/Outpul línes.

The inlernai clock generalor requires an exlernal cryslalor R-C network, It will oscillate át iwice the basic CPUoperalmg írequency, A 50% duty cycle, two phase,nonoverlapping clock is generated (rom this oscillalorInlernally and one phase oí the clock (<¿2)lsavailableasanexternal clock. The 8085A dlrectly provídes the externa!ROY synchronizalíon pravlously provided by the 8224.Tho RESET IN input is providutí wilh a Schrnitl aclioninpul so thal power-on resel only requires a resíslor andcapacitor. RESET OUT is provided for System RESET.

Tho 8085A próvidos RD, WR and IO/M signáis íor Buscontrol. An INTA whlch was previously provided by Ihe8228 in 8080 syslem Is also Included In 8085A.

STATUS INFORMATIONStatus informalion is directly available írom the 8085A.ALE serves as a status slobe. The status is partíallyencoded, and provides the userwith advanced tlmlng o)the type oí bus transíer being done. IO/M cycle statussignal is provfdad dlroctly also. Decoded Su, S ,carrles thelollowlng stalus inlormallon:

HALT

WRITE

READ

FETCH

SiO

O

11

So

oIo1

Si can be ¡nlerpreted as R/w in all bus transfers.

In Ihe 8085A the 8 LSB of address are multiplexed withthedala msüiíid oí slnlus. Tho ALE Imu ¡s usucí ¡is ¡i atiuht» lounlur lltu lowui Imll oí tho addross inlo Iho niüinory oípenphural address laich. This also (roes extra pins íorexpanded inlerrupl capability.

&¡K-:M£Üi;KíW:'-

6085A

INTERRUPT AND SERIAL I/OThs 8085A has 5 interrupt Inputs: INTR, RST 5.5, RST6.5,RST 7.5. and TRAP. INTR is identical in lunclion lo Ihe8080 INT. Each oí ihree RESTART inputs, 5.5.6.5,7.5, hasa programmable mask. TRAP is also a RESTART interruplexcept it is non-maskable,

The ihree RESTART inlerrupls cause the internalexecution oí RST {savmg Ihe program counter in (hesitick und branching lo the RESTART addross) ií Ihemlerrupls are emiblud und il tliQ inlerrupt inask is nol sel,The nonmaskable TRAP causes íhe inlernal execution ofa RST independent oí the slate oí Ihe ¡nlerrupt enable ormasks.

RESTART Address (Hex)

TRAP 'RST 5.5 'RST 6.5RST 7.5 i

242C343C

1616

There are two dillerenl types oí inpuls in the reslartinterrupts. RST 5.5 and RST 6.5 are high level-sensitivelike INTR íantí INT on Inu 8080) and are recognized withthe same liming as INTR. RST 7.5 is risinq edge-sensilive.

For RST 7.5, only a pulse is required to sal an inlernal flip[|op which generales Ihe internal interrupt requüst. TheRST 7.5 request llip flop remains sel until the request isserviced. Then it is resel automalically. This llip ílop mayalso be reset by using the SIM ¡nstruction or by issuing aRESET IN to the 8085A. The RST7.5 internal llip (lop willbe sel by a pulseontheRST7.5 pineven when the RST 7.5interrupt is masked oul.

The status of Itie three RST intorrupt masks can only beafiected by the SIM instruction and RESET IN.

The inlerrupls are arranged in a fixed priorily thatdetermines which interrupt is lo be recognized if morethan one is pending as fotlows: TRAP - highost priority.RST 7.5, RST 6.5. RST 5.5, INTR - lowosl priorily. Thispriorily schcnie does not tako into accounl ihu pnoi ily oí arouline thal was slarlcd by ahighur priorityinlorrupt. RST5.5 can inlerrupl a RST 7.5 rouline if Ihe inlerrupls were ro-enabled belore Ihe end oí |he RST 7.5 routine.

The TRAP inlerrupt is usoful lor cainstrophic orrors such ¡ispower lailure or bus error. The TRAP inpul is recognizodjusl as any other inlerrupl bul has Ihe highest priorily. It isnol affected by any flag or mask. The TRAP inpul is bothedge and level sensitive.The TRAP input must go high and

- J : FIGURE 2. 8085A BASIC SYSTEM TIMING.

3-4

8085A

remaín hlgh lo be acknowledgod, bul will not berucognlzad agaln unlil it goes low, then hlgh agam. Thlsivoldi any lalie iriggorfna due lo nolie or loglc glltchea.Tria lollowlng dlagram (Ilústrales (ha jf iAP Interrupl

t clrcullry wlthln the 8085A.

lNItlIHUfTHLQUEi'T

INTEHNAL. THAP

Note ihat the servicing o) any Interrupt (TRAP, RST7.5,RST 6,5, HST 5.5, 1NTR) disables a|| luture interruptslexcept TRAPs) untll an El ¡nslruction is executed.

The TRAP Interrupt ¡s special in thaí it preserves theprevfous Interrupt enable status. Perlorming the firsl RIMInstrucllon íollowing a TRAP Inlerrupl allows you lodetermine whether interrupts were enabied or disabledprior to Ihe TRAP. All subsequent RIM instruclionsprovlde curren! Inlarrupt enable status. (See RIM p. 3-26).

Tha serial I/O systern ¡s also conlrolled by (he RIM andSIM instructions. SID is read by R]M, and SIM sets IheSOD dala. (See p. 3-26).

BASIC SYSTEM TIMING

Tha 8085A has a multiplexed Dala Bus. ALE ¡s used as aslrobe lo sample the lower 8-bils oí address on the DataBus. Figure 2 shows an instruction fetch, memory readand I/O wrlte cycle (OUT). Note thal during the I/O wrlteand read cycle that the 1/0 port address is copied on bolhthe upper and lower ha|( of (he address.

Aa In Ihe 8080, Ihe READY Une la used to extend Ihe readand wrlte pulse lengths so that the S085A can be used with•low memory. Hold causes the CPU to relinguish the buswhen II is through witlrlt by HoatJng the Address and DataBuses,

SYSTEMINTERFACE

8085A family includes memory components, which aredirectly compatible to the 8085A CPU. For example, asystém consistlng oí the three chips, 8085A, 8156, and8355 will have Ihe (ollowing (eatures:• 2K Byies ñOM• 256 Bytes RAM• l Timer/Counter

• 4 8-bil I/O Porls• 1 (3-bil I/O Purt• 4 Inlumipl Luvuls• Surlul In/üurlul Oul Porls

Thls mínimum systom, uuing tho standurd I/O tuchniquu Isas shown in Figure 3.

In addition lo slandard I/O, Ihu muinory mappud I/O oliursanellicienl l/Oaddressingluchnique. WithlhisluchniquL1.an ama oí memory address space is assigned lor I/Oaddress, Ihereby, using the memory adtíress [or I/Omanipularon. Figure 4 shows the systém conliguration ofMemory Mapped I/O using 80B5A.

The 8085A CPU can also intertace with the standardmomury Ihul does nal have the mullipluxed Eiddrüss/d.'ilabus. U will require a simple 8212 [8-bil latch) as shown inFigure 5.

THAP ' ' HOLD

HST7.S HLDA

HSTG-S BOflGA ^HS'IB.b SU)

INfH S,

IMTA ñDDtí/ OUT S"AUDH DATA Al E RD Wfi 10/M ROY CLK

7Y

V" v>

WHKW1

ño tiUldtJ

ALL K)HJ.

PATA/ C

ADDH

IN'O/O TIMtR

HCSET OUT

HO

ALE

ce

HESET B

HOY

CLK ÍOR

FIGURE 3. Q085A MÍNIMUM SYSTEM (STANDARD

I/O TECHNIQUE)

3-5

80B5A

MÍNIMUM SYSTEM CONFIOURATION

-

TIMtH .UU1

\

»1bOM, 1/0, COUNIER/TIMEH]

IJOD[IIÜM I |/ü¡OH

B7MÍAIPHOM t 1/01

FIGURE 4. MCS-8S'- MÍNIMUM SYSTEM (MEMORY MAPPED I/O)

TRAC *> *' A f í E T I WRST7.6 HLOA

HIT ».B SOD

H»Tt>.B »°«6A (ID

NTH 6,1UT1 RESET E'"'* • ADUH/ OUT B»ADOR GATA ALE RD Wñ O/M HDV CLK

¿:

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K

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A

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K

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lo/fl (es)

Wñ

ño

DATA

STANDARDMEMÜHY

ADOR (CS|

CLK

HEStT

10/M [CS|

W'fi

tfo

DATA

STANDARDJ/O

AODH

u

/ A\C

FIGURE 5. MC8-8S" SYSTEM (U8INQ STANDARD MEMOHIES)

8085A

á

DfllVING THE Xi AND Xa INPUTS

The uaer may drive the Xi and Xa inpuls oí the 8085A with acrystal, an exlernal clock source or an RC network asshown below. The driving frequency must be twice thedeslred internal operatíng (requency Ithe 8085A wouldrequlre a 6MHz cryslal (or 3MHz internal operation).

20pl 1I

PAHAULELHESONANTCRYSTAL |30pl LOADING)

ri

1-6 MHzINPUT FREQUENCY

Tha 20pF capacilors are requlred lo guarantee osclllalional ihe proper [requency during syslem startup.

20p[

INHUTFHLQUnNCY

RC Mode causes a [arge drill In clock froijtioncy becauseoí Ihe varlallon In on-chip timlng geneíaii »n paramelers.Use oí RC Mode should be limitad to an appllcatlon, whlchcan lolerate a wlde frequency varlatíon.

+5V

470Í2,TO

1KÍ2

25 TO 50%DUTY CYCLEAT 6 MHi

1-GMHzINPUTFREQUENCY

•X2 LEFT FLOATING.

+5V

•U MU/INPUI FULÜULNCY

NOTE:Duty cycle relers to the percenlage oí the clock ¡nputcycle when Xi ¡s high.

FIGURE 6. DRIVING THE CLOCK INPUTS (Xi AND X2) OF 808SA

OENERATINQ B085A WAIT STATE

Thefollowlngclrcult may be usad lo inserí one WAIT stateIn each 8085A machine cycle.

The D IIIp flopa should be chosen such Ihat• CLK la rislrjg edge trlggered• CLEAR is low-level acllve.

CLEARCLK

"U"F/F

BOB5A

CLK OUTPUT — -

Q

CLK

"D"F/F 0

10BÜB&AHLADYINI-UT

FIGURE 7. OENERATION OF A WAIT STATE FOR 8085A CPU

f^c^l*i&íisvaMf3f*fFfiM*j»**+'«--^ • •• • • •• - " • siífV^ •• ..£*." ¡ . • - • í-

íj*fe-;je.-lií*flC''*.-<."ft/íírf"JÍ-1"11"''' " : "'- "* • * •

8085A

ABSOLUTE MÁXIMUM RATINGS'

Arnbiuní Tomporuium Undur Bins 0UC lo 7Q°CStor¡u)ii TumparimiiL1 -65"C [o-U5ü"CVoliugti on Any Pin

Wilh Rüspiict lo Groiind -0.3 to +7VPOWLT Dissipau'on 1.5 Watt

'COMMENT: Stresses above those listad under "AbsoluteMáximum ñatings" may cause permanent damage to, tí tedevice. Tlu's is a stress ract'ng only anü functfona) opura--^tion of (ha cltivicü at thesu or uny otliür conditíons ubovo * f Ithostí indica türl in the optirational sttctiom of this specifi- •catión is not impited. Exposure to abso/ute máximumratifjg contlitions for extended periocls muy affuct tíevicerL'liíibility.

D.C. CHARACTERISTICS(TA = 0?C to 70°C; Vcc » 5V ±5%; Vss - OV; unless otherwíse specífied)

Symbol

VIL

VIH

VOL

VOH

'ce

IILI LO

V,LR

V,HR

VHY

Parametar

Input Low Voltaga

Input High Voltage

Output Low Voltage

Output High Voltaga

Power Supply Currunt

'Input Leakage

Output Laakage

Input Low Luvul, RESET

Input Hiah Luvul, RESET

HysiürtJsís, RESET

Min.

-0.5

2.0

2 A

-0.5

2.1

0.25

Max.

+0.8

Vcci0.5

0,45

170

±10

±10

+0.8

Vcc+0.6

Units

V

V

V

V

mA

pA .

pA

V

V

V

Test Conditíoni

IOL « 2mA

IOH - -AOOuA

V,n = Vcc

0.45V<VO U [<VC C

Bus Timíny Specífication as a TCYC Deptíndent

'AL

'LA

1LL

!LCK

1LC

tAD

"HD1RAE ~

tCA

'DW ™tWD

'ce ~

1CL

'ARY'HACK ~'HABF ~'HABE "

1AC

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t2

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(1 /2JT-50

(1/2) T- 60(1/2) T- 20(1/2)T-60(1/2) T- 30(5/2 + N1T-225

(3/2 + N ÍT-180(1/2ÍT-10(1 /2JT -40

(3/2 + NJT-60

(1 /2JT -60{3/2 + N) T - 80[1 /2JT- 110

(3/2) T- 260

(1/2JT-50

(1/2)T + 50

(1/2) T + 50

(2/2) T - 50

(1/2) T- 80

(1/2) T- 40(3/2) T- 80

MIN

MIN

MIN

MIN

MIN

MAX

MAX

MIN

MIN

MIN

MIN

MIN

MIN

MAX

MIN

MAX

MAX

MIN

MIN

MIN

MIN

NOTE: N is equa] to the tota] WAIT siaius.

T- ICYC-

8085A

A.C. CHARACTERISTICS (TA - 0°Cto 7Q°C; Vcc = 5V±5%;VSS - ov)

Symbol

TCYC

ll

h

Vi

'AL

'LA

1LL

1LCK

<LC

'AFR

1AD

1RD

1HDH

1RAE

1CA

IDW

lwo

lcc

1CL

!AHY

1RYS

1RYH '

1HACK

'HABF

'HABE

ILDR

IR,V

< A C

1HDS

1HDH

MNS

1INH

P«ram«tar

CLK Cycle Period

CLK LowTime

CLK High Tima

CLK Riwand Fall Time

Address Valid Before Trailing Edge of ALE

Addrüss Hold Tinw Altar ALE

ALEWidih

ALE LowDurtng CLK High

Trailínfl Edgy of ALE lo Leading Edga oíControl

Addruss Float After Leading Edge ofREAD (INTA)

Valid Address lo Valid Data In

READ íor INTA) to Valid Data

Data Ho|d Timo Aítur READ (INTA)

Trailing Edge of READ to Re-Enablingof Address

Address (A8-A15) Valid After Control

Data Valid to Traiiing Edge of WR ITE

Data Valid After Trailing Edge oí WRITE

Witllh of Control Low (RD, WR, INTA}

Trailing Edge of Control to Leading Edgeo f A L E

READY Valid From Addruü Valid

READY Sutup Timu to Luudmy Edge oi CLK

READY Hold Time

HLDA Valid to Trailing Edge of CLK

Bus Float After HLDA

HLDA to Bus Enable

ALE to Valid Data In

Control Trailing Edge to Leading Edge ofNext Control

Address Valid to Leading Edge of Control

HOLD Setup Time to Trailing Edge of CLK

HOLD Hold Tima

1NTR Setup Time to Falling Edge of CLKAlio RSTandTRAP

INTR Hold Time

Min.

320

80

120

110 '

100

140

100

130

0

150

120

420

100

400

50

110

0

110

400

270

170

0

160

0

Max,

2000

30

0

575

300

220

210

210

460

Uniti

ns

ns

ns

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ns

ns

ns

ns

ns

ns

Tusí Conditionv

Suu notes 1, 2,3, 4, 5

TCYC = 320ns;

CL = l50pF

NOTES: 1. A8-1B AddfiíiSp.ciipply lo 10/M, SOand SI.1. Por •!! ouiput ilrning wh»ri C[_ ¿ iSQpf UM tht lollowina corr«cüon facían:

26p« CL< 150p| ; -.10 nt/p(160pf <CL<3CX)pf ¡ +.30 ni/pf

3, Ouipui Hmlfigi «r* rn*<our*d wlih pur*lv cupociliv» load,4, AJÍ ilminumr» m««iur«d «t output volt«g« VL - .8V, VH - 2.0V, «nd l.BV wlih 20ni rt»5, To nlcuUi» tlmlng >p«clf|c»tloni n olh»r v*lu*i oí TCYC UM l^v t d t > l« in Tablo 2.

f*ll llrn« on Inpuit.

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MC

3670

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n an

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her

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tinué

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tion

in

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e a

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ch t

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in t

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ur o

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irs a

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for

sim

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Z,

V.

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e ope-a

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d B

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w.

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e of

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u 10

det

erm

ine

if th

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evio

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ause

d a

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y to

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ur.

BC

C a

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CS

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íul

for

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rel

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agni

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acc

umul

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sam

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t.

valu

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the

ope

rand

C

onve

rsel

y, B

CS

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se a

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ncr

r

ihe

acc

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atof

val

ué is

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et i

nar

tnt

oper

and.

The

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com

plem

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nch

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s to

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C a

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is í

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ed f

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g a

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P,

u w

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ause

a b

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h ií

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the

accu

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hig

her

than

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op

eran

d.

Con

ve-s

e.B

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ause

a b

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the

unsi

g-*

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inar

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lué

in ~

e

accu

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ato'

is lo

wer

tha

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ê a

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pera

ndT

he r

emai

ning

tw

o p

airs

are

use

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n t

estin

g re

siH

-j ?

oper

anon

s in

whic

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e v

alúe

s ar

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oa'd

ed a

s si

gned

r-v

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emen

t nu

mbe

rs.

Thi

s di

fíers

fro

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e un

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e*-,

case

in the

fol

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ing

sen

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in u

nsic

-ted,

the

one

niat

ny t

high

er

or

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in s

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d

two

's co

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i, th

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nson

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berw

een

larg

s- o

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here

Ihe

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lúes

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beiw

een -

128

and

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nch

On

Less

Tha

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BLT

) an

d B

ranc

h O

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r&a^

rT

han

Or

Equ

al Z

ero

IBG

El

test

the

sre

ius

bits

for

N*V

*-

and

N*

V =

0,

resp

ectiv

ely.

BLT

wil

a'w

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caus

e a

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an

oper

atio

n in

whi

ch tw

o n

egat

ive

num

bers

v*n

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d. I

n ad

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n, it

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se a

bra

men

fol

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ing

a C

M=

rw

hic

h t

he v

alué

in

The

acc

umul

ato'

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e aic r.

oper

and

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pos

iíive

. B

LT w

ill n

evé-

cau

se a

bra

nch

ío*

t—in

g a

CW

P in

whi

ch th

e a

ccum

ulat

c" v

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pos

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s~:

tne

ope-

and

nega

tive.

B

GE

. m

e cc

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iem

ent

ío B

LT

*ca

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anch

fol

low

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S -

i w

hich

iw

o p

os**

*va

lúes

wer

e ad

ded

or in

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ch t

ne 'e

sj't

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o.T

he la

s: p

air.

Bra

nch O

n L

ess

Tns-

Or

Eou

a' Z

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(s-i

and

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On

Gre

ater

Tha

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'O '

B3

~i

test

the

s;a

:-£ D

"fo

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*(N

'fV

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tion

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LE is

idén

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hat

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als

o oc

cur

if ih

e r

esul

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the

c-e

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s re

sul:

v,as

1?-

Con

vers

ely.

BG

T is

sim

ilar

10 B

GE

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ea: t

hat n

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w.

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"^

PROGRAMA MONITOR DEL ZtíO.

00000002000400070008OOOB00 OCOOODOOOEOOOF001000130014001500160017001800 IB00 1CQUID'001 E00 1 F00200023002400270023002B002C002F00300033003400370038003B003C003F004100420044OO47004A004 B00 4 C004D004E004F00500051O052005300560058005B005E

o£.o¿i

D3FBC33FOOFFC32611FFFFFFFFFFC32911FFFFFFFFFFC32C11FFFFFFFFFFC32F11FFC3AOOSFFC33211FFC33B11FFC33511FFL--J-JE 1 1FFC33B08FFC34111DBFF173EFED25208210O1O773C!¿!c *77AF23772377322210D3FO212510225910AF

RUTINA DE

START

•.]

i

!

RESET

RESZ8

RUTINA DE RESET Y LOCALIDADES DE RESTART

LDOUTJPFFJPFFFFFFFFFFJPFFFFFFFFFFJPFFFFFFFFFFJPFFJPFFJPFFJPFFJPFFJPFFJPFFJPINRLALDJPLDLDINCINCLDXORINCLDINCLDLDOUTLDLDXOR

A,82H(FBH),ARESET

RST8

RST10

RC'T 1 OO I J. O

RST20

TRAP

R3T28

RST5.5

RST30

RST6.5

ROTO O•_• I -_"_J

RST7.5A, (FFH)

A,FEHNCiRSETSSHLi 1OOOH< HL ) , AAHL<HL) ,AAHL(HL) , AHL( HL ) v A( 1022H) , A( FOH ) , AHL, 1025H(1059H),HLA

?ESTA RUTINA DEFINE EL?uP (ZSQ-80Q5A) CON EL3 QUE SE ESTA TRABAJANDO5 Y SALTA AL PROGRAMA DE? RESET RESPECTIVO.,

00 5F006100640065

0066006A006D006E006F00700071007400770079007A007C007E0080008200860089008C008D008E008F0090009400960098009 A009C009FOOAO00 AlOOA2OOA3OOA7OOAAOOAEOOBOOOB3OOB6OOB9OOBCOOBFOOC2OOC5OOC8OOCB00 CEOODiOOD4OOD7OODAOODCOODF00 E 2OOE3

D3F5C31EOSFFFF

PROGRAMA DE S

ED731F10316610F5C505E5314410210010CBC67ED3FDDBFFFEFF2814DD21ADOOCDD400 GETIX1315E10ElDIClFlED7B1F10DDE9DBFE CHKFEFEFF200E315E10ElDIClFlED7B1F10C34411DD21BFOO GETIX218D6C3AA04C30D08C37401C31E04C3B302C33F03C37B01C3A903C3SC02C3F406C31601C3F40321F300 FINDIX010600EDB11 10600EAE500531803

OUTJPFFFF

ELECCIÓN

LDLDPUSHPUSHPUSHPUSHLDLDSETLDOUTINCPJRLDCALLLDPOPPOPPOPPOPLDJPINCPJRLDPOPPOPPOPPOPLDJPLDJRJPJPJPJPJPJPJPJPJPJPJPJPLDLDCPIRLDJPLDJR

(F5H),AOUTDC

DE SUBRUTINA

U01FH),SPSP, 1066HAFBCDEHLSP, 1044HHL, 1000H0, (HL)A, (HL)(FDH),AA, (FFH)FFHZ , CHKFEIX,OOADHFINDIXSP, 105EHHLDEBCAFSP, (101FH)(IX)A, (FEH)FFHNZ,GET.IX2SP, 105EHHLDEBCAFSP, (101FH)EXTNMIIX,OOBFHGETIX1ssESCAPELOAD00REG — >REG < —BRK REMBRK CHKARSMNUBRK INSREG STRHL,OOF3HBC,0006H

DE,0006HPE,SEARCHD,EINDEX

5 ESTE PROGRAMA ENCUENTRA?LA RUTINA QUE SE HA PE-?DIDO Y LO EJECUTA-

OOE5OOE6QOE7OOESOOEAOOEBOOECOOEDOOEEOOFOOOF2OOF3OOF4OOF5OOF6OOF7OOF8

OOF9COFA00 FBOOFDOOFF01010103010401060108010A010C010E01100 1 1 20114

0 1 3. 6011901 IB01 ID0 1 200 1210 1 2201260 1 29012B012E0130-01320 1 340 1 35013601370139013A013C013E

7B91571 EOO1C1C1C1520FADD19C9FEFDFBF7EFDF

AF2FD3FDD3FC06FFOE30OD20FD10F9CB572804CB971802CBD7D3FD1 tí t. 'y

3A0210FEOS28DCCD6B016F62DD21O4103AO310FEOO0100002809CB1F300803030318F73C1S13DD09F5

SEARCH

INDEXJPLOOP

LDSUBLDLDINCINCINCDECJRADDRETFEFDFBF7EFDF

RUTINA DE

ERROR

STRTERDECBDECC

SETBITOLITERR

RUTINA

BRKOUT

STRTBK

STBKID

XORCPLOUTOUTLDLDDECJRDJNZBITJRRESJRSETOUTJR

DE INS

LDCPJRCALLLDLDLDLDCPLDJRRRJRINCINCINCJRINCJRADDPUSH

A, ECDi AE,OOHEEEDN 2, JPLOOPI X 7 DE

ERROR

A

( FDH ) 7 A<FCH),AB,FFHC,30HCN 2, DECCDECB2, AZ, SETBIT2, AOUTERR27 AC FDH ) 7 ASTRTER

ERCION DE :

A 7 C 1002H)OSHZ, ERRORZEROUTL,AH,DIX, 1OO4HA, ( 1003H)OOHBC? OOOOH2. 7 STRTBKANC v STBKIDBCBCBCBRKOUTABRKINSI X , BCAF

5 ESTA RUTINA GENERA UNASINDICACIÓN VISUAL Y5 AUDIBLE SI SE PIDE UN5 PROCESO QUE AL MOMENTO5NO ES PERMITIDO.

BREAKS

ESTA RUTINA INSERTA UN:BREAK EN LA LOCALIDAD:QUE SE INDIQUE DESDE:EL TECLADO.'ANTES SE VERIFICA QUE¡EL NUMERO DE BREAKS YA¡INSERTADOS SEA <&. DE[SER =8 SALTA A LA RUTI-íNA DE ERROR.

0 1 3F0140014101430144014501470149014A014B0140014E014F0 1 50015201540157015A015D015E01610163016401670168

016B016C016E017001720173

0174017601770179

017B017E01 SO0133u i y 6018901SA0 1 8B018D0 1 9001910192019301940196

AFB92006Fl37CB17180BFl37CB17ODODOD20F8CB17320310DD7500DD74017EDD77023EFF7721021034C30D08

AFD3F1D3F4D3F576C9

DBF657DBF7ED45

3A0210FEOOCAF900CD6B01CDABG1F57DFE1CD2F900jilo

7E12FlCBBF57

XORCPJRPOPSCFRLJR

CNTNE POPSETBRK SCF

RLDECDECDECJRRL

BRKINS LDLDLDLDLDLDLDLDINCJP

ACN 2, CNTNEAF

ABRKINSAF

ACCCNZ, SETBRKA( 1003H),A<IX+QQH),L(IX-i-01H),HA, (HL)(IX+02H),AAiFFHQ(HL),AHL, 1002HÍHL)ESCAPE

BUBRUTINA ZEROUT

XOROUTOUTOUTHALTRET

AÍF1H),A< F4H ) , A( F5H ) 7 A

¡ESTA SUBRUTINA COLÜCA¡OOOOH EN LOS INDICADO-RES DE DATOS.

BUBROUTINA LOAD

INLDINRETN

A,(F6H)Di AA,(F7H)

5 ESTA SUBRUTINA LEE DA-5 TOS (16 BITS) DEL TECLA-? DO -

RUTINA DE REMOCIÓN DE BREAKS

LDCPJPCALLCALLPUSHLDCPJPINCLDLDPOPRESLD

A,<1002H)OOHZ,ERRORZEROUTCHKBRKAFA,L1CHNC7 ERRORHLA,(HL)(DE),AAF7,A

ESTA RUTINA REMUEVE UNBREAK DE LA LOCALIDADQUE SE INDIQUE DESDEEL TECLADO„ANTES VERIFICA QUEEXISTA POR LO MENOSUN BREAK INSERTADO.SI EL NUMERO DE BREAKSINSERTADOS ES =0 SALTAA LA RUTINA DE ERROR»

01970 1 99019B019C019D019E019F01A101A2OÍAS01A601A7OÍAS01AB01AC01AF01B201B401B501B601B701B901BA01BB01BD01BF01CO01CÍ01C301C401C601C701 CS01C901CB0 1. CC

01CD01D101D301D401DS01D901DC01 DE01EO01E401E601EA01EB0 1 EC01ED01EE01FO01F201F401F501F601F7

3E04CB022D2D2DBD38F87A210310772B35C30D085F210110SAOS 10CBOF23.¿Ic'!¿!330F9F57DFE1C300C7BBE2803Fl18EC7A.£.•_.'BE20F8FlC9

DD221E10DDE3o •— '33ED731C10315D10DD2BDDESDD2A1C10DDESDD2A1E10F5CSD5ESDDESFDE5ED57F53308D9

ROTD

CHKBRKCHEKBKFINDBKCNTROT

CKADDR

AFPOP

HFADDR

RETRN

LDRLCDECDECDECCPJRLDLDLDDECDECJPLDLDLDRRCINCINCINCJRPUSHLDCPJRLDCPJRPOPJRLDINCCPJRPOPRET

A,04HDLLLLCiROTDA,DHL,1003H(HL),AHL(HL)ESCAPEE, AHL,1001HA, (1003H)AHLHLHLNC,AF

CNTROT

1CHNC,RETRNA, E(HL)2,HFADDRAFCNTROTA,DHL(HL)NZ,AFPOPAF

RUTINA DE EJECUCIÓN DE BREAK

LOEXINCINCLDLDDECPUSHLDPUSHLDPUSHPUSHPUSHPUSHPUSHPUSHLDPUSHINCEXEXX

(101EH),< SP ) T I X

SP("T'Ci•_«r

( lOICH)?SP, 105DHIXIXIX, ( 101CIX

IX

SP

H)

IX, (101EH)AFBCDEHLIXIYA, IAFC'CiO~

AF,AF-'

ESTA RUTINA ALMACENALOS REGISTROS DEL uPY SU STATUS AL MOMEN-TO DEL BREAK Y MUESTRAEN LOS INDICADORES DEDATOS EL CONTENIDO DELPAR DE REGISTROS 3E-LECCIONADOS „

HTO'Soaino

y * ( HSd >(1H) *y

1Hy * ( Hfrd )y* <Hid)(iH> *y03 fc"lH

HOOOO *09AldSiacZN

y *9(HOOOT) cy

03MNJddino

y (HOOOT)sayaNd'ZNHySOT *1H

Hddy *o

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Hdd'yy * ( HSd )

(H6SOT) fcyy L ( Hfrd )y*(HId>

(Hyson 'yy ¿ (HOOOT)

Haacyadino

y c(HSd)(H9SOT) Lyy 4 c Hfrd )y*<HTd)

(H090T ) cyy * CHOOOT )

Haa&yyayoisHaa*y

QNdlONy * ÍHOOOT )

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(HTOOT) cyTaQNId'ZN

HQd(HOOOT ) 'y

1H3a03dy

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nyoaraiarendO13SdPQlaiinoaiinoinoaiaiaiarinoaiinoinoaiaiaiaraiaraiaiarnaarnaarnaarar-doaiar

awyai

HsridHsndHsridHsrid

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Aídsia

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QNdlON

T090S03TEOsdsa3¿%z

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OOCÍOTO¿.QOZ4/.9O

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027C027E027F02SO028 10283028502870289028B

n- 'or-Uj oL-

028F0291029302960299029C029F02 A 102A302A502A702AA02AC02AE02B1

02 B 302B602B802BA02BC02BE02C102C302C502C702CA02CD02CE02CF02D102D202D402D702D802DB02DD02EOQ2E102E302E502ES02EA02EC

CBlr042B2BCB1F38F?3EF"CB17IOF;C9

3A0110F6E1FEFFCAF90021531.0CD73023A0010F6BDCB772807CBB7320010ÍSB'3CBF732001018B3

RUTINA

3A0010CB672830CB6F2833SAO 110CBC7FEFF2843215A10CD7A024F7DFE53790600F42103F53A0010CBF7320010FlCB7F232ACD21031SC7CBE7CBAi-

RRFNDBIT INC

DECDECRRJRLD

SETFC RLDJNZRET

RUTINA DE

LDORCPJPLDCALLLDORBITJRRESLDJR

SETARS SETLD

HFDSPY JR

ABHLHLAC, FNDBITA,FFHASETFC

ARS

A, (1001H)E1HFFH1 , ERRORHL, 105AHFNDREOA, ( 1000H)BDH61 AZ, SETARS6, A(1000H),AFIXHL6, A( 1000H) , ADISPLY

DE CHEQUEO DE REGISTROS Y 1

LDBITJRBITJRLDSETCPJRLDCALLLDLDCPLDLDCALLPUSHLDSETLDPOPBITJRCALLJR

RESTSP SETRES

A, C1000H)4, AZ ^ REtíTüP5, ARESETAA, (1001H)0, AFFHZ,NOREGHL, 105AHFNDREGC»AA,L53HAiCBíOOHPTROTRGTAFA, ( 1000H)67 AC1000H),AAF7, AZiRSETFCROTRGTHFDSPY4, A5, A

;ESTA RUTINA DETECTA3 SI EXISTEN REGISTROS;PRIMOS DE LOS REGIS-?TROS MOSTRADOS EN EL5 INSTANTE DE PEDIRSE3 ESTA RUTINA- EN CASO5 DE NO SER ASI, SALTA5 A LA RUTINA DE IRRQR.

MOVIMIENTO >

?ESTA RUTINA MUESTRA?EL CONTENIDO DEL PAR5 DE REGISTROS SIGUIENTE5 AL QUE INDICAN LOS LEDÍ5 DE STATUS DEL SISTEMA.5 EL DESPLAZAMIENTO DE;ENCENDIDO DE LOS LEDS3 ES HACIA LA DERECHA»

02EE02F102F302F602F902FB02FD0300030203050308030 A030C030F031203140317031903 1C03 1F03210- .•;,.—(••-,•_'.£_ JU

0324032603270329032 A032C032F033103320333033503380339033B033C

3200103EFF320 í. 10215A1018B6F6BD3200103EFD320.1.10215:31018323EEI-3200103A0010CBA'73200103EFF320110215C10189004CB1F33F1337CB1F3F :

CB17215A10CB172B2B10FA3201.102FFE20FOC36002

LDLDLDLDJR

RESETA ORLDLDLDLDJR

NOREG LDLD

RESTPC LDRESLDLDLDLD

THDSPY JRROTRGT INC

RRJRSCFRRCCFRLLD

ROTLFT RLDECDECDJN2LDCPLCPRET

HFDTRS JP

C1000H),AAiFFHU001H>7AHL, 105AHHFDSPYBDHC 1000H) 7 AA,FDHU001H>iAHL, 1058HHFDTRSAiEFH( 1000H) , AA, ( 1000H)4, A<1000H) , AA,FFH(1001H), AHL, 105CHHFDSPYBAC» ROTRGT

A

AHL, 105AHAHLHLROTLFTU001H),A

20HPDETARS

RUTINA DE CHEQUEO DE REGISTROS Y MOVIMIENTO

033F0342034403460348O 34 AO34D034F03510353035503570359035A035C035E035F0361036203640367

3A0010CB672851CB6F.¿í3.-;;.i3A0110CBC7FEFF• iOQ'7

CB4F

06 OLÍ04CB173SF337CB173FCB1F214C10CB1F

RTLEFT

RTRGHT

LDBITJRBITJRLDSETCPJRBITJRLDINCRLJRSCFRLCCFRRLDRR

A, (1000H)4,AZ,RESETI5, AZ,RSTPCA,C1001H)O, AFFHZ,NOREG1» A¿ i Rl~'Tor*'

B, O OHBACiRTLEFT

A

AHL,104CHA

íESTA RUTINA MUESTRA?EL CONTENIDO DEL PAR5 DE REGISTROS ANTERIOR?AL QUE INDICAN LOS LEDS5 DE STATUS DEL SISTEMA.SEL DESPLAZAMIENTO DE?ENCENDIDO DE LOS LEDS5 ES HACIA LA IZQUIERDA.

0369036A036B03600370037103730376037S037A037D037F038 2038503S7038903SC038F03920394f"iOO~7U O y /

0399039C039F03AI03A403A7

03A903ACOSAD03AF03B103B303B503B703BA03BD03BF03C103C303C503C703CA03CB03CF03D203D3030503D703DA03DB03DC03DD03DEOSEO03E203E403E6

23'~?f-\A

3201102FFE20FA60Q218A7F6FD3200103EE-3201102142101 89 5CBEr320010C30r033A0010CBF7C3E302CBE7320010SAO 110CBB-320110214C1QIQD^

RUTINA

21221 07ECB7720 1 ?E60-280 5FEO-?FACAOSSAO 210FEOO2802CBFSD3FOD3F5C31E0834 ,ED43O3101 102003CE60rFE09F2BA0347 ,1Cl'C1CCB 1 930F91 OF726106B

FHDSPYRSTPC

RSTSP

RESETI

DE CHEQUEC

BRKERR

CIMTERR

BKOUT

INCINCDJNZLDCPLCPJPJRORLDLDLDLDJRSETLDJPLDSETJPSETLDLDRESLDLDJR

HLHLRTRGHT<1001H),A

20HM,DETARSTHD3PYFDH<100QH>,AA,EFH<1001H),AHL, 104CHTHDSPY5, A(1000H), ARESTPCA, ( 1000H)6, ARESTSP4, A(1000H), AA, ( 1001H)7,A(1001H), AHL, 104CHFHDSPY

DE NUMERO Y LOCALIZAC

LDLDBITJRANDJRCPJPLDCPJRSETOUTOUTJPINCLDLD

' INCANDCPJPLDT.NCINCINCRRJRDJNZLDLD

HL, 1022HA, CHL)6, ANZ, BKOUTOFHZ, BRKERR09HM, BKOUTA, (1002H)OOHZ,CNTERR6, (HL)(FOH), A(F5H)vAOUTDC(HL)BC, ( 10O3H)DEi0002HAOFH09HP> BRKERRB,AEEECNC, INCEINCEH, 10HL,E

ION DE BREAKS

ESTA RUTINA MUESTRAS5 PRIMERO EL NUMERO DE3BREAKS INSERTADOS ENEL SISTEMA Y EN CASODE HABERLOS, MUESTRAU LOCALIZACIÓN. ESTA

3 FUNCIÓN ES CÍCLICA.

03E7OSESÜ3EB03EC03EE03EF03F2

03F403F703F903FC03FE03FF04000402040404060407040'?040A040B040E04 íí041304150417041 A041B04 1C

041E04210422042304250427042A042C"042E04310432043504370439043C0440044304440445044604470448 .0449044C044E

473A0210Boo2097AF3222101891

RUITNA

3A0110FEFF215C1028 1 02B2BCB1F38FADBF677DBF.72B77C31EOS3A0010CB6728EFCB6FC2F9002B2B18E6

RUTINA

iCD6B015F1A 'FEFF2015212210CB7E28033A531012 '210O1OCBDE1 803CD6F04ED532010314410ElDIClFlD9083A4C10ED4733

LDLDCPJRXORLD.JR

DE CAMBIO DE

LDCPLD•JR

FND8TR DECDECRR.JR

LDREG INLDINDECLDJP

PGMCTR LDBITJR

STKPTR BITJPDECDEC.JR

e, AA, (1002H)BNZ,FHDSPYAí 1022H) , AFHDSPY

CONTENIDO DE REGÍ

A, (1001H)FFHHL, 105CH2 7 PGMCTR'HLHLAC,FND3TRA, <F6H)CHL),AA, (F7H)HL(HLKAOUTDCA, < 1000H)4i AZ 7 LDREG5,ANZ 7 ERRORHLHLLDREG

DE EJECUCIÓN DE PROGRAMA DEL US

CALLLDLDCPJRLDBITJRLDLDLD8ETJR

BRKGO CALLRUN LD

LDPOPPOPPOPPOPEXXEXLDLDINC

ZEROUTE, AA7 (DE)FFHNZ,RUNHL, 1022H7, (HL)Z 7 BRKGOA, (105DH)( DE ) 7 AHL, 10OOH3, (HL)RUNFINDOC(1020H) ,DESP, 1044HHLDEBCAF

AF7AF-'A, ( 104CH).I^A8P

STROS

? ESTA RUTINA CAMBIA EL? CONTEN I DO DEL PAR DE5 REG I STROS I ND I C ADO POR?EL NUEVO DATO COPIADO?EN LOS INDICADORES DE? DATOS.

U ARIO (GO)

SESTA RUTINA EJECUTA EL5 PROGRAMA DEL USUARIO Aü PARTIR DEL LA LOCALIDAD, COPIADA A LOS INDICADO-5 RES DE DATOS-

044F045104530454045504560458045B045E04600463046504670468046C046F047204750476047704780479047B047C047D047F048004S1048204840485048704380489048A04 SC048D048F0490049104920493049404950496049704980499049A049C049D049F04AO04A304A404A504A604A704A8

FDE1DDE1ElniCl ;3EC3321F103A0010F6Qir320010D3FDD3FOFl ;

ED7B5910C3 1 r 1 03A031021021023¿¿o231F30F*iF57DFE IBDO7EBA2803Fl1 y El;-2B7EBB28032318F523 ;j¿.o7E1 2Fl3F172B2B ;2BFS ;SEO 3BD !2008Fl |210310772B35C9Fl18E3

POPPOPPOPPOPPOPLDLDLDORLDOUTOIJTPOPLDJP

FINDOC LDLD

LOCREG INCINCINCRRAJRPLiSHLDCPRETLDCPJR

RSTRRG POPJR

ESAME DECLDCPJRINCJR

OKDE INCINCLDLDPOPCCF

RTRIND RLADECDECDECPUSHLDCPJRPOPLDLDDECDECRET

HRTIND POPJR

IYIXHLDEBCA,C3H<101FH),AA 7 < 1000H)OFH< 1000H) , A( FDH ) , A( FON ) „ AAFSPi (1059H)101FHA, C1003H)HL, 1002HHLHLHL

NC 7 LOCREGAFA,L1BHNCA, <HL)Dz 7 ES AMEAFLOCREGHLA, (HL)EZ,ÜKDEHLRSTRRGHLHLA, (HL)< DE ) , AAF

HLHLHLAFA.03HLNZ, HRTINDAFHL, 1003H( HL ) -> AHL(HL)

AFRTRIND

RUTINA DE PASO A PASO <SS)

04AA04AD04AF04B104B404B604B904BB04BD04CO04C204C404 C604CA04CD04CF04D204D304D704D904DA04DB04DC04DD04E104E204E504E804EB04EE04FO04F204F404F604FS04FB04FD04FF0502050405060507050A050C050E05100512051505160517051905 IB05 ID05 1F052105220526052705280529052B

3A2210CB7FCBFF322210202F3A0010CBC7CB9F320010D3FDCB4F200'?ED535B10CD6F041812CD6Í3015FED535D101804CBDDFDEDED535B101A32531021DC040104003A5::noEDB9282:3CB07380CCB07D29605FED?2007C3E506CB07380403C3CB05F6EOCB1FFE7Ü2824C33~O679 :B7281 DFE 032833FEO 22001OBED5BSB1013031AFECB2809

LDBITSETLDJRLDSETRESLDOUTBITJRLDCALLJR

STRTSS CALLLDLDJRCBDDFD

OPCDTL EDLDPCOC LDSSBTSL LD

LDBITSEL LD

LDLDCPDRJRRLCJRRLCJPCPJRJP

HBTS80 RLCJR

HBIT80 INCJP

MXBTSO ORRRCPJRJP

BYTLTH LDORJRCPJRCPJRDEC

DDFDSB LDINCT.NCLDCPJR

A, (1022H)7, A7, A(1022H),ANZ, BITSELA. C 1000H)0,A3, A<1000H) 7 A( FDH ) , A1,ANZ, STRTSSDE, (105BH)FINDOCSSBTSLZEROUTE, A<105DH),DELDPCOC

(105BH),DEA, (DE)(105DH),AHL»04DCHBCí 0004HA, (105DH)

7. , BYTLTHACíHBTSSOANCiLBITSOD9HNZiHBITSOEXCHLTAC,MXBT80BCRSVRUNEOHA7DHZiBYTFIXLTGP8OA»CAZ,BYTFIX03HZ»EDSUBR02HNZ 7 DDFDSBBC:DE, C10SBH)DEBCA, (DE)CBHZ,BYTFIX

?ESTA RUTINA EJECUTA?EL PROGRAMA DEL USÜA-?RIO PASO A PASO DESDE•LA LOCALIDAD COPIADA?EN LOS INDICADORES DE5 DATOS-

052D052F053105320534053605370538053B053C053E05400542054405460548054B054E054F055205550559055A055B055D055F05610563056405660568056A056D056E05710573057505770579057B057D057F05800582058405860588O589058B058D058F0590059205'? 405960598059A059 C059E05 A 0•O5A205A4

CB07380AOBCB07303303 ,03C3C305OBCB0730F6CBOFCBOFFEE9203A2A5B 1 03A5D10772A4-10C3CF05ED5B5B10131ACB07380ECBOFF6F32FFE0428 9 £FE02CAE305OBC3CB05CEO 73091CB07300BCB073889FEC603 :28B41882F68FFEB-03284:>FEAr30A71AFE2128 A 21 Wc«oCBOrF670FE763806FE7C289418DEFE74

BYTFIX

HBITDF

EDSUBR

HBITED

LBITDF

SLBTDF

EXIT

HBT80HLASTCK

LBIT80

CHK3BT

RLCJRDECRLCJRINCINCJPDECRLCJRRRCRRCCPJRLDLDLDLDJPLDINCLDRLCJRRRCÜRCPLCPJRCPJPDECJPRLCJRRLCJRRLCJRCPINCJRJRÜRCPINCJRCPJRLDCPJRJRRRCÜRCPJRCPJRJRCP

AC, HBITDFBCANC, LBITDFBCBCRSVRUNBCANC, BYTFIXAAE9HNZ,HBIT80HL, U05BH)A, (105DH)< HL ) , AHL, (104FH)RJPRUNDE, (105BH)DEA, <DE)AC, HBITEDAF8H

04HZ,HBIT8Q02HZ, INTRETBCRSVRUNANC,HBIT80ANC, LASTCKAC,HBIT80C6HBCZ, BYTFIXHBIT808FHBFHBCZ v RSVRUNAFHNC, BYTFIXA, (DE)21HZ, BYTFIXRSVRUNA70H76HC,CHK3BT7CZ, BYTFIXHBT80H74H

05A6OSAS05ABOSAD05AE05BO05B205B405B605 B 905BB05BD05BF05C 105C305C505C705C905CB05CE05CFÜ5DO05D305D505DS05DC05DF05E2OSESOSES05E9OSEA05ED05FO05F105F205F305F405F605FA05FC05FF06000602060406060608O6OA060E06100612061406160619061 A06 1C06 1 E062006220625062706 28

200 A3A5:310pero o1 C...¿.,c.

0330861819CBOFCBOF3A5310300ACBOFCBOFCBOFCBOF1SE3FE 1030231SB7CDDF05097E32531036FF225310ED532010C33C042A53102220103A531077

C9CDDF052A59105Ej!'-'56EB ;18D9ED435B1020083A56103D28201823FE 18•~iO i IIT.C.*-' 11

FE30ED53571O3004CB03CB03CB5F2006-CB4328031804CB43200501020018A403OA

BCFIX

CK23BT

NEWINS

THBT80RSVRUN

R.JPRUN

FXOPCD

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RLJPGP

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JRONFG

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FIMDDIS

JRLDCPINCJRJRRRCRRCLDJRRRCRRCRRCRRCJRCPJRJRCALL-ADOLDLDLDLDLDJPLDLDLDLDRETCALLLDLDINCLDEXJRLDJRLDDECJRJRCPJRCPLDJRRLCRLCBITJRBITJRJRBITJRLDJRINCLD

NZ»CK23BTA, (105DH)22HBCNdBYTFIXRSVRUNAAA, ( 105DH)MC, NEWINSAAAABCFIX10HNC, RLJPGPHBTSOHFXOPCDHL,BCA, <HL)(105DH),A(HDiFFH<105BH),HLDE, (1020H)RUNHL, (105BH)í!020H)vHLA, (105DH)(HL),A

FXOPCDHL, (1059H)E, <HL)HLD, (HL)DE,HLRJPRUNBC, ( 105BH)NZ,RELJMPA, (1056H)AZ 7 NOFLAGFNDDIS1SH2-, FNDDIS30HDE, < 1057H)NC, CYFLAGEE3, ANZ, JRONFG0,EZ» FNDDISNOFLAG0,EN Z, FNDDISBC,0002HRSVRUNBCA, (BC)

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FE803303E044D602ED444F06FF1893C6024F0600188CFE7320153A5D10FEC ?28 A 0FEE?C20605CDDF052A5110C3CF05FE71200E3A5D10CD7D06DAEQ050101001803FE7520413A5D10E6F3C07D06384601030018C3ED5B5710FEDO30 1 2CB03CB03CB5rED4B5B103A5D102006CB4337C83FC9CB43373FC818F7FEEO38E4FEFD300 £CBOBCBOB

FWDJMP

HRSVRNLTGP80

CKJPHL

GGAH01

ONELCN

GGAH02

CALLGP

CKFGCN

SGMFLGCRRYRT

RETURN

JPFGST

CYPYSN

CPJRNEGSUBNEGLOLDJRADDLDLDJRCPJRLDCPJRCPJPCALLLDJPCPJRLDCALLJPLOJRCPJRLOANDCALLJRLDJRLDCPJRRLCRLCBITLDLDJRBITSCFRETCCFRETBITSCFCCFRETJRCPJRCPJRRRC:RRC

80HC, FWDJMP

02H

C,ABiFFHRSVRUN02HC,AB OOHRSVRUN73HNZiGQAHDlA, (105DH)C9HZ, INTRETE9HNZ.HBITSOFXGPCDHLi (1051H)RJPRUN71HNZ,GOAHD2A, (105DH)CKFGCNC, INTRETBCi 000 1HHRSVRN75HNZ^GOAHDSA, (105DH)F8HCKFGCNC.CALLJPBC? 0003HHRSVRNDE, (1057H)DOHNC 7 CYPYSNEE3, ABCi (105BH)A, C105DH)NZ, JPFGSTOí E

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ZRETURNEOHC, CRRYRTFOHNC,SGNFLGEE

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06F406F606F806FA06FC06FE06FF07O207050707070 A070D070E070F07100713O716071907 1C07 1F07220725

1SDAFE792SBJ3FE 7 73A5D102016FEC3200)3CDDF05235E2356EBC3CF05FEE3•1' i"\ O•JU .•'<-•

C322Q&CB4F2006FEC3208CÍ3E4E6385F1600CDDF05EB18E12A5B103E7677EB2A2210CBB-EC33C04

3E80D3FB3E11D3FOD3F576212507O 10700EDB1C2F?00211007856FE9C 3E607C35E07C 30 408C3B407C 3F307C3E3FSC317F900

GOAHD3

GOAHD4

CALLJP

HRJPRNDI8CRD

HNOFLGKPGOIN

RSTART

EXCHLT

RUTINA DE S

JMPTBL

JRCPJRCPLD•JRCPJRCALLINCLDINCLDEXJPCPJRJPBITJRCPJRJRANDLDLDCALLEXJRLDLDLDEXLDRESJP

ELECCIÓN

LDOUTLDOUTOUTHALTLDLDCPIRJPLDADDLDJPJPJPJPJPJPJP

CRRYRT79HZiCALLGP77HA 7 ( 105DH)NZ, KPGOINC3HNZ^DISCRDFXOPCDHLE, (HL)HLD, (HL)DE,HLRJPRUNE3HNC,ONELCNNOFLAG1,ANZ, RSTARTCDHNZ,ONELCNCALLJP38HE, AD i OOHFXOPCDDEiHLHRJPRNHL, (105BH)A,76H<HL),ADE,HLHL, (1022H)7, (HL)RUN

DE FUNCIÓN

A»SOH(FBH),AA, 11H( FOH ) , A(F5H),A

HLiG725HBC7O007H

NZ 7 ERRORHL, JMPTBLA,LL,A<HL)RWMEMPGM680PGM581LD680LD581OFFSET

( MNU)

3 ESTA RUTINA SELECCIONA5 Y EJECUTA UNA FUNCIÓN;ESPECIAL BAJO COMANDO?DE UN CÓDIGO INTRODUCID3 DO A LOS INDICADORES DE?DATOS.

TBLBTM

030609OCOF12

RUITNA DE =-ROGRAMACION/LECTURA DE EPRGMS Y LECTURA/ESCRITURA DE LOCALIDA-

0726072707280729072A072B

RUI TIMA

DES DE

072C072F07300731073207340735073707330739073A073B073D073E073F0741074207430744074507480749074A074B074D074E0750075107520753075407560757075S075A075B07 5C075D075E07610763076507670769076A076B076D076E07700772

030609ocOF12

DE =-RO

MEM3RI

CD6 BO 16F62AFD3F430D3F5764F42AFD3F4C'U3CD3F5765F7AC9CD6B014F42AFD3F4or"O'™-

D3F5766F62AFD3F43C3CD3F5765FEBC9CD2C07C640D3FAC620D3FA577BD3F87ED3F9SEO ¡382

INPUT1

INPUT2

PGM680CNT581

PGMSEQ

CALLLDLDXOROUTINCOUTHALTLDLDXOROUTINCINCOUTHALTLDLDRETCALLLDLDXOROUTINCOUTHALTLDLDXOROUTINCINCOUTHALTLDEXRETCALLADDOUTADDOUTLDLDOUTLDOUTLDADD

ZEROUTL? AH,üA( F4H ) , AA(F5H),A

Ci AB,nA( F4H ) , AAACF5H),A

E, AA,D

ZEROUTC,AB,DA(F4H),AA(F5H),A

L,AH,DACF4H),AAA(F5H),A

E, ADE,HL

INPUT1A,40H( FAH ) , AA,20H( FAH ) , ADv AA7E< FT8H ) , AA, (HL)í F9H ) , AA,08HAiD

ESTA RUTINA EJECUTA LAPROGRAMACIÓN DE LASEF'ROMS Y LA LECTURA DELAS MISMAS,TAMBIÉN LEE UNA LOCALI-DAD DE MEMORIA Y CAMBIASU CONTENIDO BAJO CO-MANDO DESDE EL TECLADO,

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CO ^

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CO

ffl

Q U

. O

C^

CO

Lll

CO

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LÜ L

L O

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* 01

CO

«t

Ü J

N

'>•N

N

N

N N

N

N

N

CO

00

CO

CO

03

00 C

O 0

0 00

CO

00

CO

00

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Q\>

i>-

<j ••

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E <C

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CQ

OJ

ffl

ffl

ffl

ffi

03 P

3 01

U

CJ U

O O

O O

OC

JQ

PD

QQ

QO

D

O O

O O

O '"*

' O

O O O

O' O

'"*' O O

1 O O O

O' 'O O

Q O

O

O O

'""

"' O

O O

o

07DA07DB07DC07DD07DE07DF07E107E307E407E607E907EA07EB07ED07EF07FO07F107F307F507F707FA07FB07FD07FE07FF080 10802080408070809080 A080D081008110813081408150818081 A08 1C081 E0821082408260829082B082E083 OOOO'"!'O O 4—

083508370839083B083E0840084 1084408450848

DIEl '032378E60FFEOSF818BECD6B015F1AD3FOD3F5761218?- 53E82D3FBCD450778C604477AC6045718B7CD2C07C60457C361072100107EF60F77AF3222103EEI:D3F5D3FD3144103A0010D3FD3A0110D3FC3A2210CB7F28EC210010CB9ECBC£1 8E3326610DBFF17D20;:tF83.F3A6610C37EF8

RWnEN

LD581

PGM5S1

ESCAPE

ESCPSS

OUTDC

-rHKRo'o'

POPPOPINCINCLDANDCPRETJRCALLLDLDOUTOUTHALTLDJRLDOUTCALLLDADDLDLDADDLDJRCALLADDLDJPLDLDORLDXORLDLDOUTOUTLDLDOUTLDOUTLDBITJRLDRESSETJRLDIMRLAJPRRALDJP

DEHLBCHLA,BOFH08HMOVRFLWZEROUTE, AA, (DE)(FOH),A(F5H),A

( DE ) , A'ESCPBSA,S2H( FBH ) 7 AINPUT2A,BA704HB,AA,DAi04HD,AEXCLDINPUT1A 7 04HD,ACNT5S1HLilOQOHA, (HL)OFH(HL),A -A(1022H),AA,ECH( F5H ) 7 A( FOH ) , ASP, 1044HA 7 < iOOOH)(FDH),AA, ( 1001H)(FCH),AA? (1022H)7,AZ, OUTDCHL, IOOOH37 (HL)1 7 í HL )OUTDCU066H)7AAiFFH

NC 7 RT3S85

A, ( 1066H)RT3SZG

RUTINA DE CHEQUEO DE LA ISTRUCCIOIM s RST

FS7Er Wüj¿FSS4FÜÜWFS8C|~ÜüFF89 1FS92FOO'T1W / •_'COO/Ii o ;"tF395F896FS97F89AF89DF89EFSAOF8A3F8A5F8A7F8ABF8ACF8AFFSBOF8B2F8B4F8B7F8BBF8BDF8C1FSC4F8C7F8CBF8CDFSD1F8D4F8D8F3DBF8DCF8DDF8DEF8DFF8E3F8E7

F8E8F8EBF8ECF8EDF8FOF8F 1F8F2F8F3F8F5F8F6F8F8F8FAF8FD

DD224F1Q RT38ZGDDE; iDD225B10ED735910315D1QDDE 5*""'Pi3BF5C5D5E53143103A22101738143A0210FEOO28 IDED5B5B10IBCDAC017DFE1C3010CDD4F8 BREAKED7B5910DDE5DD2A4F10CSC DO 1CDD4FS USER38ED7B5910DDE 5DD2W10C33 311ED731C10 ALLBAK315110ElDIClFlDD2A5B10ED731C10C9

RUTINA DE C

CD6B01 OFFSET6F62CD6B015FEBAFED527C•¿tJ 1 4.FEOOC2F9007D

LDPOPLDLDLDPUSHDECDECPUSHPUSHPUSHPUSHLDLDRLAJRLDCPJRLDDECCALLLDCPJRCALLLDPUSHLDJPCALLLDPUSHLDJPLDLDPOPPOPPOPPOPLDLDRET

ALCULO

CALLLDLDCALLLDEXXORSBCLDJRCPJPLD

(104FH),IXIX(Í05BH) , IX(1059H),SPSP, 105DHIXc-p•~'rSPAFBCDEHLSP, 1043HA, C1022H)

C i BREAKA, ( 1002H)00 HZ,USER38DE, (105BH)DECHEKBKA,L1CHNC,USER38ALLBAKSP, (1059H)IXIX, (104FH)BRKEXCALLBAKSP, (1059H)IXIX, (104FH)RST38<101CH),SPSP, 1051HHLDEBCAFIX, (105BH)SP, (101CH)

DE OFFSET

ZEROUTL,AH,DZEROUTE, ADE,HLAHL,DEA,HC,CHEKSOOOHNZ, ERRORA,L

; ESTA RUTINA DETERMINA•SI LA EJECUCIÓN DEíRST 38 ES DEBIDO AL¡MONITOR O PROGRAMA/IN~tTERRUPCIOM DEL USUARIO.íSI ES DEBIDO AL MONITORi EJECUTA LA FUNCIÓN RES-¡PECTIVA. SI ES DEBIDO¡AL USUARIO SALTA A LALOCALIDAD 1138H.

ESTA RUTINA CALCULAEL OFFSET NECESARIOPARA LOS SALTOS RE-LATÍVOS.

FSFE FESO CP 80HF900 D2F900 JP NC,ERRORF903 D3FO OUTPUT OUT (FOH),AF905 D3F5 OUT (F5H)7 AF907 C31EOS JP OUTDCF90A FEFF CHK80 CP FFHF90C C2F900 JP NZ,ERRORF90F 7D LD A,LF910 FESO CP SOHF912 FAF900 JP M7 ERRORF91S ÍSEC JR OUTPUT

MONITOR DEL 6800

RUTINA DE RESET

OEAOOEA2OEA4OEA6OEA9OEABOEACOEAEOEAFOEB1OEB3OEB5OEB7DEBAOEBDCEBEOECOOEC2OEC5OEC7OEC9OECBOECDOECEOEDOOED2OED4OED7CEDAOEDCCEDEOEEOOEE2OEE4OEE5OEE7OEE9OEEBOEEDOEEF

OEF1OEF4OEF5OEFSOEFBOEFEOEFFOFOOOF02OF05OFOSOFOB

yoüj^97FBS6FECE10C2A7004CA70Í4FA702A703A7IC97FOCE IODOFF10DF4F97F520 1 2CE10C2860 FA ACÓA 70097FO4FA71I:86EC97F5SE 11 09CE1 HC2A600-97FDA60 197FCA61C4924E386F7A400SA02A70020E3

1

B71 11632 -9711.14F71115FF11173034EEO!5FF11.19BF1 11BHCE10C2860 L

RESET

ESCAPE

ESCPSS

OUTDC

PROGRAMA DE

LDAASTAALDAALDXSTAAINCASTAACLRASTAASTAASTAASTAALDXSTXCLRASTAABRALDXLDAAORAASTAASTAACLRASTAALDAASTAALDSLDXLDAASTAALDAASTAALDAAROLAE CCLDAAANDAÜRAASTAABRA

SLECCIÜN

STAAPULASTAASTABSTXT3XDESLDXSTXO T O

LDXLDAA

#*82H*FBH#$FEH#$ 1 OC2H00 1 X

0 1 , X

02, X03» X1C, X*FOH#*10DOH*10DFH

*F5HOUTDC#$10C2H*t$OFH00» X00 T X$FOH

IC,X$ECHSF5H#*11Q9Htt$10C2H00? X$FDH01.7 X

*FCHICiX

OUTDC#*F7H00 7 X#$02H00, XOUTDC

DE SUBRUTINA

«1116H

«1114H*1115H*1117H

05, X*1119H*111BH4**10C2Htt*01H

ESTA RUTINA EJECUTA LAINICÍALO ACIÓN DEL MO-NITOR CRESET).

5 ESTE PROGRAMA ENCUEN-TRA LA RUTINA QUE SE?HA PEDIDO Y LO EJECUTA.

OFODOFOFQFllOF13ÜF15OF17OF19OF1COF1EOF21OF24OF27OF29OF2BOF2DOF2FOF32OF35OF38OF3AOF3DOF40OF43OF46OF49OF4COF4FOF52OF55OF5SOF5BOF5EOF61OF62OF65OF67OF68OF6AOF6BOF6COF6DOF6EOF70OF71OF74OF75OF76OF77OF78OF79OF7A

OF7BOF7COF7DOF7FOFS1OF84OF86OF87

AAOOA70097FD96FFS1FF2710CEOF3A8D40F61115B61116BE111B6EOO96FE81FF2606BEÜ1B7EFFE9CEOF4C20 E 27EFE897EOEC27EOFA17EFE017EFD727EFD9A7EFC077EFC6D7EOF7B7EFDFO7EOFAC7E5DB9BF 1 OES35CEOF75E600112706OSo* J.31 '•_"j 120F530BE10E339 ;

FEFDFB ;

F7EFDF

4F4397FC97FDCE0040C6FF5A26FD

ORAASTAASTAALDAACMPABEQLDX

GETIXÍ BSRLDABLDAALDSJMP

CHKFE LDAACMPABNELDSJMP

GETIX2 LDXBRAJMPJMPJMPJMPJMPJMPJMPJMPJMPJMPJMPJMP

FINDIX STS. TSXLDX

FINDKY LDABCBABEQINXINSINSINSBRA

RTRN TSXLDSRTSFEFDFBF7EFDF

RUTINA DE ERROR

ERROR CLRACOMASTAA

OUTERR STAASTRTR LDXDEC IX LDABDECRB DECB

BNE

00, X00, X$FDH*FFH#*FFHCHKFE#$OF3AFINDIX41115H41116H4111BH00, X*FEH#$FFHOETIX24111BHEXTNMI#$OF4CHGETIXÍSSESCAPELOADGOREO >REG<BRK. REMBRK. CHKERRORRW MEMBRK. INSREO. STR410E3H

&40F75H00, X

RTRN

FINDKY

410E3H

*FCH*FDH#$0040H#*FFH

DECRB

5ESTA RUTINA GENERA UNA5 INDICACIÓN VISUAL Y AU--?DIBLE SI SE PIDE UN PRO-?CESO QUE AL MOMENTO NO5 ES PERMITIDO»

OF89OF8AOFSCOFSEOF90OF92OF94OF96

OF9SOF99OF9BOF9DOF9FOFAO

OFA1OFA3OFA5OFA6OPASOFAAOFAB

ÜFACOFAFOFB1OFB3OFB6OFB9OFBAOFBBOFBDOFBFOFCOOFC1OFC4OFC6OFC7OFCSOFC9OFCAOFCBOFCCOFCEOFDOOFD2OFD4OFD6OFD7OFDAOFDCOFDD

0926F88.1FB26048AFF20EB84FB20E7

4F97F197F497F53 E•jy

96F6D6F730E701A702333B

B610C4ülUW27C8BDOF98CE 10 05364FA 100270F375F7610C524 OCoaos085C5C5C20F36COO20 1 7C1002¿06OE7'? 10C52C OCOE7910C5

RESERR

DEXBNECMPABNEORAABRAANDABRA

DEC IX#*FBHRESERRí**FFHOUTERR

OUTERR

SUBRUTNA ZEROUT

CLRASTAA $F1HSTAA $F4HSTAA *F5HWAIRTS

SUBRUTINA LOAD

5 ESTA SUBRUTINA COLOCA5OOOOH ENLOS INDICADO-5 RES DE DATOS»

LDAALDABTSXSTABSTAATXSRTI

$F6H$F7H

01, X021 X

ESTA SUBRUTIMA LEE DATC(16 BITS) DEL TECLADO.

RUTINA DE INSERCIÓN DE BREAKS

LDAACMPABEQJSRLDXPSHACLRACMPABEQPSHBCLRB

BRKOUT RORBCCINXJ:NXINXINCBINCBINCBBRA

STRTBK INCBRA

STBKID CMPBBNESECROLBRA

SETBRK SECROL

*10C4H#*08HERRORZEROUT#$ÍOC5

00, XSTRTBK

*10C5HSTBKID

BRKOUT00 7 XBKINSA#$OOHSETBRK

$ 1 OC5HBKINSB

*10C5H

ESTA RUTINA INSERTA UNBREAK EN LA LOCALIDADQUE SE INDIQUE DESDE ELTECLADO„ ANTES VERIFICAQUE EL NUMERO DE BREAKSYA INSERTADOS SEA <S.DE SER =3 SALTA A LARUTINA DE ERROR-

OFEOOFE1OFE2OFE3OFE5OFESOFE9OFEAOFECOFEEOFEFOFFiOFF3OFF4OFF6OFF8OFF9OFFBOFFD

F300FS03F804F806FSOSF8ÜA

FCOOFC01FC04

FC07FC08FCOBFCODFCÍOFC13FC15FC1SFC1AFC1CFC1DFC1FFC21FC22FC23FC26FC2SFC29FC2AFC2BFC2CFC2EFC2FFC30FC32FC33FC3SFC3S

5A5A5A26F779 1 OC5o o•~'j¿

A701E70235EE01A60030A7C3S63F•~¡nr.

EE01A7CO7EFCOO

BE10DF30E60 1A602EE037E1120

307C10C47ECEC2

4FB 1100426C37ECF7BBDCF9S8D23SC10DE27F3A60235EEOOA70030OCSC10C62706590909 -0920F559O 9E7OO096AOO7EOEC2B71117

BKINSBBKINSA

USRSWI

RUTINA DE

ERRJMPBRKREM

ROTACB

RSRACB

CHKBRK

DECBDECBDECBENEROLPULBPULASTAA3TABTXSLDXLDAATSXSTAALDAATXSLDXSTAAJMP

LDSTSXLDABLDAALDXJMP

TSXINCJMP

REMOC

CLRACMPABNEJMPJSRBSRCPXBEQLDAATXSLDXSTAATSXCLCCPXBEQROLBDEXDEXDEXBRAROLBDEXSTABDEXDECJMPSTAA

SETBRK$ 1 OC5H

01 7 X

02, X

01, X00 7 X

03.X#*3FH

01, X00, X$FCOOH

$ÍODFH

01, X02, X03 » X*1120H

*10C4HESCAPE

ION DE -BREAK

*1'OC4HBRKREMERRORZEROUTCHKBRK4HS10DEHERRJMP02, X

00 1 X00 , X

••i**10C&HRSRACB

ROTACB

00 7 X

00 , XESCAPE*1117H

ESTA RUTINA REMUEVE UNBREAK DE LA LOCALIDADQUE SE INDIQUE DESDE ELTECLADO- ANTES VERIFICAQUE EXISTA POR LO MENOSUN BREAK YA INSERTADO.SI EL NUMERO DE BREAKSINSERTADOS ES =Q SALTAA LA RUTINA DE ERROR.

FC3BFC3EFC41FC44FC45FC46FC47FC48FC4BFC4DFC4FFC52FC54FC57FC5SFC59FC5CFC5EFC61FC64FC66FC69FC6C

FCóDFC70FC72FC73FC74FC76FC78FC7AFC7CFC7EFC81FCS3FC85FC87FCS9FC8CFC8EFC90FC93FC94FC95FC97FC93FC9AFC9CFC9EFCA1FCA4bCASFCA6FQA7FCA8FCA9FCABFCACFCAE

F71118CE10C3F610C55608OSos8C10DE2F1F24Í-5BF1119AEOOFFiliB3009BC1.11 7270SBE1119FE111B20 JEBEÍ119FE 11 IB39

RUTINA

CEIODEA600494925 ID840F270481092D.L7B6:LOC42709A6008A40A700B6I.OC497FO97F57EOED44646;

6COO4C.S40F81092 CEOCE30C3F610C536080808**./-•-•O

24FA4A26F7•¿¡.¿I

STABLDXLDAB

CNTROT RORBINXINXINXCPXBLEBCCSTSLDSSTXTSXDEXCPXBEQLDSLDXBRA

HRETRN LDSLDX

RETRN RTS

*1118H#*10C3H*10C5H

4*$10DEHRETRNCNTROTS1119H00, X$111BH

M117HHRETRN$1119H*111BHCNTRÜT*1119H*111BH

i£ CHEQUEO DE NUMERO Y LOCALIZQCION DE BREAKS

BRKERR

CNTERR

HBKOUT

BKOUT

I NCR IX

LDXLDAAROLAROLABCSANDABEQCMPABLTLDAABEQLDAAORAASTAALDAASTAASTAAJMPRORARORAINCINCAANDACMPABGELDXLDABPSHAINXINXINXRORBBCCDECAENEPULA

#*10DEH00 7 X

HBKOUT4**OFHBRKERR#$09HBKOUTS10C4HCNTERR00 •> Xtt*40H00» X$ 1 OC4H$FOH*F5HGUTDC

00, X

4**OFHtt*09HBRKERR#*10C3H*10C5H

I NCR IX

I NCR IX

5ESTA MUESTRAS PRIMERO?EL NUMERO DE BREAKS?INSERTADOS EN EL SITE-;MA Y EN CASO DE HABERLO5 MUESTRA SU LGCALIZACIGN•ESTA FUNCIÓN ES CÍCLICA

FCAFFCBOFCB3FCB4FCB6FCB7FCBAFCBCFCBEFCCO

FCC3FCC6FCC7FCC9FCCAFCCCFCCEFCDOFCD3FCD6FCD9FCDBFCDEFCDFFCE1FCE4FCE7FCEAFCECFCEEFCEFFCFOFCF1FCF2FCF4FCF6FCF7FCFSFCFAFCFCFCFDFCFEFDOOFD01FD04FD06FD08FDOAFDOCFDOFFD12FD15FD17FD19FD1BFD1DFD1EFD20

16B630C41126044FB 7. 10 DEEEOO97F1DFF47EOED4

BFJODF30AE0534AF05A605E606SE30DOBDFC3S8C30DE2609B630DE4925037EF3008E1112FE10DFA607E60636373434A605E6C'43637A6C3b.6C i¿!3736A6C 136CE1ODFA6COE6C:lCB073900B7110FF71110CE10C2A60084FD81FD270 C49244549

DISPLY

RUTINA DE

BRKEXC

CHKREG

FINDR1

TABLDAACBABNECLRASTAALDXSTAASTXJMP

E.JECUC

STSTSXLDSDES— —. —•_.• i •-•LDAALDABLDSJSRCPXBNELDAAROLABCS.JMPLDSLDXLDAALDABPSHAPSHBDES-DESLDAALDABPSHAPSHBLDAALDABPSHBPSHALDAAPSHALDXLDAALDABADDBADCASTAASTABLDXLDAAANDACMPABEQROLABCCROLA

*10C4H

DISPLY

*10DEH00, X*FÍH*F4HOUTDC

ION DE BREAK

*10DFH

05. X

05, X05, X06, X#*10DOHCHKBRK#*10DEHBRKEXCMODEH

BRKEXCUSRSWI#*U12H$10DFH07, X06,X

057 X04» X

03 7 X02, X

01, X

tt*10DFH00, X0 1 •> Xtt*07H#$OOH*110FH$11 .10Htt*10C2H00, X#*FDH#*FDHFIMDR2

OUTCCR

¡ESTA RUTINA ALMACENA¡LOS REGISTROS DEL uP:Y SU STATUS AL MOMEN-:TO DEL BREAK Y MUESTRA•EN LOS INDICADORES DE: DATOS EL CONTENIDO DEL¡PAR DE REGISTROS SELEC-:C ION ADOS..

FD21FD22FD24FD25FD27FD29FD2BFD2DFD2FFD31FD32FD34FD36FD3SFD3AFD3CFD3EFD40FD43FD46FD4SFD4AFD4CFD4EFD51FD53FD55FD57FD5AFD5CFD5EFD60FD63FD65FD67FD69FD6BFD6DFD70

FD72FD75FD77FD7SFD7AFD7CFD7DFD7FFDSOFDS1FDS3FDS4FD86FDSSFDS9FD8BFDSCFDQEFD90

492422492411S6FDA700AÓ01Sl^F27 374624 1F84102724S6EDA700S6FFA701CE L i l i7EFCBAS¿DDA700Q6FFA701CEllOF20F:0S6FEA701CE110B20E7 .86DFA701CE110D20DES67'DA700S6FFA7C 1CE110A20 E 1

CE10C2A60016CAF5E7OO4924D449 '49240Ü49240FA60 14624D117S4EF20AA17

RUTINA

FINDR2

OUTPCHOUTPC

HDSPLYOUTSPHOUTSP

ÜUTAB

OUTIX

OUTCCRHOTCCR

ROLABCCROLABCCLDAA3TAALDAACMPABEQRORABCCANDABEQLDAASTAALDAASTAALDXJMPLDAASTAALDAASTAALDXBRALDAASTAALDXBRALDAASTAALDXBRALDAASTAALDAASTAALDXBRA

i DE CHEQUEO DE

RESTPC

RSTCCR

LDXLDAATABORABSTABROLABCCROLAROLABCCROLABCCLDAARORABCCTBAANDABRATBA

OUTSP

OUTPC4t*FDH00, X0 1 , X

tt$FFHOUTPC

OUTABtmoHOUTIX#$EDH00 1 X#*FFH0 1 , X#*miHDISF'LY#3DDH00, X#*FFH01, X#*110FHHDSPLYtt*FEH01, X#*110BHHDSPLY#*DFH0 1 7 X

tt*110DHHDSPLYtt*7DH00 7 Xtt*FFH01, X#*11QAHHDSPLY

REGISTROS

#*1QC2H00, X

#*F5HOO, X

OUTAB

RSTCCR

RESTSP01, X

OUTIX

#*EFHOUTPC

Y MOVIMIENTO >

"ESTA RUTINA MUESTRA EL5 CONTENIDO DEL PAR DE5 REGISTROS SIGUIENTE AL3 QUE INDICAN LOS LEDS DE?STATUS DEL SISTEMA. EL5 DESPLAZAMIENTO DE ENCEIM-5DIDO DE LOS LEDS ES HA-5 CÍA LA DERECHA.

FD91FD93FD95FD96FD9S

FD9AFD9DFD9FFDAOFDA2FDA4FDA5FDA7FDASFDA9FDABFDACFDAEFDBOFDB1FDB3FDB5FDB7

FDB9FDBCFDBEFOCOFDC1FDC3FDC5FDC6FDCSFDC9FDCAFDCCFDCDFDCFFDD2FDD3FDD5FDD7FDD9FDDBFDDDFDDFFDE1FDE3FDE5FDE7FDE9FDEBFDED

S47F20D21784 DF20 A E

RL

CE10C2A60016CAF5E7004924EE494924 EO4924AEA6014624 DD841027 ?C20 02

CEIOC29EF6A60143260FA6004924:. 3494924 ;. 34924147EOF7B46251284 1 O261220EQAF¿-8200EAF4D200 AAF4F2006AF/Í92002AF4B7ECED4

ANDABRA

RESTSP TEAANDABRA

JI TIMA DE CHEQUEO DE

LDXLDAATASORABSTABROLABCCROLAROLABCCROLABCCLDAARORABCCANDABEQBRA

RUTINA DE CAMBIO DE

LDXLDSLDAACOMABNE

FDSTR1 LDAAROLABCCROLAROLABCCROLABCCJMP

FDSTR2 RORABCSANDABNEBRA

STRCCR STSBRA

STRSP STSBRA

STRPC STSBRA

STRAB STSBRA

STRIX STSODCJMP JMP

#$7FHHOTCCR

ftSDFHHOUTSP

REGISTROS Y

#*10C2H00, X

#*F5H00 7 X

RESTSP

RESTPC

OUTIX01, X

RSTCCR&$10HOUTABRESTPC

CONTENIDO

ft$10C2H$F6H01, X

FDSTR200 7 X

STRCCR

STRSP

STRPCERROR

STRABttílOHSTRIXFDSTR148 7 XODCJMP4D,XODCJMP '4F, XODCJMP49, XODCJMP4B, XOUTDC

MOVIMIENTO <

5 ESTA RUTINA MUESTRA EL; CONTEN I DO DEL PAR DE"REGISTROS ANTERIR AL5 QUE INDICAN LOS LEOS5 DE STATUS DEL SISTEMA.5 EL DESPLAZAMIENTO DE•ENCENDIDO DE LOS LEDS5 ES HACIA LA IZQUIERDA.

DE REGISTROS

5 ESTA RUTINA CAMBIA EL5 CONTEN I DO DEL PAR DE5 REG I STROS I ND I CADO POR5 EL NUEVO DATO COPIADO5 EN LOS INDICADORES DE5 DATOS.

RUTINA DE LECTURA/ESCRITURA DE LOCALIDADES DE MEMORIA

FOFOFÜF3FDF5FDF7FDF9FDFBFDFCFDFE

FEO 1FE04FE06FE09FEOBFEODFEOPFE12FE 15FE17FE 18FE1BFE1DFE1EFE20FE21FE22FE24[- EJ¿OFE27FE29FE2CFE2EFE30FE32FE34FE37FE39FE3CFE3EFE40FE42FE44FE47FE48FE4AFE4CFE4EFE50FE52FE53 'FE55FE57FE59FE5BFE'SDFE60FE62

BDOF98DEF6A60097FO97F53EE7007EOECE

RUTINA

BDOF98DEF6FF1111A600813F2708SE 11 02BF10DF202235CE10DEA600492414OC46A700A63530A 700CE10C28608AAOOA7002005SE 11 09SD2DCE10C2A600SAOFA70097FOCE10DF•~* % JA62Z:E62DEEODA703£70230A623AE32EEOOA701AF06BE1 IODAF04BE10DF

JSRLDXLDAASTAASTAAWAISTABJMP

DE EJECUCIÓN DE

JSRLDXCT Y•«• 1 A

LDAACMPABEQLDSSTSBRA

CNTNGO TXSLDXLDAAROLABCC

SL3PGO CLCRORASTAALDAATSXSTAALDXLDAAORAASTAABRA

BRKGG LDSBSR

RUN LDXLDAAORAASTAASTAALDXTXSLDAALDABLDXSTAASTABTSXLDAALDSLDXSTAAC'T1— ••_> ) --.'

LDSSTSLDS

ZEROUT*F6H00 7 X$FOH*F5H

00, XESCPSS

PROGRAMA

ZEROUT$FÓH*1111H00 7 Xtf*3FHCNTNGO4t*1102H*10DFHRUN

tt*10DEH00, X

BRKGG

00 7 X••:•=; y•._'%J 7 A

00 7 X4**10C2H#$08H00, X007 XRUN#$1109HFINDOCtt*10C2H00 , X#*OFH007 X$FOHtt$10DFH

2C,X2D,X00 1 X03, X02 1 X

2B, X32, X007 X01 7 X

06, X*110DH04 7 X*10DFH

ESTA RUTINA LEE LA L0~CALIDAD DE MEMORIA INDI-CADA Y CAMBIA SU CONTENÍDO BAJO COMANDO DESDE ELTECLADO.

DEL USUARIO (GO)

5ESTA RUTINA EJECUTA EL,PROGRAMA DEL USUARIO7°A PATIR DE LA LOCALI-5 DAD COPIADA A LOS INDI-3 C ADORES DE DATOS,,

FE65FE66FE69FE6CFE6FFE72FE74FE76FE77FE78FE79FE7AFE7BFE7EFESOFE32FE84FE86FEwa

FE89FE8CFE8EFE8FFE91FE93FE96FE93FE9AFE7BFE9CFE9EFEAOFEA2FEA4FEA6FEASFEA9FEAAFEACFEAFFEB1FEB3FEB6FEB8FEBAFEBDFECOFEC1FEC2FEC4FEC5FEC7FEC8FECAFECCFFCF1 1 — '_-!

FED1FED3

3BB61111F61112BDFC3SSC10DE2717A6J2OC590909098C I.OC326F7£7026A01EE4EA70039

CE30C2A61C492409A651FE1111.A7CO2026OD46A71CA6008A0184F7A70097FD46 ;462507FE11118DB520011'BDOF9SDEFÓA6OOB71113FFlitll1659257:.5925365925 OC;A601B711 13

A70 17EFE39

FINDOC

DECBRi;

SBRRTN

RUTINA DE PASO

CNFTOC

STRTSS

SSBTSL

BYTSEL

ONEBYT

HLFRUN

RTILDAALDABJSRCPXBEQLDAACLCROLBDEXDEXDEXCPXBNESTABDECLDXSTAARTS

A PASO

LDXLDAAROLABCCLDAALDXSTAABRASECRORASTAALDAAORAAANDASTAASTAARORARORABCSLDXBSRBRAJSRLDXLDAASTAASTXTABROLBBCSROLBBCSROLBBCSLDAASTAALDAASTAAJMP

sillín*1112HCHKBRK#$10DE1SBRRTN02, X

#$1QC3IDECBRK02, X01, X4E,X00» X

(SS)

#*1QC2I*1CH

CNFTOCK-.j y•-' .1 , 7%

$ 1 1 1 1 H

00» XBYTSEL

1C,X00 , X#$Q1H#*F7H00» X*FDH

'oTRTy'™-$ 1 1 1 1 HFINDOCBYTSELZERGUT$F6H00 7 X*1113H$ 1 1 1 1 H

CHKHGR

CKBT02

CKBCSP01, X*1113H#$3FH01, XRUN

5 ESTA RUTINA EJECUTA EL3 PROGRAMA DEL USUARIO5 PASO A PASO DESDE LA5 LOCALIDAD COPIADA EN"LOS INDICADORES DE DA-5TOS.

FED6FED7FED9FEDAFEDCFEDDFEDFFEE2FEE4FEE6FEE9FEEBFEEDFEEFFEFOFEF1FEF3FEF6FEF8FEFBFEFDFEFEFFOOFF01FF03FF05FF07FF09FFOCFFOEFF10FF12FF14FF16FF1SFF1BFF1CFF1EFF20FF22FF24FF26R r •"*' o£-'.t

FF2AFF2DFF2FFF31FF33FF35FF36FF38FF39FF3BFF3CFF3EFF40FF42FF44FF46FF4SFF4BFF4D

5924 5A5924EE592510FE110FEE01A600B7.1113863FA70020 E459592505FE:. 11120F:3FE;. 12120E-75924CA59240F817E27DBA603B7J 113S63FA70320 Cl816E*"•*'/• 1 ""'E6C1CE10E14FEB2DAB2CA7COE7C 1EEOO20BCA602B7I113863FA70220 A 02O5D5925465925355925EAS13B23E6818D26C1E601CE10E1A631C17F

CKBCSP

SPLOPS

EXTDJPEXCSTR

EXCWAI

CKSIWA

SFTWRI

CKBT02

THREBT

CHEK6E

INDXJP

TWOBYT

BMCHJPCHKHGR

CKRLJP

ROLBBCCROLBBCCROLBBCSLDXLDXLDAASTAALDAASTAABRAROLBROLBBCSLDXBRALDXBRAROLBBCCROLBBCCCMPABEQLDAASTAALDAASTAABRACMPAENELDABLDXCLRAADDBADCASTAASTABLDXBRALDAASTAALDAASTAABRABRAROLBBCSROLBBCSROLBBCSCMPABLSCMPABNELDABLDXLDAACMPB

BNCHGP

ONEBYT

CKSIWA*110FH01, X00, X$1113H#$3FH00, XHLFRUN

SFTWRI$ 1 1 1 1 HEXCWAI*1121HEXCSTR

ONEBYT

CHEKóE#$7EHEXTDJP03, X*1113Htt*3FH03, XHLFRUN#*6EHTWOBYT01, X#*10EU

2C,X00 7 X01, X00 , XEXCSTR02, X*1113H4**3FH02, XHLFRUNBNCHGP

CHKCTF

CHEKAB

TWOBYT#*SBHTWOBYTtt$SDHTHREBT01, X#$10E1I-31, X#$7FH

FF4FFF51FF52FF53FF55FF57FF59FF5BFF5DFF5EFF5FFF6 1FF62FF64FF66FF68FF6AFF6CFF6DFF6EFF70FF71FF73FF75FF77FF7AFF7CFF7EFF80FF81rr P~ i~i -"ir r o-j>FF84FF86FF88FF8AFF8DFF8EFF90FF92FF94FF96FF97FF99FF9BFF9DFF9FFFAOFFA1FFA3FFA4FFA7FFA9FFAAFFABFFADFFAEFFBOFFB2FFB3FFB5FFB7FFB8

23105010£630C2:JOE700A701EEOO08OS2033IBE630C900E700A701EEOOOSos20EF59240781BD26907EFEE281AD279820A859250A5925A28 ICE269E7EFF075925FA2096812027BO1681232327S12C2C2E4646251446B6110A250146R/_•-JO

250546249ó20DE46259120D94646

HEXCSRFWDJMP

HFWDJP

' CHEKAB

CHECKA

CHKCTF

HTREBTCHEKEF

HTWOBTBNCHGP

CHECKVHCHKFGCHECKC

JPFGRSBCC

JPFGST

CHEKZN

BLSNEGBSBALDABSBCBSTABSTAALDXINXINXBRAABALDABADCBSTABSTAALDXINXINXBRAROLBBCCCMPABiMEJMPCMPABEQBRAROLBBCSROLBBCSCMPAENEJMPROLBBCSBRACMPABEQTABCMPABLSCMPABGERORARORABCSRORALDAABCSRORARORBBCSRORACKRLJPBRARORABCSBRARORARORA

FWDJMP

30, X#$OOH00, X01,X00, X

EXCSTR

30, X#$OOH00, X01 v X00 7 X

HEXCSR

CHECKA#$BDHTHREBTEXTDJP&$ADHINDXJPTWOBYT

CHEKEF

TWOBYT4t*CEHTWOBYTTHREBT

HTREBTTWOBYT#$20HCKRLJP

#*23HCHECKZ#$2CHCHKNVZ

CHEKZN

*110AHCHECKC

JPFGST

HTWOBT

CKRLJPHTWOBT

TjT

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X

PRÜGRMAM MONITOR DEL 80S5A

RUTINA DE RESET V LOCALIDADES DE RESTART

0000000200 04

00 38

003 F004 100420044

O16B0 1 6C016E017001720173

UWo'B083E0840084 1

084B0840084F085208550856085708580859085AO85BOS5C035D085E0861086308660869086 A086C086F0872087308750876

•""' cr o "'•OCZ.O.Ú-

D3F3C33FOO

C33308

DBFF173EFED25208

AFD3F1D3F4D3FS576C9

326610DBFFr17D20DF8

1F3A6610C37FOA216710773C2-77AFj'.O

77.c.o77•™»*~tiOO 1 f~iOj¿-'~"-' 1 v*

D3FO218B1022B210AFD3F5C3S0082167107EF60F77AF

RESET

LDAOUTJMP

JMP

INRALLDAJNC

FBHRESET

CHKR3S

FFH

FEHRSET85

5 ESTA RUTINA SALTA AL5 PROGRAMA DE RESET DEL3S085A Y TAMBIÉN SALTA5 AL PROGRAMA DE CHEQUEC5DE LA INSTRUCCIÓN RST

3LIBRUTINA ZEROUT

RST85

RSET85

ESCAPE

XRAOUTOUTOUTHALTRET

STAINRLA.JNC

AF1HF4HF5H

;ESTA SUBRUTINA COLOCASOOOOH EN LOS INDICADO-RES DE DATOS.

1066HFFH

CKURBK

RARLDAJMPLXIMOVINRINXMOVXRAINXMOVINXMOVSTAOUTLXISHLDXRAOUTJMPLXIMOVORÍMOVXRA

1066HEXCBRKH, 1067HMi AAHM,AAHM, AHMi A1088HFOH108BH10B2HAF5HOUTDCH, 1067HA,MOFHM, AA

0877087AOS7COS7EOS 30OS 33OS 36i"*jO ™'O

08 3BOS 30OS90O 39108940397OS9SOS9A089COS9D

OSAOOSASOS A 4OSAS08A608A9OSACOSADOSEOOSB308B403BS08B8OSBBOSBDOSBEOSBFOSC iOSC 3OSC5osesOSCBOS CE08CFOSDOO8D 1OSD4O8D5OSD808DBOSDD08DFOSE208E4OSE7OSEAOSEDOSFOOSF3OSF4

3288103EECD3F5D3FO31A7103A6710D3FD3A6S10D3FC3ASS1017D2&0082U7107EE6F7F60277C38008

22B710ElF5ET-";

22BD10210000•— • y22851031BD10C5D531A910216710SEO 1B677D3FDDBFFFE7FCAOBOSCDFOOS31B910DIClFl2ASH10F92AB710C3BF10DBFE-FEFFC2C8083EC332BF1021471122C010C3CBOS21180917D20609

STAESCPSS MVI

OIJTOUT

OUTDC LXILDAOIJTLDAOUTLDARALJNCLXIMOVANIORÍMOVJMP

PROGRAMA DE SELECC

SHLDPOPPUSHXTHLSHLDLXIDADSHLDLXIPUSHPUSHLXILXIMVIORAMOVOUTINCPIJZ

FSTKBD CALLRTNSTS LXI

POPPOPPOPLHLDSPHLLHLDJMP

CHKFE INCPIJNZMVISTALXISHLDJMP

FDRTNE LXIRALJNC

1 08SHA 7 ECHF5HFOHSP, 10A7H1067HFDH1068HFCH10SSH

OUTDCH, 1067HA 7 MF7H02HMi AOUTDC

ION DE SUBRUTINA

10B7H 9 1H ;PSW 5

10BDHHiOOOOHSP1085HSP, 10BDHBDSP, 10A9HH, 1067HAiOlHMM,AFDHFFH7FHCHKFEFDRTNESPi 10B9HDBPSW10S5H

10B7H10BFHFEHFFHFSTKBDA,C3H10BFHH, 1147H10COHRTNSTSH, 091SH

RELDDE

ESTE PROGRAMA ENCUEN-TRA LA RUTINA QUE SEHA PEDIDO Y LO EJECUTA,

OSF7OSF8OSFBOSFC08 FF090009010902090309060907090809 OB090 E090F0912091409 1 709180919091 A09 IB09 1C09 ID091 E092109240927092A092D093009330936093909 3C093F

09420943094409460943O94A094CO94D0950O951095409550956095709580959095A095B095D

1F113:1)09BECAOz.09o o

131 -~i--•J o. •— 'C3F308O "7O /

1F111 £09C3F1308EB22C0103EC332BF 1 0C9FEFDFBF7EFDFC3140DC36F08C36009C3850CC32BOBC3C90BC3BB09C313.0AC34209C3770CC 3 66 09C33F:OC

AF2FD3FHD3FC06FFOE3£¡ODC24CO905C24A091F1F1F3F171717D3FDC34S09

FDDATA

RELDDE

STJPLC

DATATL

FSTTBL

SCNDTL

RUTINA

STRTERDECBDECC

RARLXICMPJZINXINXINXINXJMPSTCRARLXIJMPXCHGSHLDMVISTARETFEFDFBF7EFDFJMPJMPJMPJMPJMPJMPJMPJMPJMPJMPJMPJMP

: DE

XRACMAOUTOLITMVIMVIDCRJNZDCRJNZRARRARRARCMCRALRALRALOUTJMP

D-, 0930HMSTJPLCHDDDFDDATA

Ü7091EHFDDATA

10COHAiCSH10BFH

SSESCAPELOADGOREU jREü':-.BRK. REMBRK. CHKERRORRWMEMBRK. INSREO. STR

ERROR

A

FDHFCHB,FFHC,38HCDECCBDECB

FDHSTRTER

"ESTA RUTINA GENERA UNA5 INDICACIÓN VISUAL Y AU-3 DIBLE SI SE PIDE UN PRC5 CESO QUE AL MOMENTO NO5 ES PERMITIDO.

SUBRUTINA LOAD

O 9 600962O9630965

O9660969096B096E097109720975097S097A097D09 SO09810984098509860987098A098B098 E098F0990099109920995099609970998099B099C099D099E099F09AO09 Al09 A 409A509A809A9O9AAO9AB09 A C09AD09AE09AF09BO09BÍ09B309B409B709B8

DBF657DBF7C9

3A6910FEOSCA4209CD6B015F216B103A6A10FE 00010000CAS 3091FD 2 SE 09030303Uütí'JÜV

3CC3A150909F5AFB9C29B09Fl3717C3AÍ509Fl3717ODODODC29C0917326A1073j£.O

72EB .7EEB!¿!-->77EB3EFF7721691034C36F08

RUTINA DE

BRKOUT

STRTBK

STBKID

CNTNESETBRK

BRKINS

INMOVINRET

INSERCIÓN

LDACPIJZCALLMOVLXILDACPILXIJZRARJNCINXINXINXJMPINRJMPDADPUSHXRACMPJNZPOPSTCRALJMPPOPSTCRALDCRDCRDCRJNZRALSTAMOVINXMOVXCHGMOVXCHGINXMOVXCHGMVIMOVLXIINRJMP

F6HD,AF7H

DE BREAKí

1069H08HERRORZEROUTE, AH, 106BH106AHOOHBi OOOOHSTRTBK

STBKIDBBBBRKOUTABRKINSBPSWAC:CNTNEPSW

BRKINSPSW

CC:CSETBRK

106AHM,EHM,D

A,M

HM,A

FFHM,AH, 1069HMESCAPE

5 ESTA SUBRUTINA LEE?DATOS (16 BITS) DEL;TECLADO.

ESTA RUTINA INSERTA UNBREAK EN LA LOCALIDADQUE SE INDIQUE DESDEEL TECLADO.ANTES VERI-FICA GUE EL NUMERO DEBREAKS YA INSERTADOSEA <£. DE SER ~& SALTAA LA RUTINA DE ERROR»

RUTINA DE REMOCIÓN DE BREAKS

O9BB09BE09CO09C309C609C909CA09CB09CD09DOQ9D109 D 209D309D409D609D709D809D909DA09DB09DD09DE09DF09E209E509E609E709ES09EB09EC09EF09F209F309F409F509F609F909FA09FB09FDOAOOOA01OA02OA05OA06OA09OAOAOAOBOAOCOAOFOA10

3A6910FEOOCA4209CD6B01CDEB09F57DFE83D 242 09JÍ.O

7E12FlE67F072D2D2D573E6BBD7ADAD609216A10772B35C36FOSSF2168103A6A10OF•~~f -~i

23!¿!w'D2F2O9F!57Dcr cr o o

D20FOA7BBECA090AFlC3F2097Aj£.--jBEC2050AFlC9

LDACPIJZCALLCALLPUSHMOVCPIJNCINXMOVLDAXPOP-AN I

ROTATE RLCDCRDCRDCRMOVMVICMPMOVJCLXIMOVDCXDCRJMP

CHKBRK MOVCHEKBK LXIFINDBK LDACNTROT RRC

INXINXINXJNC

CLADDR PUSHMOVCPIJNCMOVCMPJZ

PSWPOP POPJMP

HFADDR MOVINXCMPJNZ

RETRN POPRET

1069HOOHERRORZEROUTCHKBRKPSWA*L83HERRORHA,MDPSW7FH

LLLD,AA,6BHLA,DROTATEH, 106AHM,AAMESCAPEE, AHi 1068H106AH

HHHCNTROTPSWAiLOOLJO O ti

RETRNA, EMHFADDRPSWCNTROTA,DHMPSWPOPPSW

ESTA RUTINA REMUEVE UNBREAK DE LA LOCALIDADQUE SE INDIQUE DESDE ELTECLADO,, ANTES VERIFICAQUE EXISTA POR LO MENOSUN BREAK INSERTADO»SI EL NUMERO DE BREAKSINSERTADOS ES =0 SALTAA LA RUTINA DE ERROR»

RUTINA DE CHEQUEO DE NUMERO Y LOCALIZACION DE BREAKS

OA11OA14QA15CAÍ 6CAÍ 7OAIA

2138107EO707DA3BOAOF

LXIMOVRLCRLCJCRRC

H,IOSQH

HBKOUT

"ESTA RUTINA MUESTRA:?PRIMERO EL NUMERO DE5BREAKS INSERTADOS EN EL5 SISTEMA, Y EN CASO DE3 HABERLOS, MUESTRA SU?LOCALIZACION. ESTA FUN-

OA1BOA1COA1EOA21OA23OA26OA29OA2BOA2EOA2FOA31OA32OA33OA34OA36OA33OA3BOA3COA3DOA3EOA3FOA42OA43OA44OA45OA48OA49OA4BOA4DOA50O ASIÜA52OA53OA54OA55OA56OA57OA5AOA5BOA5COA5FOA61OA62OA63OA64OA67OA6SOA6BOA6COAóFOA70OA72OA74OA75OA76OA73OA7BOA7C

OFE60FCA260AFE09FA3DOA3A6910FEOOCA340AF53E40B677FlD3FOD3F5C3SOOSOFOF34E52A6A104D44El1169003CE60FFE09F2260A47F5791C1CÍC1FD2530AF505C27BOA26106BClCl3A6910BSC26FOAAF323S107ED3F1D3F42B7ED3F5C3SOOSFlC3530A

BRKERR

CNTERR

HBKOUT

BKOUT

INCRE

DISPLY

RSRPSW

RRCANIJZCPIÜHLDACPIJZPU3HMVIÜRAMOVPOPOIJTOUTJMPRRCRRCINRPUSHLHLDMOVMOVPOPUXIINRANICPIJPMOVPUSHMOVINRI MRINRRARJNCPUSHDCRJNZMVIMOVPOPPOLDACMPJNZXRASTAMOVOUTOUTDCXMOVOUTÜMPPOPJMP

OFHBRKERR09HBKOUT1069HOOHCNTERRPSWA,40HMM,APSWFOHF5HOUTDC

H106AHC,LB,HHD 7 00691AOFH09HBRKERRB,APSWAvCEEE

INCREPSWBRSRPSWH, 10HL,EBB1069HBDISPLYA10S8HA,MF1HF4HHA,MF5HOUTDC:PSWINCRE

CIQN ES CÍCLICA,

RUTINA DE EJECUCIÓN DE BREAK

OA7FOA82OAS3OAS4OAS7OAS8CAS"?GASAOASBCASEOA91OA92OA95OA98OA99OA9AOA9BOA9EOAA1OAA3OAA6OAA9OAABOAAEOABiOAB2OAB3OAB4OAB5OABSOAB9OABCCABEOAC1OAC4OAC6OAC9OACCCACEGADOGAD3OAD5OAD8CADAOADDGAEGOAE2OAE4OAE7OAE9OAEBGAEEOAF1GAF3OAF5GAFSOAFBOAFEOBO 1OB04OBG7GBG9

22AA10E32B22B41G•-'•j>o •«'F5El22B01021GGGGo o

22B21G31B010C5DS2032A9ÍG3A6710E6FDC2BÍGA3A6S10FEFFC2F1GAC3C40A17171717D2C40A1FD2DSOA3EFD326710C3A60A3EED3267 103AB510D3F1D3F43AB410D3F5C3E9GA3EDD3267 1G3AB310D3F1D3F43AB21OD3F53EFF326S1Gu^yuuyF661FEFF21B310C201GB326710C3E9GA31A91GCD130BSEA ABD

BRKEXC SHLDXTHLDCXSHLDINXINXPUSHPOPSHLDLXIDADSHLDLXIPUSHPUSHRIMSTALDAANIJNZ

NOTFND LDACPIJNZJMP

FINDR1 RALRALRALRAL.JNCRAR.JNCMVI

STOREA STAJMP

OUTB4 MVISTALDAOUTOUTLDAOUTJMP

OUTB5 MVISTALDAOUTOUTLDAOUT

OUTFD MVISTAJMP

FINDR2 ORÍCPILXIJNZSTAJMP

LOCREG LXICALLMVICMP

10AAH

H10B4HSPr~-p

PSWH10BOHH, OOOOHi>r*'

1GB2HSP, 10BOHBD

1GA9H1067HFDHFINDR1106SHFFHFINDR2GAC4H

OUTB4

OUTB5A, FDH1067HNOTFNDA.EDH1067H1GB5HF1HF4H10B4HF5HOUTFDA,DDH1G67H10B3HF1HF4H1OB2HFSHA, FFH106SHOUTDC61HFFHH, 1GB3HLOCREG1067HOUTFDSP, 1GA9HFNDREGA» AAHL

ESTA RUTINA ALMACENALOS REGISTROS DEL uPY SU STATUS AL MOMENTODEL BREAK Y MUESTRA ENLOS INDICADORES DE DATOSEL CONTENIDO DEL PAR DEDE REGISTROS SELECCIO-NADOS»

OBOAOBODOBÍOOBI 3OBI 5OBI 6OBI 7OB1SOBI 9OBI AOB1DOB1FOB20OB21OB22OB25OB26OB27OB2S

OB2BOB2EOB30OB3 1OB32OB33OB36OB37OB3AOB3DOB3FOB41OB44OB47OB4AOB4COB4FOB51OB54OB56OB59OB5AOB5BOB5DOB5EOB60OB63OB66OB67OB68OB6BOB6EOB6FOB70OB71OB72OB74OB76OB79

DA6FOA21A910C36FOA060 11F042B2B1FDAÍ60B3EFF17F505C2270BFlC9FlC3ÍFOB

RUTINA

3A6710F6CO171717D2S40B17D26EOB3A6810F661FEFFCA940B21B310CD130BFE7FCA990BFEEFC2590B3E7FC3660B4F7DFEAD790600CDACOBC3630B2B2B326810C36FOA1F1F1F1FF610E6DF3267103EFF

JCLXIJMP

FNDREG MVIRAR

FNDBIT I MRDCXDCXRARJCMVI

SETFC RALPUSDCRJNZPOPRET

HSETFC POPJMP

DE CHEQUEO DE

LDAORÍRALRALRALJIMCRALJIMCLDAORÍCP IJZLXI

DISPLYH, 10A9HDISPLYBiOlH

BHH

FNDBITFFH

H PSWB .H, SETFCPSW

PSWSETFC

REGISTROS Y

1067HCOH

Rb.üETA

RESTSP1068H61HFFHNOREOhU 10B3H

CALL FNDREGCPIJZCPIJNZMVIJMP

NOTHL MOVMOVCPIMOVMVICPJMP

DISPIM DCXDCX

DSPREG STAJMP

RESTSP RARRARRARRAR

HRSTSP ORÍANISTAMVI

7FHRESTPCEFHNOTHLA,7FHDISPIMC,A -A» UADHA,CB , OOHROTRGTDSPREGHH106SHDISPLY

10HDFH1067HA, FFH

MOVIMIENTO

3 ESTA RUTINA MUESTRA EL3 CONTENIDO DEL PAR DE•REGISTROS SIGUIENTE AL5 QUE INDICAN LOS LEOS3 DE STATUS DEL SISTEMA»3 EL DESPLAZAMIENTO DE3 ENCENDÍDO DE LOS LEDS5 ES HACIA LA DERECHA-

OB7BOB7EOBS1OB84OBy6OB89OB8BOBSEOB91OB94OB96OB99OB9COB9EOBA1OBA3QBA6OBA9OBACOBADOBAEOBB1OBB2OBB3OBB4OBB5OBB8OBB9OBBAOBBBOBBCOBBDOBCOOBC1OBC4OBC5OBC6

ÜBC9OBCCOBCEOBCFOBDOOBD1OBD4OBD5OBDSOBDBOBDDOBDFOBE2OBE3OBE4OBE7OBESOBE9OBEAOBEDOBEE

3268 i 021B310C36FOAF6FD326710

, 3EFD1 32631021BÍ10C36FOA3EFF3267103A6710E6EF3267103EFF326S1021B510C36FOA041FDAACOB371F3F172 1 B3 1 0172B2BF505C2C50BFl326S 1 0C9FlC3B80B

RUTINA

3A6710F6CO171717D21COC17D22COC3A6310F661FEFFCA940B1F1FD2260C171717D20FOC1F0600

STALXIJMP

RESETA ORÍSTAMVISTALXIJMP

NOREG MVISTA

RSETPC LDAANISTAMVISTALXIJMP

ROTRGT INRRARJCSTCRARCMCRALLXI

ROTLFT RALDCXDCXPUSHDCRJNZPOPSTARET

HRTLFT POPJMP

DE CHEQUEO DE

LDAORÍRALRALRALJNCRALJNCLDAORÍCPIJZRARRARJNCRALRALRALJNCRARMVI

106SHH, 10B3HDISPLYFDH1067HA, FDH106SHH-, 10B1HDISPLYA,FFH1067H1067HEFH1067HA,FFH106SH10B5HDISPLYB

ROTROT

H» 10B3H

HHPSWBHRTLFTPSW1068H

PSWROTLFT

REGISTROS

1067H60H

RSTPC

RESETI1QÓSH61HFFHNOREG

RSTSP

DISPHL

B,QOH

Y MOVIMIENTO <

ESTA RUTINA MUESTRA ELCONTENIDO DEL PAR - DEREGISTROS ANTERIOR ALQUE INDICAN LOS LEOS DESTATUS DEL SISTEMA. ELDESPLAZAMIENTO DE EN-CENDIDO DE LOS LEDS ESHACIA LA IZQUIERDA.

OBFOOBF1OBF2OBF506F6OBF7OBF3OBF9OBFCOBFDOBFEOBFFocooOC01OC04OC05ecosOCOBococOCOFOCIOOC11OC 1 3OC16OC19OC 1 C:OC1DOCIEOC1FOC20OC23OC26OC29OC2COC2FOC31OC34OC 36OC 39OC3C

OC3FOC42OC44OC47OC4AOC4BOC4COC4DOC50OC5 1OC53OC5 4OC57OC5AOC5COC5DOC5FOC60

0417DAFOOB37173F1F21A5101F.¿LO

ji'-JÍ

F505U20BOCFl3268 1 0C36FOAFlC3FCOB371FE6EF•"'•"'/. O 1 í"lC'x_O'_> J. IJ

21AB1QC36FOA371F1F1F326710C3990B3A6710C3720B3A6710F6FO3267103E7F326S1021A910C36FOA

RUTINA

3A6810FEFF21B510CA640C2B2B1FDA4AOCF53EA9BDFA5AOC21A910DBF677DBF72B77

RTLEFT INRRALJCSTCRALCMCRARLXI

RTRGHT RARINXINXPUSHDCRJNZPOPSTAJMP

HRTRGT POPJMP

DISPHL STCRARAMISTALXIJMP

RSTPC STCRARRARRARSTAJMP

RSTSP LDAJMP

RESETI LDAORÍSTAMVISTALXIJMP

DE CAMBIO DE C

LDACPILXIJZ

FNDSTR DCXDCXRARJCPUSHMVICMPJlvlLXI

LDREG INMOVINDCXMOV

B

RTLEFT

H, 10A5H

HHPSWBHRTRGTPSW1 06SHDI3PLYPSWRTRGHT

EFH1068HH, 10ABHDISPLY

1067HRESTPC1067HHRyTüP1067HFOH1067HA,7FH1068HH, 10A9HDISPLY

UNTEN I DO DE REGÍ

1068HFFHH, 10B5HPGMCTRHH

FNDSTRPSWA,A9HLLDREGH» 10A9HF6HM,AF7HHM, A

STRO

7 E¡D

5 CO;RE;EL;EN5 DA

ÍTA RUTINA CAMBIA ELCONTENIDO DEL PAR DEREGISTROS INDICADO POR

NUEVO DATO COPIADOLOS INDICADORES DE

OC61OC64OC67OC6SOC69OC6AOC6BOC6EOC6FOC72OC73OC74

OC77OC7AOC7BOC7COC7EocsoOC8 1OC8 2

OC85oes sOCS 9CCS 9ocscOC8FOC92OC94OC95OC9SOC9BOC9COC9FOCA 1OCA 2OCA 3OCA6OCA9OCACOCADOCA EOCAFOCB2OCB3OCB4OCB5OCB6OCB7OCB9OCBCOCBFOCC1OCC4OCC6

CSaOOS3A671017171717D25AQC1FDA42092B2BC35AOC

RUTINA DE

CD6B015F1AD3FOD3F5761 2C37AOS

RUTINA

CD6BO 15Fi AFEFFC2A90C2 1 38 i 0SESOA6CAA60C3 ABÓ 10122167103E08B677C3A90CCDD10C2186107-t!'•_•j¿O

723 1 AS 1 0Fl3OElDICl3EC33285103A6710F60F326710D3FDD3FO

JMPPGMCTR LDA

RALRALRALRALJNCRARJCDCXDCXJMP

OUTDC1067H

LDREG

ERRORHHLDREG

LECTURA /ESCRITURA DE

CALLMOVLDAXOUTOLITHALTSTAXJMP

DE EJECUCIÓN

CALLMOVLDAXCPIJNZLXIMVIANAJZLDASTAXLXIMVIORAMOVJMP

BRKGO CALLRUN LXI

MOVINXMOVLXIPOPSIMPOPPOPPOPMVI3TALDA.ORÍSTAOUTOUT

ZERGUTE, ADFOHF5H

DEOf'C'C'C-•_>'_- r o o

LOCALIDADES DE MEMORIA

5 ESTA RUTINA3 LOCAL I DAD DE? INDICADA Y C? CONTEN I DO BA•DESDE EL TEC

LEE LAMEMORIA

AMBIA SUJO COMANDOLADO.

DE PROGRAMA DEL USUARIO (GG)

ZEROUTE,ADFFHRUNH, 10S8HA,SGHMBRKGO10B6HDH, 1067HA»OSHMM,ARUNFINDGCH, 10S6HM,EHM,D3FS 10 ASPSW

HDBAiCSH10S5H1067HOFH1067HFDHFOH

5 ESTA RUTINA5 PROGRAMA DEL? PARTIR DE LA5 COPIAD A EN L3 RES DE DATOS

H

EJECUTA ELUSUARIO ALOCALIDADOS INDICADO„

occsOCC9OCCAOCCBOCCEOCD1OCD4OCD7OCD8OCD9OCDAOCDBOCDEOCDFOCEOOCE2OCE3OCE4OCE5OCESO CE 9OCECOCEDOCEEOCEFOCF2OCF3OCF6OCF7OCFSOCF9OCFAOCFBOCFCOCFDOCFEOCFFODOOODOiOD03OD04OD07ODOSODOBODOEODOFODIOOD11

FlElF92AAA10C385103A6A10216910Tr~j

23U-J!'

1FD2D70CF57DFE82DO7EBACAECOCFlC3D70C ,2B7EBBCAF60C23C3E80C23j¿-~'7E12Fl3F172B2B2BF53E6ABDC2100DFl326 A 1021691035C9FlC3FCOC

POPPOPSPHLLHLDJMP

FIMDOC LDALXI

LOGREO INXINXINXRARJNCPUSHMOVCPIRNCMOVCMPJZ

RSTRRG POP.JMP

ESAME DCXMOVCMPJZINXJMP

OKDE INXINXMOVSTAXPOPCMC

RTRIND RALDCXDCXDCXPUSHMVICMPJNZPOPSTALXIDCRRET

HRTIND POPJMP

PSWH

10AAH1085H106AHH, 1069HHHH

LOCREGPSWA,LO '""f LJO iiiL F i

A,MDESAMEPSWLOCREGHA,MEOKDEHRSTRRGHHA,MDPSW

HHHPSWA>6AHLHRTINDPSW106AHH, 1069HM

PSWRTRIND

RUTINA DE PASO A PASO <SS>

OD14OD17OD18OD1BODIEOD21OD22OD23OD26OD29

3A8S1017D2210D3AB610C34DOD371F32S31O3A6710F601

CNFTOC

LDARALJNCLDAJMPSTCRARSTALDAORÍ

10S8H

CNFTOC10B6HBITSEL

10S8H1067H01H

ESTA RUTINA EJECUTA ELPROGRAMA DEL USUARIOPASO A PASO DESDE LALOCALIDAD COPIADA ENLOS INDICADORES DE DA-TOS.

OD2BOD2DOD30OD32OD33OD34OD37OD3AOD3BOD3EOD41OD44OD450046OD49OD4AOD4DOD4EOD510052OD550057OD59OD5COD5E0061OD64OD66OD69OD6COD6FOD70OD71OD74OD76OD77OD7AOD7DOD7EOD81ODS4OD87OD3AOD8BOD8COD8FOD920095009700980099009COD9EOD9FODAOODASODA6ODA7ODAAODACODAFOOB2

E6F7326710D3FD1F1FDA410D2AB410EBCDD10CC3450DCD6B015PEB22B4107E32B61007DAC10D07DA640DE61CFEOCFAA30DFE1SCASCODC3690DFE09CA9200010ÍOOCD810D097E32B6103EFF7722B4102 A 36 10EBC3A90C2AB4102236103AB61077C9010200C36COO2AB4103E7677EB2133103E7FA677C3A90C3AB6101FD2B50D£604C2690D010300C36COO

STRTSS

¡:>yBTüL

LDPCOC

BITSEL

HONBYT

ONEBYTRSVRUN

RJPRUN

FXPOCD

TWOBYT

EXCHLT

LOWHLF

TREBYT

AIMISTAOUTRARRARJCLHLDXCHGCALLJMPCALLMOVXCHGSHLOMOVSTARLCJCRLCJCANICPIJMCPIJZJMPCPIJZLXICALLDADMOVSTAMVIMOVSHLDLHLDXCHGJMPLHLOSHLDLDAMOVRETLXIJMPLHLDMVIMOVXCHGLXIMVIANAMOVJMPLDARARJNCANIJNZLXIJMP

F7H1067HFDH

STRTSS10B4H

FINDOCC-OOT'-'I•-"•-.« O I -_«L_.

ZEROUTE, A

10B4HA,M10B6H

HGHBIT

HONBYT1CHOCHLOWHLF1SHTWOBYTONEBYTD9HEXCHLT&i 000 1HFXOPCDBA,M10B6HA,FFHM,A10B4H1086H

RUN10B4H10S6H10B6HM,A

B,0002HRSVRUN10B4HA,76HM,A

H? lUtíWHA,7FHMM, ARUN10B6H

CK3BYT04HONEBYTBi 0003HRSVRUN

ODB5ODB6ODB9ODBBODBEODC1ODC2ODC5ODC7ODC9ODCCODCEODD1ODD3ODD6ODD9ODDBODDEODEÍODE2ODE3ODE4ODE5ODE6ODE9ODEBODEEODF1ODF3ODF6ODF9ODFCODFDCEDOOE01OE03OE06OE07OEOSOE09OEOAOEOBOEOCOEOEOE11OE12OE13OElé.OE17OE1AQE1COE1DGE 1 EOE1FOE20OE22GE 23OE24OE25OE2SGE2AOE2D

1FD269CDE608CA690DC3AFOD07D2690DE&1CFE1CCA3BOEFE 13CA8CODFE14FAE90D3AB610FECDC2690DCDS10D235E!¿!-i¡56£BC3700DFE10C24FOE3AB610E6FSCDFCODDADEODC3AFODEB2ABO 1 0EBFEDOD22SOEF57B07075FFíE6082AB4104D443AB6107BC2200EE60137CSocrOí

C9E601373FCSC31EOEFEEODAOCOEFEFO

CK3BYT

HGHBIT

CALLJP

CKCALL

CKFGCN

MOV

SGNFLG

CRRYRT

RETURN

JPFGST

CYPYSN

RARJNCANIJZJMPRLCJNCANICPIJZCPIJZCPIJMLDACPIJNZCALLINXMOVINXMOVXCHGJMPCPIJNZLDAANICALLJCJMPXCHGLHLDXCHGCPIJNCPUSHA, ERLCRLCMOVPOPANILHLDMOVMOVLDAMOVJNZANISTCRZCMCRETANISTCCMCRZJMPCPIJCCPI

ONEBYTOSHONEBYTTREBYT

ONEBYT1CH1CHRSTART1SHTWOBYT14HCKCALL10B6HCDHONEBYTFXOPCD

E?MHD,M

RJPRUN10HNEXT10B6HFSHCKFGCNCALLJPTREBYT

10BOH

DOHCYPYSNPSW

E, APSWOSH10B4HCiLB,H10B6HA, E.JPFGST01H

01H

RETURNEOHCRRYRTFOH

OE2FOE32OE33OE34OE35OE36OE37OE3QOE3BOE3COE3DOE40OE43OE45OE46OE4SOE4BOE4COE4FOE51OE54OE57QE59OE5COE5EOE61OE64OE66OE69OE6BOE6EOE71OE73OE76OE79OE7COE7FOEQ2OES5OE36OE37OE83OES9OE8CCESEOE91OE94OE97OE9AOE9D

FSODF810FS13FS14F817F818F819F81AF81BF81Eí™821

D23BOEF57BOFOF5FFlC30COEF57BC3090E3AB610E6385F1600CDSÍODEBC3700DFEOCC2640E3AB610FEC3CADEODFEE3F2690DC3SCODFEOSCAEEODFEOOCA940E3AB610FEE9C28COECDSÍOD2AAA10C3700DCDSÍOD2AB2105E•""""í

"ñAEBC3700DFEC9C2690DC37FOE3AB610CDFCODDA7FOEC3690D

3A661022AA10E322B410• "•— '•~¡;1¡

F5El22B01021000039

HSNFLG

RSTART

NEXT

SKJUMP

RTRN

CHKRET

CNLRET

CKRT38

JNCPÜSHMOVRRCRRCMOVPOPJMPPUSHMOVJMPLDAANIMOVMVICALLXCHGÜMPCPIJNZLDACPIJZCPIJPÜMPCPIJZCPIJZLDACPIJNZCALLLHLDJMPCALLLHLDMOVINXMOVXCHGJMPCPIJNZJMPLDACALLJCJMP

LDASHLDXTHLSHLDINXINXPUSHPOPSHLDLXIDAD

HSNFLGPSWA, E

E, APSWCRRYRTPSWA, ESGNFLO10B6HO OLÍ•_"-'r!

E,ADíOOHFXOPCD

RJPRUIMOCHCKJUMP10B6HC3HCALLJPE3HONEBYTTWOBYT08HCKCALLOOHCNLRET10B6HE9HCHKRETFXOPCD10AAHRJPRUNFXOPCD10B2HE,MHDiM

RJPRUNC9HONEBYTRTRN10B6HCKFGCNRTRNONEBYT

1066H10AAH

10B4HSPo o•—'I

PSWH10BOHHi OOOOHSP

F y k!i~y.«¿-.jF82SF829F82AF82DF82EFtí!¿lFF832Froo^iO O--.'

F836F839F83CF83EF841F844F845F847F84AF84DF850FOC" 1•_'•_' I

F854F855F858F85BF85EFS61F862F865F866F369F86CF86FF870F873F876F877F878F879F87CF87D

22B21031B010C5D52AB4102BEB31A910O/\OO 1 t"\ H «-"--A U

17DA4AFS3A6910FEOOCA5BF8CDEC097DFE83D25BF8CD6CFQ2AB210F92AB4ÍOE52AAA10C37FOACD6CF82AB210.i— _

2AB410E52AAA10U'J-Jc! 1 1

210000392283 1 031AC10DIClFl2A8310F9C9

CKFRBK

BREAK

ALLBAK

SHLDLXIPUSHPUSHLHLDDCXXCHGLXIUDARALJCLDACPIJZCALLMOVCPIJNCCALLLHLDSPHLLHLDPUSHLHLDJMPCALLLHLDSPHLLHLDPUSHLHLDJMPLXIDADSHLDLXIPOPPOPPOPLHLDSPHLRET

10B2HSP> 10BOHBD10B4HH

SP, 10A9H108SH

BREAK1069HOOHUSER38CHEKBKA,L83HUSER3SALLBAK10B2H

10B4HH10AAHBRKEXCALLBAK10B2H

10B4HH10AAHRST3QI-UOOOOHSP1033HSP, 10ACHDBPSW1033H

Quito, Diciembr d 198ee 3 - EPN: Página de...

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